UPD78F0411 時鐘控制(2)
UPD78F0411 時鐘控制(2)
1.4 控制內(nèi)部低速振蕩時鐘示例
內(nèi)部低速振蕩時鐘不能用作CPU 時鐘。
只有如下外部硬件可以使用這個時鐘。
看門狗定時器
8 位定時器H1 (選擇fRL, fRL/27 或fRL/29 作為計數(shù)時鐘時)
LCD控制器/驅(qū)動器(選擇fRL/23 作為LCD 時鐘源時)
此外,可以通過選項字節(jié)選擇如下操作模式。
內(nèi)部低速振蕩器不能停止
內(nèi)部低速振蕩器可由軟件停止
在復(fù)位釋放后內(nèi)部低速振蕩器自動開始振蕩,并且如果通過選項字節(jié)允許看門狗定時器操作,則驅(qū)動看門狗定時器
(240 kHz (TYP.))。
(1) 停止內(nèi)部低速振蕩時鐘時設(shè)置過程示例
1> 將LSRSTOP 置1 (RCM 寄存器)
LSRSTOP 置1 時,停止內(nèi)部低速振蕩時鐘。
(2) 內(nèi)部低速振蕩時鐘重新振蕩時設(shè)置過程示例
1> LSRSTOP 清零(RCM寄存器)
LSRSTOP 清零時,內(nèi)部低速振蕩時鐘重新振蕩。
注意事項如果通過選項字節(jié)選擇“不能停止內(nèi)部低速振蕩器”,則不能控制內(nèi)部低速振蕩時鐘的振蕩。
1.5 CPU 和外部硬件所采用的時鐘
下表顯示了CPU 和外部硬件采用的時鐘之間的關(guān)系及寄存器的設(shè)置。
備注1. XSEL: 主時鐘模式寄存器(MCM)的第2 位
2. CSS: 處理器時鐘控制寄存器(PCC)的第4 位
3. MCM0: MCM的第0 位
4. EXCLK: 時鐘操作模式選擇寄存器(OSCCTL)的第7 位
5. X:不必考慮
1.6 CPU 時鐘狀態(tài)轉(zhuǎn)換圖
圖5-15 顯示了該產(chǎn)品CPU 時鐘狀態(tài)轉(zhuǎn)換圖。
備注在2.7 V/1.59 V POC 模式下(選項字節(jié): POCMODE = 1),當(dāng)供電電壓超過2.7V(TYP.)時CPU 時鐘狀態(tài)轉(zhuǎn)換為上圖所示的(A),而在復(fù)位處理后(11 ~ 47 μs (TYP.))變到(B)。
表5-5 顯示了CPU 時鐘的切換過程與SFR 寄存器設(shè)置示例
表5-5. CPU 時鐘切換與SFR 寄存器設(shè)置示例
(1) 復(fù)位釋放后(A)CPU 使用內(nèi)部高速振蕩時鐘(B)
狀態(tài)轉(zhuǎn)換 | SFR 寄存器設(shè)置 |
(A) →(B) | SFR 寄存器不必設(shè)置(復(fù)位釋放后默認(rèn)狀態(tài)). |
(2) 復(fù)位釋放后(A)CPU 使用高速系統(tǒng)時鐘(C)
(復(fù)位釋放后CPU 立即使用內(nèi)部高速振蕩時鐘(B)。
注意事項供電電壓達(dá)到所用時鐘的操作電壓后,設(shè)置時鐘。
(3) 復(fù)位釋放后(A)CPU 使用副系統(tǒng)時鐘(D)
(復(fù)位釋放后CPU 立即使用內(nèi)部高速振蕩時鐘(B)。
備注1. 表5-5 的(A) 到(I)對應(yīng)圖5-15 的(A)到(I)。
2. EXCLK, OSCSEL, OSCSELS:
時鐘操作模式選擇寄存器(OSCCTL)的第7、6 位和第4 位
MSTOP: 主OSC 控制寄存器(MOC)的第7 位
XSEL, MCM0: 主時鐘模式寄存器(MCM)的第2 位與第0 位
CSS: 處理器時鐘控制寄存器(PCC)的第4 位
(4) CPU 時鐘從內(nèi)部高速振蕩時鐘(B)切換到高速系統(tǒng)時鐘(C)
注復(fù)位釋放后該標(biāo)志只能被修改一次。如果已經(jīng)設(shè)置了該項,則無需再設(shè)置。
注意事項供電電壓達(dá)到所用時鐘的操作電壓后,設(shè)置時鐘(參見第二十七章電氣特性(標(biāo)準(zhǔn)產(chǎn)品)) 。
(5) CPU 時鐘從內(nèi)部高速振蕩時鐘(B)切換到副系統(tǒng)時鐘(D)
備注1. 表5-5 的(A) 到(I)對應(yīng)圖5-15 的(A)到(I)。
2. EXCLK, OSCSEL, OSCSELS:
時鐘操作模式選擇寄存器(OSCCTL)的第7、6 位和第4 位
MSTOP: 主OSC 控制寄存器(MOC)的第7 位
XSEL, MCM0: 主時鐘模式寄存器(MCM)的第2 位與第0 位
CSS: 處理器時鐘控制寄存器(PCC)的第4 位
(6) CPU 時鐘從高速系統(tǒng)時鐘(C)切換到內(nèi)部高速振蕩時鐘(B)
(7) CPU 時鐘從高速系統(tǒng)時鐘(C)切換到副系統(tǒng)時鐘(D)
(8) CPU時鐘從副系統(tǒng)時鐘(D)切換到內(nèi)部高速振蕩時鐘(B)
備注1. 表5-5 的(A) 到(I)對應(yīng)圖5-15 的(A)到(I)。
2. MCM0: 主時鐘模式寄存器(MCM)的第0 位
OSCSELS: 時鐘操作模式選擇寄存器(OSCCTL)的第4 位
RSTS, RSTOP: 內(nèi)部振蕩模式寄存器(RCM)的第7 位和第0 位
CSS: 處理器時鐘控制寄存器(PCC)的第4 位
(9) CPU 時鐘從副系統(tǒng)時鐘(D)切換到高速系統(tǒng)時鐘(C)
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