基于FPGA的MSK調(diào)制器設(shè)計與實現(xiàn)
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8位相位累加器的仿真波形如圖6所示。由波形圖可以看出，當(dāng)k=08時，在每一個有效脈沖的作用下，輸出的數(shù)值比前一個輸出的數(shù)值大8；當(dāng)k=09時，輸出的數(shù)值比前一個輸出的數(shù)值大9；結(jié)果證明，該程序?qū)崿F(xiàn)了相位的累加。本文引用地址：http://cafeforensic.com/article/190460.htm
2．3．3 正弦ROM表的FPGA實現(xiàn)
用相位累加器輸出的數(shù)據(jù)作為波形存儲器的取樣地址，完成相位序列(相位碼)向幅度序列(幅度碼)的轉(zhuǎn)換。這里用ROM構(gòu)造一個查找表。N位的尋址ROM相當(dāng)于把一個周期的正弦波形信號離散成具有2N個幅值的序列，若波形ROM有D位數(shù)據(jù)位，則2N個幅值以D位二進制數(shù)值固化在FPGA的ROM中，按照給定地址的不同可以輸出相應(yīng)相位的正弦信號的幅度編碼。
本文ROM表采用64個采樣點。其波形仿真如圖圖7所示，從圖中可以看出，地址位從00H變化到20H時，輸出信號值從FFH變到00H，正好為正弦波的四分之一個周期，結(jié)果證明：通過查詢該ROM表，可以生成不同頻率的正弦波。
把上述各部分所生的symbol在QuartusII7．2提供的BlockDiagram／SchematicFile中用Graphic Editor編輯連接起來，就形成了圖1的虛線所示的部分，編譯后進行整體模塊仿真，經(jīng)過器件編程，可將整體模塊程序燒寫到合適的FPGA芯片中，再配以相應(yīng)的D／A器件及其他外圍電路，調(diào)試后即完成設(shè)計。
3 結(jié)束語
用FPGA來實現(xiàn)MSK信號調(diào)制器，電路簡單，設(shè)計靈活，便于修改和調(diào)試，可靠性高。特別是對數(shù)控振蕩器的設(shè)計，正弦函數(shù)的ROM表格，直接采用VHDL的CASE語句實現(xiàn)，避免了調(diào)用ROM塊，降低了系統(tǒng)的設(shè)計規(guī)模，減少了系統(tǒng)對邏輯資料的需求；另外Altera公司的QuatusII7.2 應(yīng)用軟件具有較強大的開放性和綜合性，它可以利用其它各種EDA資源以及先進的設(shè)計方法，使其功能更加完善和強大。它可以實現(xiàn)從簡單的接口電路設(shè)計到復(fù)雜的狀態(tài)機，甚至“Sys-temon Chip”。它的可編程特性帶來了電路設(shè)計的靈活性，縮短了產(chǎn)品的“Time ToMarket”。
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