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          Stm32時鐘分析

          作者: 時間:2016-11-28 來源:網(wǎng)絡(luò) 收藏

          本文引用地址:http://cafeforensic.com/article/201611/322683.htm

          RCC->CFGR=0X00000400; //APB1/2=DIV2;APB2=DIV1;AHB=DIV1;查詢中文手冊可知,

          apb1最大為36MHZ所以這里要對其分頻,因為經(jīng)過這番設(shè)置PLLMUL輸出后為72MHZ所以為,這里要讓APB1/2=DIV2是36MHZ。

          PLL-=2;//抵消2個單位

          RCC->CFGR|=PLL<<18;//設(shè)置PLL值2~16設(shè)置PLL為9倍頻

          RCC->CFGR|=1<<16; //PLLSRC ON設(shè)置HSE為輸入時鐘,因為第cfgr的17位也為0,所以HSE輸入到PLLSRC的就是8M

          此時hse為8MHZ顯然經(jīng)過上面的9倍頻,經(jīng)分析可知輸出到AHB的SYSCLK為72MHZ。因為前面設(shè)置AHB不分頻,所以AHB輸出也是72MHZ。apb1因為前面分頻了所以輸出后為36MHZ。apb2為72MHZ

          第七步:

          FLASH->ACR|=0x32; //FLASH 2個延時周期

          第八步:

          RCC->CIR = 0x00000000;//關(guān)閉所有中斷

          第九步:

          //配置向量表

          #ifdefVECT_TAB_RAM

          MY_NVIC_SetVectorTable(NVIC_VectTab_RAM, 0x0);

          #else

          MY_NVIC_SetVectorTable(NVIC_VectTab_FLASH, 0x0);//這里用到的就是flash啟動

          #endif

          第十步:

          RCC->CR|=0x00010000;//外部高速時鐘使能HSEON,注意使能hseon之前外部時鐘不能直接或間接的為系統(tǒng)時鐘,也就是說cfgr中的SW位先為0,因為在第五步已經(jīng)設(shè)為0了,所以這里無需顧慮。

          while(!(RCC->CR>>17));//等待外部時鐘就緒

          第十一步:打開PLL,

          RCC->CR|=0x01000000;//PLLON

          while(!(RCC->CR>>25));//等待PLL鎖定

          第十二步:

          RCC->CFGR|=0x00000002;//PLL作為系統(tǒng)時鐘

          while(temp!=0x02)//等待PLL作為系統(tǒng)時鐘設(shè)置成功

          {

          temp=RCC->CFGR>>2;

          temp&=0x03;

          }

          結(jié)合Stm32_Clock_Init()時鐘配置過程,我總結(jié)時鐘配置就是大致如下步驟:

          關(guān)所有外設(shè)時鐘,
          (1)使能HSI并關(guān)閉HSE,PLL,CSS,配置分頻寄存器,并且在crgr中將系統(tǒng)時鐘設(shè)為HSI。
          (2)關(guān)所有中斷。
          (3)配置向量表。
          (4)使能HSE,CR中等待設(shè)置完畢。
          (5)打開PLL,CR中等待PLL開啟。
          (6)在cfgr中sws位等待PLL成為系統(tǒng)時鐘。


          結(jié)合上述方式,我改寫的代碼如下:
          void Stm32_Clock_Init111(u8 PLL)
          {

          unsigned char temp=0;
          RCC->APB1RSTR = 0x00000000;//復(fù)位結(jié)束
          RCC->APB2RSTR = 0x00000000;

          RCC->AHBENR = 0x00000014;//睡眠模式閃存和SRAM時鐘使能.其他關(guān)閉.
          RCC->APB2ENR = 0x00000000; //外設(shè)時鐘關(guān)閉.
          RCC->APB1ENR = 0x00000000;

          RCC->CR &= 0xFEF2FFFF;//該步的主要作用是開啟內(nèi)部HSION,且關(guān)閉HSE,CSS,PLLON

          RCC->CFGR=0X00000400; //APB1=DIV2;APB2=DIV1;AHB=DIV1; HSE設(shè)置為不分頻,CFGR的主要作用是配置分頻,分頻之前當(dāng)然要把cr中HSE時鐘全關(guān)閉只開啟HSI時鐘。當(dāng)然還有一個重要的作用是,設(shè)置當(dāng)前是誰作為系統(tǒng)時鐘,就是SW位。


          PLL-=2;//抵消2個單位
          RCC->CFGR|=PLL<<18;//設(shè)置PLL值 2~16
          RCC->CFGR|=1<<16;//PLLSRC ON

          FLASH->ACR|=0x32;//FLASH 2個延時周期

          RCC->CIR = 0x00000000;//關(guān)閉所有中斷
          //配置向量表
          #ifdefVECT_TAB_RAM
          MY_NVIC_SetVectorTable(NVIC_VectTab_RAM, 0x0);
          #else
          MY_NVIC_SetVectorTable(NVIC_VectTab_FLASH, 0x0);//這里用到的就是flash啟動
          #endif

          RCC->CR|=0x00010000;//外部高速時鐘使能HSEON
          while(!(RCC->CR>>17));//等待外部時鐘就緒
          RCC->CR|=0x01000000;//PLLON
          while(!(RCC->CR>>25));//等待PLL鎖定
          RCC->CFGR|=0x00000002;//PLL作為系統(tǒng)時鐘
          while(temp!=0x02)//等待PLL作為系統(tǒng)時鐘設(shè)置成功
          {
          temp=RCC->CFGR>>2;
          temp&=0x03;
          }

          }



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