Berkeley Design:IC設(shè)計(jì)需要高效軟件
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數(shù)字技術(shù)在電子產(chǎn)品中得到了廣闊的應(yīng)用,數(shù)字技術(shù)的發(fā)展帶來(lái)的結(jié)果不是模擬技術(shù)的減少而是增加。數(shù)字采用的不過是新的技術(shù),而模擬采用的則是全部的技術(shù),現(xiàn)在模擬技術(shù)采用的技術(shù)已經(jīng)幾乎與數(shù)字完全相同。消費(fèi)電子的發(fā)展有兩大趨勢(shì),一是內(nèi)存的增加速度越來(lái)越快,另一個(gè)是模擬電源技術(shù)的增多,供電量增加電源管理難度也隨之加大。不僅如此,模擬和RF電路在半導(dǎo)體元件中變得越來(lái)越普及,復(fù)雜時(shí)鐘和IO也更加重要,模擬IP則是隨處可見。因此,如何應(yīng)對(duì)模擬電路快速在IC中增加是個(gè)問題,解決這個(gè)問題更多的依靠軟件的支持。
目前,對(duì)模擬電路分析主要采用傳統(tǒng)的SPICE,而對(duì)數(shù)字電路則流行Digital FastSPICE,但兩種方法都存在很難同時(shí)高速且高效地同時(shí)支持?jǐn)?shù)字和模擬信號(hào)分析的尷尬。正是看到這樣一個(gè)局勢(shì),Berkeley Design開發(fā)出Precision Circuit Analysis軟件,實(shí)現(xiàn)對(duì)模擬和數(shù)字混合信號(hào)的高速與高效分析,可以有效地將仿真時(shí)間縮短到原來(lái)的1/10甚至更短。該軟件包括Analog FastSPICE、RF FastSPICE和PLL Noise Analyzer等功能,適合于絕大多數(shù)混合信號(hào)的仿真與開發(fā)分析。該類軟件特別適合消費(fèi)電子、電信與網(wǎng)絡(luò)應(yīng)用,目前已經(jīng)可以支持45nm芯片設(shè)計(jì)。正如該公司CEO所說(shuō):“我們的工具縮短了電路驗(yàn)證與芯片測(cè)定之間不斷增加的差別。”
評(píng)論