clk90_bufg的輸出要代替由原interface_clk驅(qū)動(dòng)的IOB上的時(shí)鐘。要將IOB從原來(lái)的時(shí)鐘域中移開(kāi)，需要定位IOB，標(biāo)注時(shí)鐘輸入端衰減器并按下Delete鍵移除這一連接。這樣我們就可以將新的clk90_bufg時(shí)鐘連接到這兒，從而完成整個(gè)補(bǔ)丁。要連接BUFG (clk90_bufg)的輸出，按住Ctrl鍵不放，在窗口Array2中標(biāo)注BUFG的輸出端衰減器并在Array1窗口中選擇IOB的時(shí)鐘輸入。松開(kāi)Ctrl鍵，點(diǎn)擊鼠標(biāo)右鍵顯示選項(xiàng)菜單并選擇Add。這樣就最終完成了BUFG輸出和IOB之間的連接，而IOB則用來(lái)驅(qū)動(dòng)下游ASIC的新建接口，利用interface_clk90時(shí)鐘就可以正確地捕獲傳輸?shù)臄?shù)據(jù)。

　　這樣就完成了ASIC的補(bǔ)丁。現(xiàn)在重新運(yùn)行設(shè)計(jì)規(guī)則(DRC)檢查器，確保沒(méi)有引入任何新的錯(cuò)誤。在菜單條中點(diǎn)擊Tools →DRC →Run。

　　腳本完成并且沒(méi)有錯(cuò)誤的情況下，就可以回到菜單選擇Tool →Script →End Recording。這將停止并關(guān)閉腳本記錄過(guò)程，下次需要這一ASIC補(bǔ)丁時(shí)你還可以重新利用這一腳本。一個(gè)不錯(cuò)的方法是在文本編輯器中打開(kāi)腳本文件，將所有GUI Post 和 Unpost命令去除。這些命令并不是必要的，而且留著它們還讓腳本難于閱讀。下面的文本就是我們ASCI補(bǔ)丁的腳本。 如前面所述，內(nèi)容非常直接，易于讀取。

unselect -all
setattr main edit-mode Read-Write
add -s “BUFGCTRL_X0Y28” comp
clk90_bufg ;
setattr comp clk90_bufg type BUFG
unselect -all
select pin ‘BUFGCTRL_X0Y28.I0’
select pin ‘DCM_ADV_X0Y11.CLK90’
add
post attr net $NET_0
setattr net $NET_0 name
DCM_clk90_out
unselect -all
select pin ‘OLOGIC_X0Y2.CLK’
delete
unselect -all
select pin ‘ILOGIC_X0Y3.CLK’
delete
unselect -all
select pin ‘ILOGIC_X0Y3.CLK’
select pin ‘OLOGIC_X0Y2.CLK’
select pin ‘BUFGCTRL_X0Y28.O’
add
post attr net $NET_1
setattr net $NET_1 name
clk90_bufg_out
unselect -all
drc
save -w design “patch.ncd”
“patch.pcf”
exit
end

　　仔細(xì)看看腳本內(nèi)容，看能否分辨出對(duì)應(yīng)GUI中做的動(dòng)作。

　　很重要的是，可以從GUI(在菜單條 Tool →Scripts →Playback下)中或命令行回放這一腳本。 要在編譯腳本中加入補(bǔ)丁，只需要增加下面一條命令就可以了：

　　fpga_edline yourdesign.ncd

　　yourdesign.pcf -p yourscript.scr

　　應(yīng)當(dāng)在布局布線(PAR)完成后再執(zhí)行這一命令，即當(dāng)NCD和PCF文件完成后。

　　FPGA Editor真的是一項(xiàng)強(qiáng)大的用戶工具，盡管并非每個(gè)人都希望或需要在設(shè)計(jì)過(guò)程中用到它。 但當(dāng)需要一些特殊處理或需要在某些地方突破規(guī)則以使設(shè)計(jì)功能更強(qiáng)時(shí)，沒(méi)有其它工具能夠像FPGA Editor一樣提供如此強(qiáng)大的能力。你的FAE能夠向你展示其功能，展示FPGA Editor如何幫助你完成設(shè)計(jì)調(diào)試和驗(yàn)證，當(dāng)然還包括對(duì)規(guī)則的突破。