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          利用頻域時鐘抖動分析加快設計驗證過程(07-100)

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          作者:安捷倫科技 Akihiko Oginuma 時間:2009-03-04 來源:電子產(chǎn)品世界 收藏

           

          本文引用地址:http://cafeforensic.com/article/92051.htm

            圖8 利用交叉關(guān)聯(lián)技術(shù)獲得的出色本底噪聲

            實時仿真

            圖9表示直接應用于相位噪聲信號的功能的結(jié)果。您可以看到如何消除頻譜的不同部分,使您可以分析與應用相關(guān)的。E5052B對相位噪聲測量的實時分析功能可加快您的設計進程。E5052B SSA可以導入任何函數(shù),使您可以輕松快速地仿真設備到設備的PLL響應。

           

            圖9 仿真PLL響應

            結(jié)語

            對于高速串行數(shù)據(jù)應用,抖動分析的主要目的是確定參考的抖動對系統(tǒng)比特誤碼率的影響。最精確的方法是對時鐘應用發(fā)射機(和接收機)在最壞情況下的傳遞函數(shù),并測量獲得的時鐘RJ和PJ。在E5052B上運行的E5001A精確時鐘抖動分析軟件改變了傳統(tǒng)的抖動測量方式,它不僅能以飛秒級分辨率對時鐘抖動進行全面分析,而且具有出色的易用性和實時抖動分析功能,可以幫助您加快設計驗證過程。


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