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數(shù)字下變頻
數(shù)字下變頻 文章 進(jìn)入數(shù)字下變頻技術(shù)社區(qū)
基于CORDIC算法的中頻多路控守系統(tǒng)設(shè)計(jì)
- 針對(duì)無(wú)線(xiàn)接收技術(shù)向著大帶寬、高采樣的方向發(fā)展，軍地的頻譜管理設(shè)備已經(jīng)不能滿(mǎn)足日常的訓(xùn)練和執(zhí)法需求，本文提出了一種基于CORDIC算法的中頻多路控守系統(tǒng)設(shè)計(jì)方法，直接采集超外差接收機(jī)的中頻輸出信號(hào)，從而實(shí)現(xiàn)多達(dá)32路或者64路的窄帶信號(hào)提取、存儲(chǔ)、分析、回放等。作為事后分析取證等，彌補(bǔ)當(dāng)前設(shè)備的不足。文中介紹了CORDIC的基本原理，核心實(shí)現(xiàn)基于CORDIC算法的nco和子帶變頻器，并在Xilinx平臺(tái)上驗(yàn)證成功。
- 關(guān)鍵字： CORDIC 軟件無(wú)線(xiàn)電 NCO 數(shù)字下變頻 信號(hào)分析 202301
基于FPGA的數(shù)字下變頻設(shè)計(jì)與仿真
- 在軟件無(wú)線(xiàn)電數(shù)字接收機(jī)中，從AD前端采集過(guò)來(lái)的數(shù)字信號(hào)頻率高達(dá)72 MHz，如此高的頻率使得后端DSP不能直接完成相關(guān)的數(shù)字信號(hào)處理任務(wù)。因此合理的設(shè)計(jì)基于FPGA的DDC，以降低數(shù)字信號(hào)頻率，方便后端DSP實(shí)時(shí)完成相關(guān)的數(shù)字信號(hào)處理任務(wù)就顯得尤為重要。在很多數(shù)字信號(hào)處理系統(tǒng)中，數(shù)字信號(hào)頻率是非常高的，而后端數(shù)字信號(hào)處理器件幾乎不能滿(mǎn)足系統(tǒng)的實(shí)時(shí)性要求，此時(shí)通過(guò)合理的設(shè)計(jì)DDC就可以解決上述問(wèn)題。
- 關(guān)鍵字： 軟件無(wú)線(xiàn)電 systemgenerator 數(shù)字下變頻
基于Simulink的數(shù)字下變頻器設(shè)計(jì)及其FPGA實(shí)現(xiàn)
- 數(shù)字下變頻是數(shù)字接收機(jī)中一個(gè)重要組成部分,實(shí)現(xiàn)將高速ADC轉(zhuǎn)換后的數(shù)字信號(hào)進(jìn)行抽取和濾波,得到低速的數(shù)字基帶信號(hào)。針對(duì)傳統(tǒng)模擬接收機(jī)系統(tǒng)帶寬較窄,系統(tǒng)體積大,同時(shí)缺少靈活性的缺點(diǎn),本文利用MATLAB的Simulink工具箱結(jié)合Altera公司的DspBuilder軟件,仿真和設(shè)計(jì)了一體積較小(只需要一片F(xiàn)PGA)、可靈活配置的中頻數(shù)字寬帶接收機(jī),并進(jìn)行了FPGA的硬件實(shí)現(xiàn)。實(shí)驗(yàn)結(jié)果表明:設(shè)計(jì)的數(shù)字中頻接收機(jī)具有系統(tǒng)帶寬較寬,體積較小,可以進(jìn)行靈活的配置,能滿(mǎn)足不同的性能要求等優(yōu)點(diǎn)。
- 關(guān)鍵字： Simulink 數(shù)字接收機(jī) 數(shù)字下變頻
重新思考快速寬頻ADC中的數(shù)字下變頻
- 寬帶每秒數(shù)千兆個(gè)樣本(GSPS)模數(shù)轉(zhuǎn)換器(ADC) 為高速采集系統(tǒng)帶來(lái)眾多性能優(yōu)勢(shì)。這些ADC在高采樣率和輸入帶寬下提供較寬的可見(jiàn)頻譜。然而，有些情況需要寬帶前端，有些則要求能夠?yàn)V波并調(diào)諧為較窄的頻帶。
- 關(guān)鍵字： 數(shù)字下變頻 ADC 快速寬頻
基于AD9680的寬帶高動(dòng)態(tài)全數(shù)字雷達(dá)接收機(jī)設(shè)計(jì)
- 針對(duì)某寬帶雷達(dá)數(shù)字接收機(jī)對(duì)帶寬、動(dòng)態(tài)、處理速度、多通道等指標(biāo)的需求，設(shè)計(jì)了一種基于新型ADC器件AD9680的寬帶高動(dòng)態(tài)全數(shù)字雷達(dá)接收機(jī)驗(yàn)證平臺(tái)。文中首先在搭建的平臺(tái)上對(duì)AD9680進(jìn)行全帶寬模式和數(shù)字下變頻模式的性能驗(yàn)證與結(jié)果分析，根據(jù)分析結(jié)果提出改善AD9680動(dòng)態(tài)性能的方案;其次，對(duì)AD9680兩個(gè)通道之間的同步性做了驗(yàn)證，并提出了一種針對(duì)雙通道時(shí)間偏差的優(yōu)化方法。各項(xiàng)結(jié)果表明，AD9680能滿(mǎn)足某寬帶雷達(dá)的應(yīng)用需求。
- 關(guān)鍵字： AD9680 寬帶雷達(dá)數(shù)字接收機(jī) JESD204B 數(shù)字下變頻 雙通道同步
基于FPGA的高速數(shù)字下變頻系統(tǒng)設(shè)計(jì)
- 摘要：基于FPGA設(shè)計(jì)了一高速數(shù)字下變頻系統(tǒng)，在設(shè)計(jì)中利用并行NCO和多相濾波相結(jié)合的方法有效的降低了數(shù)據(jù)的速率，以適合數(shù)字信號(hào)處理器件的工作頻率。為了進(jìn)一步提高系統(tǒng)的整體運(yùn)行速度，在設(shè)計(jì)中大量的使用了FPGA中
- 關(guān)鍵字： 數(shù)字下變頻 并行NCO 多相濾波 DSP48
基于多相濾波結(jié)構(gòu)的信道化及FPGA實(shí)現(xiàn)
- 摘要 隨著現(xiàn)代電子戰(zhàn)中電磁環(huán)境的日益復(fù)雜，軍用接收機(jī)需具備同時(shí)處理多個(gè)信道信號(hào)的能力，即具備全概率截獲能力。信道化接收機(jī)可將一個(gè)復(fù)雜信號(hào)分成多個(gè)信道，從而方便后續(xù)處理。文中利用一種簡(jiǎn)化的結(jié)構(gòu)驗(yàn)證了該種
- 關(guān)鍵字： 數(shù)字下變頻 多相濾波 信道化
數(shù)字下變頻器中坐標(biāo)變換模塊的ASIC實(shí)現(xiàn)
- 1．引言數(shù)字下變頻(DDC)技術(shù)是軟件無(wú)線(xiàn)電接收機(jī)的核心技術(shù)。其基本功能是從輸人的寬帶高速數(shù)字信號(hào)...
- 關(guān)鍵字： 數(shù)字下變頻 DDC ASIC 坐標(biāo)變換
寬帶短波信道模擬器中數(shù)字下變頻的實(shí)現(xiàn)
- 摘要： 寬帶短波信道模擬器是一種運(yùn)用仿真技術(shù)對(duì)真實(shí)的短波信道進(jìn)行模擬的儀器。首先指出數(shù)字下變頻在寬帶短波信道模擬器中的作用。然后，闡述了數(shù)字下變頻中的數(shù)控振蕩器、CIC 濾波器、半帶濾波器和低通濾波器
- 關(guān)鍵字： 寬帶 短波 信道模擬器 數(shù)字下變頻
基于FPGA的數(shù)字下變頻電路的設(shè)計(jì)與實(shí)現(xiàn)
- 引言數(shù)字化中頻(DIF)頻譜分析儀在高中頻實(shí)現(xiàn)數(shù)字化處理，具有分析帶寬大、RBW小、測(cè)量時(shí)長(zhǎng)短，可對(duì)復(fù)雜信...
- 關(guān)鍵字： FPGA 數(shù)字下變頻 VHDL
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數(shù)字下變頻介紹
數(shù)字下變頻
在超外差式接收機(jī)中，如果經(jīng)過(guò)混頻后得到的中頻信號(hào)比原始信號(hào)的頻率低，那么此種混頻方式叫做下變頻 （Down Converter or DC）。將射頻信號(hào)通過(guò)一次或者幾次的模擬下變頻轉(zhuǎn)換到中頻上，在中頻對(duì)信號(hào)數(shù)字化，然后再進(jìn)行數(shù)字下變頻。數(shù)字下變頻（Digital Down Converter or DDC）是軟件無(wú)線(xiàn)電的核心技術(shù)之一。
數(shù)字下變頻分為兩個(gè)基本的模塊，數(shù)控 [ 查看詳細(xì) ]
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