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          DSP架構(gòu)應(yīng)對(duì)電網(wǎng)諧波污染分析的挑戰(zhàn)

          • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
          • 關(guān)鍵字: DSP架構(gòu)  數(shù)字PLL  數(shù)字振蕩器  

          基于DDS的數(shù)字PLL

          •   多年以來,作為業(yè)界主流產(chǎn)品的模擬PLL已被熟知,模擬PLL性能穩(wěn)定,可為頻率合成和抖動(dòng)消除提供低成本的解決方案,工作頻率高達(dá)8GHz及以上。然而新興的基于直接數(shù)字頻率合成(DDS)的數(shù)字PLL在某些應(yīng)用中極具競(jìng)爭(zhēng)力。   數(shù)字PLL利用數(shù)字邏輯實(shí)現(xiàn)傳統(tǒng)的PLL模塊。雖然實(shí)現(xiàn)數(shù)字PLL的方法有很多,但本文只介紹基于DDS的數(shù)字PLL架構(gòu)。 圖1 典型的模擬PLL結(jié)構(gòu)框圖   圖1所示的是典型的模擬PLL。輸入信號(hào)首先進(jìn)入?yún)⒖挤诸l器,參考分頻器可降低輸入鑒相器的信號(hào)頻率。在PLL中,參考分頻器的
          • 關(guān)鍵字: DDS  數(shù)字PLL  
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          數(shù)字pll介紹

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