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EEPW首頁 >> 主題列表 >> 現(xiàn)場可編程門陣列（fpga）

現(xiàn)場可編程門陣列（fpga）文章進入現(xiàn)場可編程門陣列（fpga）技術(shù)社區(qū)

雷達信號處理：FPGA還是GPU?

FPGA和CPU一直是雷達信號處理不可分割的組成部分。傳統(tǒng)上FPGA用于前端處理，CPU用于后端處理。隨著雷達系統(tǒng)的處理能力越來越強，越來越復(fù)雜，對信息處理的需求也急劇增長。為此，F(xiàn)PGA不斷在提高處理能力和吞吐量，CPU也在發(fā)展以滿足下一代雷達的信號處理性能需求。
關(guān)鍵字： FPGA CPU GPU GFLOP 轉(zhuǎn)換器

基于PCI總線的微弱信號采集模塊的設(shè)計方案

隨著微電子技術(shù)的廣泛普及、計算機技術(shù)的快速發(fā)展，現(xiàn)場信息實時采集系統(tǒng)的性能越來越受到大量關(guān)注。從測試系統(tǒng)和科研領(lǐng)域產(chǎn)生的動態(tài)信息中提取有用數(shù)據(jù)進行現(xiàn)場實時采集并存儲顯得尤為重要。
關(guān)鍵字： PCI FPGA 傳感器轉(zhuǎn)換器采集信號

一種新型帶寬自適應(yīng)全數(shù)字鎖相環(huán)的設(shè)計方案

本方案采用理論分析與硬件電路設(shè)計相結(jié)合的方法進行了系統(tǒng)設(shè)計，并用FPGA予以實現(xiàn)。系統(tǒng)仿真與硬件電路測試結(jié)果證實了設(shè)計方案的正確性。該鎖相環(huán)的自由振蕩頻率可隨輸入信號頻率的變化而改變，具有電路結(jié)構(gòu)簡單、鎖相范圍廣、鎖定速度快和穩(wěn)態(tài)誤差小等特點。
關(guān)鍵字： FPGA 鎖相環(huán) 振蕩器濾波器計數(shù)器

基于FPGA的采集卡的圖像增強算法應(yīng)用研究

圖像在采集過程中不可避免地會受到傳感器靈敏度、噪聲干擾以及模數(shù)轉(zhuǎn)化時量化問題等因素影響而導(dǎo)致圖像無法達到人眼的視覺效果，為了實現(xiàn)人眼觀察或者機器自動分析的目的，對原始圖像所做的改善行為，就被稱作圖像增強技術(shù)。
關(guān)鍵字：傳感器圖像增強 FPGA PCI VHDL

一種通用數(shù)據(jù)采集系統(tǒng)的設(shè)計方案

基于NI公司的智能FPGA板卡以及圖形化編程軟件LabVIEW,本文提出了一種通用數(shù)據(jù)采集系統(tǒng)的設(shè)計方案。該方案中所設(shè)計的系統(tǒng)與傳統(tǒng)的數(shù)據(jù)采集系統(tǒng)相比結(jié)構(gòu)簡單、開發(fā)周期短、可靠性高、實時性好，并且對于不同應(yīng)用場合，在FPGA邏輯單元足夠多的情況下可以很簡便地依據(jù)實際情況對其做相應(yīng)調(diào)整，具有較強的通用性。
關(guān)鍵字： NI FPGA LabVIEW 數(shù)據(jù)采集光耦隔離

基于FPGA的速率自適應(yīng)圖像抽取算法

載荷圖像可視化是深空探測任務(wù)中的重要需求，但受信道帶寬的限制，無法實時傳輸所有載荷數(shù)據(jù)，因此星載復(fù)接存儲器中圖像的抽取下傳是實現(xiàn)任務(wù)可視化的關(guān)鍵。
關(guān)鍵字：存儲器 FPGA 載荷圖像 VCDU FLASH

基于FPGA多路機載冗余圖像處理系統(tǒng)的設(shè)計方案

摘要：本文以FPGA作為核心處理器，提出了一種基于FPGA多路機載冗余圖像處理系統(tǒng)的設(shè)計方案，實現(xiàn)了對多路DVI視頻冗余信號的解碼、編碼、實時處理以及輸出顯示，并且信號通道增加冗余設(shè)計，因而加強了系統(tǒng)的穩(wěn)定性和可靠性。
關(guān)鍵字： FPGA DVI 視頻均衡器 SDRAM

如何在FPGA內(nèi)實現(xiàn)最佳化車用MCU設(shè)計方案？

在汽車電子中廣為采用的微控制器(MCU)正快速面臨時間和成本的壓力。使用MCU的主要優(yōu)勢一直以來都是‘創(chuàng)造具有高性價比的高階系統(tǒng)整合’。然而，在此一優(yōu)勢之下，有一些與元件本身相關(guān)的潛在成本是超乎于其單價水平的。例如，若選用的元件無法創(chuàng)造所需特性，則必須增加外部邏輯、軟件或其它整合元件。
關(guān)鍵字：微控制器 FPGA ASIC CPU 嵌入式

基于SPI FLASH的FPGA多重配置

通過FPGA的多重配置可以有效地精簡控制結(jié)構(gòu)的設(shè)計，同時可以用邏輯資源較少的FPGA器件實現(xiàn)需要很大資源才能實現(xiàn)的程序。以Virtex5系列開發(fā)板和配置存儲器SPI FLASH為基礎(chǔ)，從硬件電路和軟件設(shè)計兩個方面對多重配置進行分析，給出了多重配置實現(xiàn)的具體步驟，對實現(xiàn)復(fù)雜硬件設(shè)計工程有一定的參考價值。
關(guān)鍵字： FPGA Virtex5 FLASH ICAP IPROG 寄存器

基于ADS1298與FPGA的高性能腦電信號采集系統(tǒng)

本文利用ADS1298芯片的高精度，以FPGA為主控制芯片，通過將工頻陷波、帶通濾波等模擬部分轉(zhuǎn)移到數(shù)字側(cè)，在保證性能的前提下簡化腦電信號放大與調(diào)理的模擬電路，實現(xiàn)便攜式腦電信號的采集。
關(guān)鍵字： FPGA 信號采集 ADS1298 腦電信號接口電路

Altera推進了FPGA和SoC中高速串行收發(fā)器的評估

Altera公司(Nasdaq: ALTR)日前發(fā)布JNEye鏈路分析工具，提供驗證和電路板級全套設(shè)計工具。JNEye支持設(shè)計人員迅速方便的評估高速Altera FPGA和SoC中的高速串行鏈路性能。
關(guān)鍵字： Altera FPGA JNEye 仿真器

FPGA：縱向創(chuàng)新與橫向整合引領(lǐng)變革

　　FPGA在先進工藝路上的狂飚猛進帶來了如影隨形的挑戰(zhàn)：一方面，進入20nm和14nm階段后，不光是FPGA復(fù)雜度提升，對其外圍的電源管理等芯片也提出了“與時俱進”的要求。另一方面，隨著SoC FPGA和3D IC技術(shù)的發(fā)展，F(xiàn)PGA不斷在加速取代ASSP和ASIC，但這還需要更多的突破，其中最大的障礙就是互聯(lián)問題，需在縱向架構(gòu)上“守正出奇”。此外，隨著FPGA系統(tǒng)復(fù)雜度的提升，競爭已不僅僅是產(chǎn)品性能的較量，還在于如何幫助客戶簡化設(shè)計、加快上市等，這就要求
關(guān)鍵字： Altera FPGA

Exar大功率COT交換控制器提供1%輸出準(zhǔn)確率

高性能模擬混合信號部件與數(shù)據(jù)管理解決方案的領(lǐng)先供應(yīng)商公司(紐交所：EXAR)近日推出新型大功率交換控制器，該產(chǎn)品隸屬于DC-DC電源轉(zhuǎn)換產(chǎn)品家族。XRP6141同步降壓控制器支持高達35A的分布式供電(POL)，并采用Exar的專有仿電流模式恒定導(dǎo)通時間(COT)控制環(huán)路，實現(xiàn)出色的瞬態(tài)響應(yīng)與輸出準(zhǔn)確性。
關(guān)鍵字： EXAR 控制器 FPGA XRP6141

Microsemi主流FPGA產(chǎn)品組合加入全新小封裝器件

致力于提供功率、安全、可靠與高性能半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation，紐約納斯達克交易所代號：MSCC) 宣布為其主流SERDES-based SmartFusion?2 系統(tǒng)級芯片(SoC) FPGA和IGLOO?2 FPGA器件提供全新小尺寸解決方案。
關(guān)鍵字：美高森美 FPGA RAM

德州儀器推出業(yè)界速度最快 16 位 DAC

日前，德州儀器 (TI) 宣布推出業(yè)界速度最快的 16 位數(shù)模轉(zhuǎn)換器 (DAC)。這款 4 通道 2.5GSPS DAC38J84 比同類競爭產(chǎn)品快 66%，支持適用于速率高達 12.5 Gbps 數(shù)據(jù)轉(zhuǎn)換器的 JEDEC JESD204B 串行接口標(biāo)準(zhǔn)。
關(guān)鍵字： TI 轉(zhuǎn)換器 FPGA

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現(xiàn)場可編程門陣列（fpga）介紹

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現(xiàn)場可編程門陣列（fpga）電路

利用FPGA資源和最小模擬電路發(fā)電進行開關(guān)電源設(shè)計的方法
基于FPGA的機載顯示系統(tǒng)架構(gòu)設(shè)計與優(yōu)化
基于FPGA+DSP遠程監(jiān)控器設(shè)計與實現(xiàn)
基于FPGA的LCD顯示遠程更新

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現(xiàn)場可編程門陣列（fpga）資料下載

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