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Astera Labs推出云規(guī)?；ゲ僮鲗?shí)驗(yàn)室,實(shí)現(xiàn)大規(guī)模無縫部署CXL解決方案
- 心部署CXL附加內(nèi)存先進(jìn)的專用連接解決方案公司Astera?Labs（Astera Labs）近日宣布，擴(kuò)展其云規(guī)?；ゲ僮鲗?shí)驗(yàn)室(Cloud-Scale Interop Lab)，支持Leo內(nèi)存連接平臺(tái)(Leo Memory Connectivity Platform)與不斷成長的生態(tài)系統(tǒng)之間實(shí)現(xiàn)強(qiáng)大的互操作性測試，該生態(tài)系統(tǒng)包括領(lǐng)先CXL為基礎(chǔ)的CPU、內(nèi)存模塊和操作系統(tǒng)。Astera Labs首席產(chǎn)品官Casey Morrison表示：“Compute Express Link?（CXL?）
- 關(guān)鍵字： Astera Labs 云規(guī)?；ゲ僮鲗?shí)驗(yàn)室 CXL
Astera Labs面向CXL附加內(nèi)存擴(kuò)展和池化應(yīng)用的Leo Memory Connectivity Platform進(jìn)入預(yù)量產(chǎn)階段
- 中國，北京 - 2022年9月1日-智能系統(tǒng)專用連接解決方案企業(yè)Astera Labs今日宣布已開始向客戶和戰(zhàn)略合作伙伴提供Leo Memory Connectivity Platform預(yù)量產(chǎn)樣品，平臺(tái)可支持Compute Express Link? (CXL?) 1.1和2.0，實(shí)現(xiàn)云服務(wù)器的安全性、可靠性以及高性能內(nèi)存擴(kuò)展和池化。在對(duì)Leo智能內(nèi)存控制器 (Smart Memory Controllers)與業(yè)界先進(jìn)的CPU/GPU平臺(tái)以及DRAM內(nèi)存模塊在各種實(shí)際工作負(fù)載上成功進(jìn)行端到端互操作性測
- 關(guān)鍵字： Astera Labs CXL 內(nèi)存擴(kuò)展 池化
Astera Labs全新發(fā)布Aries PCIe 5.0和CXL?2.0 Smart Retimers助力解鎖下一代云連接
- 智能系統(tǒng)連接解決方案先驅(qū)Astera Labs近日宣布，其面向PCI Express? (PCIe?) 5.0和Compute Express Link? (CXL?) 2.0的Aries Smart Retimers現(xiàn)已進(jìn)入量產(chǎn)階段。率先上市的Aries Smart Retimer產(chǎn)品組合圓滿完成與關(guān)鍵行業(yè)合作伙伴之間嚴(yán)苛的互操作性測試，測試涵蓋各種PCIe 5.0處理器、FPGA、加速計(jì)算、GPU、網(wǎng)絡(luò)、存儲(chǔ)和交換機(jī)SoC，為在企業(yè)數(shù)據(jù)中心和云中的廣泛部署鋪平了道路。Astera Labs首席執(zhí)行官J
- 關(guān)鍵字： Astera Labs Aries PCIe 5.0 CXL?2.0 Smart Retimers
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