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一種基于ADSP-BF537的無(wú)線視頻傳輸方案

由于無(wú)線信道具有易錯(cuò)、時(shí)變和帶限的特點(diǎn)，視頻業(yè)務(wù)數(shù)據(jù)量大，對(duì)誤比特率要求高，針對(duì)這些特點(diǎn)設(shè)計(jì)一種基于ADSP-BF537的無(wú)線視頻系統(tǒng)。設(shè)計(jì)中運(yùn)用DSP+FPGA的方案，以ADSP-BF537為例，利用DSP動(dòng)態(tài)配置FPGA并與視頻服務(wù)器、FPGA進(jìn)行數(shù)據(jù)通信。測(cè)試證明，該系統(tǒng)在不同信噪比下誤碼率低，克服了無(wú)線信道傳輸易誤碼的缺點(diǎn)，滿足了視頻傳輸對(duì)誤碼率的高要求。
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H.264在ADSP-BF561上的實(shí)現(xiàn)與優(yōu)化

研究了H.264編碼關(guān)鍵技術(shù)的實(shí)現(xiàn),并結(jié)合ADSP-BF561的特點(diǎn)提出了有效的優(yōu)化方案,包括幀內(nèi)幀間快速算法、存儲(chǔ)空間分配、Cache應(yīng)用、C和匯編語(yǔ)言優(yōu)化等。測(cè)試結(jié)果表明,優(yōu)化后的算法編碼效率得到顯著提高。
關(guān)鍵字：優(yōu)化實(shí)現(xiàn) ADSP-BF561 H.264 音頻

基于ADSP-BF561的H.264編碼器設(shè)計(jì)

基于ADSP-BF561的H.264編碼器設(shè)計(jì),摘要：依據(jù)H.264視頻編碼標(biāo)準(zhǔn)，在DSP上完成視頻編碼器的設(shè)計(jì)工作，以實(shí)現(xiàn)高質(zhì)量視頻流的實(shí)時(shí)傳輸。編碼器硬件平臺(tái)選用AD公司的BF561開(kāi)發(fā)板，圖像采集采用OV7660，利用DMA技術(shù)以達(dá)到更高效的視頻采集和數(shù)據(jù)格式轉(zhuǎn)換。
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ADSP TS201鏈路口通信的FPGA實(shí)現(xiàn)

O 引言
隨著電子技術(shù)的飛速發(fā)展，在實(shí)際應(yīng)用中數(shù)據(jù)高速傳輸有著越來(lái)越高的要求，鏈路口為數(shù)據(jù)傳送提供了高速、獨(dú)立的通信機(jī)制，得到廣泛應(yīng)用。AD公司生產(chǎn)的TS201 DSP就具備這種端口。為了使不具備此接口的器件
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基于ADSP―BF533的μClinux嵌入式系統(tǒng)移植與開(kāi)發(fā)

基于ADSP―BF533的μClinux嵌入式系統(tǒng)移植與開(kāi)發(fā),Blackfin處理器是基于由美國(guó)模擬器件公司(ADI)和Intel公司聯(lián)合開(kāi)發(fā)的微信號(hào)架構(gòu)(MSA)的首款第4代DSP產(chǎn)品，它是ADI公司16 位產(chǎn)品的一個(gè)大系列。這一新產(chǎn)品是專為通信和互聯(lián)網(wǎng)應(yīng)用而設(shè)計(jì)的通用DSP芯片，適合處理廣泛用
關(guān)鍵字：系統(tǒng) 移植開(kāi)發(fā) 嵌入式 Clinux ADSP BF533 基于嵌入式移植 μC1inux ADSP-BF533 U-Boot

跟蹤雷達(dá)的高速實(shí)時(shí)信號(hào)處理系統(tǒng)研究與設(shè)計(jì)

1引言跟蹤雷達(dá)是重要的現(xiàn)代雷達(dá)體制之一，可以對(duì)目標(biāo)進(jìn)行連續(xù)跟蹤并獲取目標(biāo)航跡信息，以便進(jìn)行瞄準(zhǔn)計(jì)...
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日立錄像機(jī)選擇ADI公司的Blackfin ADSP-BF531

　　中國(guó)，北京——Analog Devices, Inc.（紐約證券交易所代碼: ADI），全球領(lǐng)先的高性能信號(hào)處理解決方案供應(yīng)商，日前宣布，日立公司選擇ADI公司的Blackfin ADSP-BF531，作為其Hitachi Wooo D系列錄像機(jī)的信號(hào)處理器。　　數(shù)字視頻錄像機(jī)（DVRs）自誕生以來(lái)就一直在穩(wěn)步發(fā)展。早期商用DVR所提供的用于回放體育賽事直播過(guò)程中的精彩瞬間的“即時(shí)定格及回放”等功能已經(jīng)被豐富的用戶模型所取代。如今，使用日立公司的
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基于ADSP-TS201的／雷達(dá)恒虛警實(shí)現(xiàn)

1 引言　　雷達(dá)恒虛警(CFAR-Constant False Alarm Rate)在雷達(dá)系統(tǒng)中有著重要的作用和地位。恒虛警處理可以避免雜波變化影響的檢測(cè)閾值，提高雷達(dá)在各種干擾情況下的檢測(cè)能力。　　美國(guó)模擬器件公司(ADD的ADSP-TS201處理器具有高速運(yùn)算能力、可時(shí)分復(fù)用、并行處理、數(shù)據(jù)吞吐率高等特點(diǎn)。該處理器片內(nèi)集成大容量存儲(chǔ)器，性價(jià)比高，并兼有ASIC和FPGA的信號(hào)處理性能、指令集處理器的高度可編程性與靈活性，適用于高性能、大存儲(chǔ)量的信號(hào)處理和圖像應(yīng)用。本文主要討論基于ADSP-T
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Boot在ADSP-BF533上的移植

　　DSP-BF533處理器是ADI公司新推出的一款Blackfin系列DSP，他具有2個(gè)MAC，集成了大量的外圍設(shè)備和存儲(chǔ)器接口，最高處理速度高達(dá)750 MHz，每秒運(yùn)算速度最高達(dá)到1 500 MMAC(兆次乘法加法運(yùn)算)，適用于各種視頻、音頻、通信領(lǐng)域；另外該系列處理器所采用的微信號(hào)體系結(jié)構(gòu)使其集DSP和MCU的功能于一身，大大方便了開(kāi)發(fā)者的使用。　　U-Boot(Universal Boot Loader)是遵循GPL條款的開(kāi)放源碼項(xiàng)目，由德國(guó)工程師Wolfgang Denk從8xxROM代碼發(fā)
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基于FPGA和ADSP的數(shù)字波束形成技術(shù)的工程實(shí)現(xiàn)

　　數(shù)字波束形成技術(shù)充分利用陣列天線所獲取的空間信息，通過(guò)信號(hào)處理技術(shù)使波束獲得超分辨率和低副瓣的性能，實(shí)現(xiàn)了波束的掃描、目標(biāo)的跟蹤以及空間干擾信號(hào)的零陷，因而數(shù)字波束形成技術(shù)在雷達(dá)信號(hào)處理、通信信號(hào)處理以及電子對(duì)抗系統(tǒng)中得到了廣泛的應(yīng)用。數(shù)字波束形成是把陣列天線輸出的信號(hào)進(jìn)行AD采樣數(shù)字化后送到數(shù)字波束形成器的處理單元，完成對(duì)各路信號(hào)的復(fù)加權(quán)處理，形成所需的波束信號(hào)。只要信號(hào)處理的速度足夠快，就可以產(chǎn)生不同指向的波束。由于數(shù)字波束形成一般是通過(guò)DSP或FPGA用軟件實(shí)現(xiàn)的，所以具有很高的靈活性和可擴(kuò)展性
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ADSP-TS101的USB 2.0接口擴(kuò)展

　　1 引言　　現(xiàn)代信號(hào)處理系統(tǒng)通常涉及到上位機(jī)與信號(hào)處理機(jī)之間的數(shù)據(jù)通訊，如何建立信號(hào)處理機(jī)與上位機(jī)的通訊接口成為系統(tǒng)設(shè)計(jì)中必須解決的一個(gè)問(wèn)題。通常情況下，對(duì)于數(shù)據(jù)傳輸速度要求不太高的應(yīng)用，可以使用普通串行口作為通訊鏈路。在本系統(tǒng)中，由于采用多片高性能浮點(diǎn)數(shù)字信號(hào)處理器ADSP-TS101作為處理器，產(chǎn)生了大量的處理結(jié)果，并且要求實(shí)時(shí)傳輸處理結(jié)果，傳輸速度必須達(dá)到1 MB/s，因此普通的串行通訊口已經(jīng)不能滿足要求。若采用PCI接口，雖然在速度上可以滿足要求，但需要單獨(dú)在上位機(jī)占用一個(gè)PCI插槽，另
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基于ADSP-BF561的車載多媒體系統(tǒng)

本文給出了一套新的車載多媒體系統(tǒng)設(shè)計(jì)方案,該系統(tǒng)是基于美國(guó)模擬器件公司(ADI)的ADSP-BF561嵌入式多媒體處理器設(shè)計(jì)出的支持嵌入式音視頻應(yīng)用、GPS、GPRS、HFCK、網(wǎng)口、USB、CAN總線、I2C控制和海量存儲(chǔ)等功能,是功能強(qiáng)大的多媒體系統(tǒng),尤其適用于車載環(huán)境,亦可作為個(gè)人數(shù)字助理應(yīng)用。
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基于ADSP-BF533處理器的濾波器的實(shí)現(xiàn)及優(yōu)化

引言　　在已有的基于塊的視頻編解碼系統(tǒng)中，當(dāng)碼率較低時(shí)都存在方塊效應(yīng)，新的視頻編碼標(biāo)準(zhǔn)H.264中亦是如此。產(chǎn)生這種方塊效應(yīng)的主要原因有兩個(gè)：一是由于對(duì)變換后的殘差系數(shù)進(jìn)行的基于塊的整數(shù)變換后，以大的量化步長(zhǎng)對(duì)變換系數(shù)進(jìn)行量化會(huì)使得解碼后的重建圖像的方塊邊緣出現(xiàn)不連續(xù)；二是在運(yùn)動(dòng)補(bǔ)償中插值運(yùn)算引起的誤差使得編解碼器反變換后的重建圖像會(huì)出現(xiàn)方塊效應(yīng)。如果不進(jìn)行處理，方塊效應(yīng)還會(huì)隨著重構(gòu)幀積累下去，從而嚴(yán)重地影響圖像的質(zhì)量和壓縮效率。為了解決這一問(wèn)題，H.264中的
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ADSP-TS201的系統(tǒng)設(shè)計(jì)及外部總線接口技術(shù)

1 引言　　隨著雷達(dá)技術(shù)發(fā)展，大帶寬高分辨力、多種信號(hào)處理方式的采用，使得實(shí)時(shí)信號(hào)處理對(duì)數(shù)據(jù)的處理速度大大提高。同時(shí)在雷達(dá)信號(hào)處理中運(yùn)算量大，數(shù)據(jù)吞吐量急劇上升，對(duì)數(shù)據(jù)處理的要求不斷提高。隨著大規(guī)模集成電路技術(shù)的發(fā)展，作為數(shù)字信號(hào)處理的核心數(shù)字信號(hào)處理器(DSP)得到了快速的發(fā)展和應(yīng)用。ADSP-TS201DSP是美國(guó)模擬器件(ADD公司繼TSl01之后推出的一款高性能處理器。此系列DSP性價(jià)比很高，兼有FPGA和ASIC信號(hào)處理性能和指令集處理器的高度可編程性
關(guān)鍵字：模擬技術(shù) 電源技術(shù) ADSP-TS201 系統(tǒng)設(shè)計(jì) 總線接口