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安全通信系統(tǒng)的FPGA實(shí)現(xiàn)
- 摘要：本文針對網(wǎng)絡(luò)通信過程中存在信息泄露、信息篡改、非法用戶入侵等安全威脅而設(shè)計(jì)的一套基于FPGA平臺的的網(wǎng)絡(luò)通信安全傳輸系統(tǒng)。 關(guān)鍵詞：網(wǎng)絡(luò)通信；FPGA；加密. 緒論 信息安全的解決方案目前主要集中于采取單一的措施來保證信息的安全性，針對各種攻擊手段，防范措施主要集中于信息加密技術(shù)、安全交換機(jī)技術(shù)、防火墻技術(shù)、認(rèn)證技術(shù)，入侵檢測技術(shù)等，這些技術(shù)從不同的方面對安全性提供了較好的保障，但各有缺點(diǎn)和不足，這將成為網(wǎng)絡(luò)防護(hù)的軟肋，因此，本文也嘗試性地提出了一種集數(shù)據(jù)加密技術(shù)和訪問控制策略于一體的信息
- 關(guān)鍵字： 網(wǎng)絡(luò)通信 FPGA 200812
數(shù)字下變頻的FPGA實(shí)現(xiàn)
- 摘要：本文介紹了數(shù)字下變頻的組成結(jié)構(gòu)，并通過一個具體的實(shí)例，給出了FPGA實(shí)現(xiàn)的具體過程。 關(guān)鍵詞：FPGA；數(shù)字下變頻；VHDL 引言 數(shù)字化中頻(DIF)頻譜分析儀在高中頻實(shí)現(xiàn)數(shù)字化處理，具有分析帶寬大、RBW小、測量時(shí)長短，可對復(fù)雜信號實(shí)施時(shí)—頻分析的功能，因而得到越來越廣泛的應(yīng)用。但由于現(xiàn)有的數(shù)字信號處理器(DSP)處理速度有限，往往難以對高速率A/D采樣得到的數(shù)字信號直接進(jìn)行實(shí)時(shí)處理。為了解決這一矛盾，需要采用數(shù)字下變頻(DDC)技術(shù)，將采樣得到的高速率信號變成低速率基帶信
- 關(guān)鍵字： FPGA 200812
直擴(kuò)導(dǎo)航系統(tǒng)中數(shù)字科思塔斯環(huán)的FPGA設(shè)計(jì)與實(shí)現(xiàn)
- 引言 擴(kuò)頻接收機(jī)載波的同步包括捕獲和跟蹤兩個過程，載波捕獲即多普勒頻移的粗略估計(jì)通常包含在偽碼同步過程中，而精確的載波相位及多普勒頻移則通過FLL（鎖頻環(huán)）和PLL（鎖相環(huán)）跟蹤來實(shí)現(xiàn)。鎖頻環(huán)直接跟蹤載波頻率，而鎖相環(huán)則直接對載波相位進(jìn)行跟蹤。鎖相環(huán)具有較高的跟蹤精度，但對通信鏈路干擾的容忍能力差，特別是受載體動態(tài)引入的多普勒頻移影響較大；而鎖頻環(huán)具有較好的動態(tài)性能，但跟蹤精度較低。載波跟蹤環(huán)的跟蹤精度決定了最后定位測量的精度。常規(guī)接收機(jī)中載波跟蹤是在數(shù)字延遲鎖定環(huán)對偽碼相關(guān)解擴(kuò)的基礎(chǔ)上，通過科斯塔
- 關(guān)鍵字： FPGA 導(dǎo)航
LIBERO IDE 8.5軟件工具系列增添對ACTEL全新NANO FPGA產(chǎn)品的支持
- Actel公司宣布推出 Libero® 集成設(shè)計(jì)環(huán)境 (IDE) 8.5版本，這套完整的軟件設(shè)計(jì)工具系列已進(jìn)一步擴(kuò)展，支持新近推出的nano版本IGLOO® 和ProASIC3®現(xiàn)場可編程門陣列 (FPGA)。Libero IDE 8.5版本還提供對嵌入式數(shù)學(xué)構(gòu)件(mathblock) 的例示和配置支持，可用于Actel全新的耐輻射RTAX-DSP系列產(chǎn)品。 Actel公司的nano FPGA為設(shè)計(jì)人員提供了高效的方法，以開發(fā)基于業(yè)界最低功耗、最小占位面積FPGA的便攜式
- 關(guān)鍵字： Actel 集成設(shè)計(jì)環(huán) nano FPGA
利用NI新型CompactRIO系統(tǒng)有效簡化高級控制應(yīng)用
- 新聞發(fā)布——2008年12月——美國國家儀器有限公司（National Instruments，簡稱NI）近日推出高性價(jià)比的NI CompactRIO可編程自動化控制器（PAC），為工程師和科學(xué)家在高級控制和監(jiān)控應(yīng)用領(lǐng)域提供了理想的解決方案。NI cRIO-9073系統(tǒng)具備集成的硬件構(gòu)架，在一個機(jī)箱上集成了嵌入式實(shí)時(shí)處理器和用戶可編程的FPGA芯片。利用LabVIEW 8.6圖形化系統(tǒng)設(shè)計(jì)平臺和NI PAC（如cRIO-9073）中的FPGA進(jìn)行編程時(shí)，
- 關(guān)鍵字： NI LabVIEW FPGA
FPGA嵌入式系統(tǒng) 開發(fā)過程中的XBD文件設(shè)計(jì)
- 利用Xilinx的嵌入式開發(fā)工具EDK快速建立FPGA嵌入式系統(tǒng)過程中，板級描述(Xilinx Board Description，XBD)文件起著至關(guān)重要的作用，它是系統(tǒng)硬件配置文件MHS和約束文件UCF的基礎(chǔ)。XBD文件的設(shè)計(jì)過程中，采用模塊化的設(shè)計(jì)方法對物理電路板上FPGA外圍各單元的信息進(jìn)行描述，從而通過XBD文件實(shí)現(xiàn)IP核和板上電路模塊之間的連接。
- 關(guān)鍵字： FPGA XBD 嵌入式系統(tǒng) 過程
基于FPGA的B超數(shù)字圖像實(shí)時(shí)采集系統(tǒng)
- 1 引 言 醫(yī)學(xué)超聲診斷成像技術(shù)大多數(shù)采用超聲脈沖回波法，即利用探頭產(chǎn)生超聲波進(jìn)入人體，由人體組織反射產(chǎn)生的回波經(jīng)換能器接收后轉(zhuǎn)換為電信號，經(jīng)過提取、放大、處理，再由數(shù)字掃描變換器轉(zhuǎn)換為標(biāo)準(zhǔn)視頻信號，最后由顯示器進(jìn)行顯示。在基于FPGA+ARM 9硬件平臺的全數(shù)字化B超診斷儀中，前端探頭返回的回波電信號需由實(shí)時(shí)采集系統(tǒng)進(jìn)行波束合成、相關(guān)處理、采集并傳輸至ARM嵌入式處理系統(tǒng)，視頻信號數(shù)據(jù)量大，實(shí)時(shí)性要求高，因此選用FPGA+SRAM構(gòu)成實(shí)時(shí)采集系統(tǒng)，在速度和容量上都能滿足上述要求。主要介紹B超成像系
- 關(guān)鍵字： FPGA ARM
基于CPLD的移相全橋軟開關(guān)電源數(shù)字控制器
- 1引言近年來，隨著大功率開關(guān)電源的發(fā)展，對控制器的要求越來越高，開關(guān)電源的數(shù)字化和智能化也將成為...
- 關(guān)鍵字： CPLD DSP FPGA 開關(guān)電源控制器
基于FPGA+DDS的控制設(shè)計(jì)
- 為了滿足目前對數(shù)據(jù)處理速度的需求，設(shè)計(jì)了一種基于FPGA+DDS的控制系統(tǒng)。闡述了系統(tǒng)硬件實(shí)現(xiàn)方法，給出了相關(guān)的軟件設(shè)計(jì)例程。并對DDS AD9911各個控制寄存器的設(shè)置與時(shí)序進(jìn)行詳細(xì)說明，最后給出了實(shí)驗(yàn)結(jié)果。
- 關(guān)鍵字： FPGA DDS 控制設(shè)計(jì)
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