- 摘要：提出了以AVR ATmega128單片機(jī)和Altera公司的Cyclone系列EP1C3T100為核心的系統(tǒng)設(shè)計方案。分析了數(shù)字式低頻相位測量儀的測量原理和測量誤差及其消除的方法。利用單片機(jī)強(qiáng)勁的運(yùn)算、控制功能和FPGA運(yùn)算速度快、資
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數(shù)字式相位 測量儀 低頻 FPGA AVR 單片機(jī) 基于
- 0引言隨著國民經(jīng)濟(jì)的快速發(fā)展和人們生活水平的不斷提高，人們對居住房子的舒適性及安全性要求也提升到了更高...
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跳頻通信 頻率合成器 FPGA
- 摘要：為了克服一般車載導(dǎo)航系統(tǒng)定位不連貫的缺陷，利用NiosⅡ軟核處理器配置靈活、擴(kuò)展性強(qiáng)等特點，結(jié)合GPS和GSM模塊，設(shè)計出了一種基于SoPC技術(shù)的雙重定位系統(tǒng)。該設(shè)計利用SoPC Builder開發(fā)工具將NiosⅡ處理器、存
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FPGA GPS GSM 車載定位
- ?????? MathWorks 日前宣布適用于 Xilinx FPGA 開發(fā)板且新添了 FPGA 在環(huán) (FIL) 功能的 EDA Simulator Link 3.3 面市。FIL 使工程師們能夠在使用 Simulink 作為系統(tǒng)級測試臺架的同時，以硬件速度驗證其設(shè)計。
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MathWorks Xilinx FPGA
- 本設(shè)計中存儲的圖像數(shù)據(jù)所采用的像素位深為3 位，共可顯示8種顏色。在實際應(yīng)用中，可以使用更大的存儲器，最終實現(xiàn)256 色圖像，乃至真彩色圖像的顯示。在此設(shè)計基礎(chǔ)上，通過使用SDRAM 等外部存儲器，利用DMA 控制方式，并且配合Altera 的nios 嵌入式軟核CPU ,可以在SOPC 開發(fā)平臺上最終實現(xiàn)兼容SVGA ,TVGA 標(biāo)準(zhǔn)等的更復(fù)雜顯示控制器。
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實現(xiàn) 方法 控制器 圖形 FPGA VGA 基于
- CPLD在DSP多分辨率圖像采集系統(tǒng)中的應(yīng)用,視頻采集系統(tǒng)是數(shù)字圖像獲取的最基本手段，是進(jìn)行數(shù)字圖像處理、多媒體和網(wǎng)絡(luò)傳輸?shù)那疤幔蔀楦鞣N圖像處理算法提供待處理的原始數(shù)字圖像和算法驗證平臺。隨著圖像數(shù)字化處理技術(shù)的高速發(fā)展，對圖像采集的要求也越
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系統(tǒng) 應(yīng)用 采集 圖像 DSP 分辨率 CPLD
- 本系統(tǒng)的開發(fā)采用了 DSP+CPLD 的結(jié)構(gòu)，這種結(jié)構(gòu)將DSP 較強(qiáng)的數(shù)據(jù)運(yùn)算能力與CPLD 的高集成性、硬件可重復(fù)編程性結(jié)合在一起，使系統(tǒng)的設(shè)計過程更加的合理、緊湊和簡化
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F2812 CPLD 2812 320F
- 本文提出了一種FPGA 可實現(xiàn)的跳頻MSK 信號實時截獲和識別的設(shè)計方案，經(jīng)過試驗證明，可以對寬帶跳頻信號進(jìn)行實時的截獲，并能夠?qū)ζ渲械腗SK 目標(biāo)信號完成準(zhǔn)確識別，可應(yīng)用于針對特定目標(biāo)的通信偵察系統(tǒng)，具有較高的應(yīng)用價值。
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FPGA MSK 跳頻 算法
- FPGA如何改變嵌入設(shè)計格局,由于經(jīng)濟(jì)下滑損及開發(fā)預(yù)算減少，嵌入系統(tǒng)設(shè)計者正在轉(zhuǎn)向FPGA(現(xiàn)場可編程門陣列)技術(shù)，以縮減開發(fā)周期、對抗設(shè)備老化以及簡化產(chǎn)品升級。通過采用數(shù)量龐大且不斷增加的FPGA開發(fā)工具、可重用邏輯單元以及市售商用模塊，
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設(shè)計 格局 嵌入 改變 如何 FPGA
- QDR SRAM與Spartan3 FPGA的接口設(shè)計,為了滿足當(dāng)前系統(tǒng)和處理器的生產(chǎn)量需求，更新的靜態(tài)存儲器應(yīng)運(yùn)而生。QDR SRAM就是由Cypress、Renesas、IDT、NEC和Samsung為高性能的網(wǎng)絡(luò)系統(tǒng)應(yīng)用而共同開發(fā)的一種具有創(chuàng)新體系結(jié)構(gòu)的同步靜態(tài)存儲器?！ ? QDR SRAM的
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接口 設(shè)計 FPGA Spartan3 SRAM QDR
- CPLD的DSP多SPI端口通信設(shè)計,本文介紹一種采用運(yùn)動控制專用DSP芯片DSP56F801設(shè)計的超聲波電機(jī)運(yùn)動控制裝置。由于該超聲波電機(jī)需要采用兩相四路對稱PWM信號來實現(xiàn)驅(qū)動控制，而DSP芯片無法直接產(chǎn)生所需PWM信號，采用軟件方法又會占用大量的DSP計算
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設(shè)計 通信 SPI DSP CPLD
- 摘要：本文針對FPGA實際開發(fā)過程中，出現(xiàn)故障后定位困難、反復(fù)修改代碼編譯時間過長、上板后故障解決無法確認(rèn)的問題，提出了一種采用仿真的方法來定位、解決故障并驗證故障解決方案。可以大大的節(jié)約開發(fā)時間，提高
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FPGA 仿真技術(shù) 方法
- 帶服務(wù)能夠支持三重應(yīng)用（即支持語音、視頻和數(shù)據(jù)）至第一英里的客戶，例如持續(xù)發(fā)展的小商業(yè)和住宅。FTTx中的主角是GPON（吉比特?zé)o源光網(wǎng)絡(luò)，Gigabit Passive Optical Network），它提供較高的帶寬替代DSL和電纜的
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GPON FPGA 模式 接收器
- FPGA是通過邏輯組合來實現(xiàn)各種功能的器件，幾乎可以進(jìn)行任何類型的處理。過去五年間，為了突破傳統(tǒng)的通信及網(wǎng)絡(luò)等高端應(yīng)用市場局限，將FPGA引入更為廣闊的嵌入式領(lǐng)域，F(xiàn)PGA廠商已經(jīng)開始嘗試采用多核和硬件協(xié)處理加速技術(shù)。如今，隨著技術(shù)的進(jìn)步，很多芯片廠商開始采用硬核或軟核CPU+FPGA的模式。
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主導(dǎo) FPGA 使用 是否 平臺 為中心 配置 控制器
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