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多項式擬合在log-add算法單元中的應用及其FPGA實現
- 綜合考慮面積和速度等因素，采用一次多項式擬合實現了簡單快速的log-add算法單元。實驗結果表明，在相同的精度要求下，其FPGA實現資源占用合理，硬件開銷好于其他次數的多項式擬合實現方案。
- 關鍵字： log-add算法單元 多項式擬合 FPGA
Canny算法的改進及FPGA實現
- 通過對傳統(tǒng)Canny邊緣檢測算法的分析提出了相應的改進方法。通過模板代替卷積、適當的近似變換、充分利用并行處理單元等使其能夠用FPGA實現。
- 關鍵字： Canny邊緣檢測算法 卷積 FPGA
基于FPGA的三相PWM發(fā)生器
- 介紹了基于FPGA設計的三相PWM發(fā)生器。該發(fā)生器具有靈活和可編程等優(yōu)點,可應用于交流電機驅動用的三相電壓源逆變器。實驗結果驗證了本設計的有效性。
- 關鍵字： PWM發(fā)生器 三相逆變器 FPGA
獨立式多分辨率VGA/DVI壓縮存儲系統(tǒng)
- 一種獨立式多分辨率VGA/DVI壓縮存儲系統(tǒng)，該系統(tǒng)支持VGA/DVI輸入，同時支持SVGA、XGA、SXGA、UXGA、1080p等任意分辨率圖像的連續(xù)壓縮和存儲。在100 MHz時鐘頻率下，系統(tǒng)可以對圖像SXGA和UXGA實時壓縮為(25幀/s)和(17幀/s)。實驗表明，在不同碼率下，系統(tǒng)的單幀圖像壓縮性能與JPEG2000標準近似，PSNR值優(yōu)于JPEG標準。
- 關鍵字： VGA/DVI壓縮存儲系統(tǒng) 圖像壓縮 FPGA
基于CPLD的線陣CCD數據采集系統(tǒng)
- 本文結合實際應用需要，設計了基于復雜可編程邏輯器件(CPLD)的線陣CCD數據采集系統(tǒng)。著重介紹了數據采集的特點及該系統(tǒng)軟、硬件設計和最后的性能評價。
- 關鍵字： 數據采集系統(tǒng) CCD CPLD
一種改進型surendra背景更新算法的FPGA實現
- 針對現有的動態(tài)背景提取運動目標物體算法復雜且難以在硬件上實現的問題，研究了改進型surendra背景更新算法原理的特點，提出了改進型surendra背景更新算法的硬件結構，并對硬件結構進行綜合、仿真后，在FPGA芯片上實現。
- 關鍵字： 運動目標提取 surendra背景更新算法 FPGA
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