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常用FPGA/CPLD四種設(shè)計(jì)技巧
- 常用FPGA/CPLD四種設(shè)計(jì)技巧,FPGA/CPLD的設(shè)計(jì)思想與技巧是一個(gè)非常大的話題，本文僅介紹一些常用的設(shè)計(jì)思想與技巧，包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意，如果能有意識(shí)地利用這些原則指導(dǎo)日
- 關(guān)鍵字： 技巧 設(shè)計(jì) FPGA/CPLD 常用
基于VHDL/CPLD的I2C串行總線控制器設(shè)計(jì)及實(shí)現(xiàn)
- 分析了I2C串行總線的數(shù)據(jù)傳輸機(jī)制，用VHDL設(shè)計(jì)了串行總線控制電路，其中包括微處理器接口電路和I2C總線接口電路。采用ModelSim Plus 6.0 SE軟件進(jìn)行了前仿真和調(diào)試,并在Xilinx ISE 7.1i開(kāi)發(fā)環(huán)境下進(jìn)行了綜合、后仿真和CPLD器件下載測(cè)試。 結(jié)果表明實(shí)現(xiàn)了I2C串行總線協(xié)議的要求。
- 關(guān)鍵字： 控制器 設(shè)計(jì) 實(shí)現(xiàn) 總線 串行 VHDL/CPLD I2C 基于
基于CPLD的IEEE1149.1 USB下載電纜設(shè)計(jì)
- 引言隨著片上系統(tǒng)(SoC，SystemonChip)時(shí)代的到來(lái)，包括復(fù)雜可編程邏輯器件(CPLD，ComplexProgrammab...
- 關(guān)鍵字： FPGA CPLD USB下載電纜 IEEE1149.1
用雙端口RAM實(shí)現(xiàn)與PCI總線接口數(shù)據(jù)通訊
- 采用雙端口RAM實(shí)現(xiàn)DSP與PCI總線芯片之間的數(shù)據(jù)交換接口電路。提出了一種使用CPLD解決雙端口RAM地...
- 關(guān)鍵字： PCI接口 雙端口RAM 數(shù)據(jù)通訊 CPLD
基于CPLD的電動(dòng)自行車充電系統(tǒng)的研究設(shè)計(jì)
- 電動(dòng)車由于具有無(wú)廢氣污染、無(wú)噪音、輕便美觀等特點(diǎn)，受到眾多使用者的青睞。但使用中也暴露出它的局限性...
- 關(guān)鍵字： FPGA CPLD SPCE061A 充電系統(tǒng) 電動(dòng)自行車
基于CPLD和ISA總線的數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
- 摘要：介紹一種基于復(fù)雜可編程邏輯器件(CPLD)的數(shù)據(jù)采集系統(tǒng)，并給出詳細(xì)的設(shè)計(jì)方案。計(jì)算機(jī)通過(guò)ISA總線實(shí)現(xiàn)與數(shù)據(jù)采集系統(tǒng)的指令和數(shù)據(jù)傳輸。通過(guò)VHDL編程實(shí)現(xiàn)CPLD對(duì)12位串行模數(shù)轉(zhuǎn)換器ADS7816的控制。最后，給出該
- 關(guān)鍵字： CPLD ISA 總線 數(shù)據(jù)采集
CPLD在臭氧電源中的應(yīng)用
- 摘要：利用壓控振蕩器CD4046和可編程邏輯器件EPM7128構(gòu)成控制系統(tǒng)，通過(guò)調(diào)節(jié)逆變輸出脈沖的占空比和頻率，實(shí)現(xiàn)臭氧電源輸出電壓和頻率的調(diào)節(jié)，從而達(dá)到對(duì)臭氧電源輸出功率的調(diào)節(jié)。調(diào)試結(jié)果表明該系統(tǒng)滿足實(shí)時(shí)性和功耗
- 關(guān)鍵字： CPLD 臭氧電源 中的應(yīng)用
TMS320F2812與CPLD的視頻采集系統(tǒng)接口設(shè)計(jì)
- 摘要：介紹基于TMS320F2812和CPLD的數(shù)字視頻采集系統(tǒng)的接口設(shè)計(jì)。該系統(tǒng)采用同步分離電路、TMS320F2812、EPM7128、TMS320C6416、IDE硬盤存儲(chǔ)器以及顯示器接口等芯片，利用TMs320F2812中的ADC采樣速度和轉(zhuǎn)換精度高的優(yōu)
- 關(guān)鍵字： 接口 設(shè)計(jì) 系統(tǒng) 采集 CPLD 視頻 TMS320F2812
基于CPLD的異步串行通訊控制器的研究與設(shè)計(jì)
- 本文在對(duì)異步串行通信協(xié)議進(jìn)行分析的基礎(chǔ)上，根據(jù)實(shí)際工程的需要，對(duì)異步串行通信控制器進(jìn)行了詳細(xì)設(shè)計(jì)，并結(jié)合CPLD器件，采用VHDL語(yǔ)言，對(duì)設(shè)計(jì)方案進(jìn)行了實(shí)現(xiàn)和驗(yàn)證，通過(guò)最后時(shí)序仿真的波形圖得出了設(shè)計(jì)方案的正確，而且加載了該設(shè)計(jì)程序的CPLD在實(shí)際工程中能夠很好地與處理器進(jìn)行連接來(lái)收發(fā)數(shù)據(jù)，從而為那些沒(méi)有串行異步接口的處理器提供一個(gè)比較理想的設(shè)計(jì)方案。
- 關(guān)鍵字： CPLD 異步串行 通訊 控制器
基于CPLD/FPGA的VHDL語(yǔ)言電路優(yōu)化設(shè)計(jì)
- VHDL(VeryHighSpeedIntegratedCircuitHardwareDescriptionLanguage)是IEEE工業(yè)標(biāo)準(zhǔn)硬件描述語(yǔ)言...
- 關(guān)鍵字： CPLD FPGA VHDL 電路優(yōu)化設(shè)計(jì)
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