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          中國國際醫(yī)療電子技術大會隆重登場
          
                                                            
            
                    	
          • 　　權威的市場分析、領先的技術方案、關鍵元器件展示與講解，2011年4月19日，眾多精彩內(nèi)容伴隨著第四屆中國國際醫(yī)療電子大會(CMET2011)一同亮相深圳。深圳醫(yī)療器械行業(yè)協(xié)會會長陶篤純、藍韻集團產(chǎn)品市場部總監(jiān)劉明宇、中國科學院深圳先進技術研究院 鄭海榮博士分別從深圳醫(yī)療器械產(chǎn)業(yè)發(fā)展概況、醫(yī)改兩年帶來的機遇與挑戰(zhàn)、多學科交叉驅(qū)動醫(yī)療儀器創(chuàng)新關鍵等角度出發(fā)，
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          • 關鍵字：
                        TI  FPGA  醫(yī)療超聲                          
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          基于DSP與改進邊緣檢測算法的煤矸石自動分選系統(tǒng)
          
                                                            
            
                    	
          • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡家園
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          • 關鍵字：
                        煤矸石  DSP  邊緣檢測算法  煤矸石自動分選系統(tǒng)                          
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          基于Xilinx FPGA的片上系統(tǒng)無線保密通信終端設計
          
                                                            
            
                    	
          • 0引言利用軟件實施加密算法已經(jīng)成為實時安全通信系統(tǒng)的重要瓶頸。標準的商品化CPU和DSP無法跟上數(shù)據(jù)...
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          • 關鍵字：
                        FPGA  片上系統(tǒng)  無線保密  通信終端                          
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          基于FPGA+DSP的高速中頻采樣信號處理平臺的實現(xiàn)
          
                                                            
                                        
            
                    	
          • 基于FPGA+DSP的高速中頻采樣信號處理平臺的實現(xiàn),摘要：高速中頻采樣信號處理平臺在實際應用中有很大的前景，提出采用FPGA+DSP的處理結構，結合高性能A／D和D／A處理芯片，設計了一個通用處理平臺，并對其主要性能進行了測試。實驗與實際應用表明，該系統(tǒng)具有很強的
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          • 關鍵字：
                        信號處理  平臺  實現(xiàn)  采樣  中頻  FPGA  DSP  高速  基于                          
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          FPGA在數(shù)字式心率計中的電路組成及工作原理
          
                                                            
            
                    	
          • 本心率計在數(shù)字式心率計的基礎上，采用FPGA和VHDL語言實現(xiàn)，減少了元器件使用數(shù)量，提高了測量精度和可靠性。該電路能夠?qū)崟r采集并測量人體心跳的瞬時和平均心跳速率，判斷并顯示心率狀態(tài)（即心跳是否正常、是否過快或過慢、是否有心率不齊現(xiàn)象）。如果心率過快或過慢或者有心率不齊現(xiàn)象，那么將用不同顏色發(fā)光管進行閃爍報警顯示。

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          • 關鍵字：
                        FPGA  數(shù)字式  電路  工作原理                            
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          基于POWER PC+FPGA架構的飛行試驗振動數(shù)據(jù)實時分析
          
                                                            
            
                    	
          • 摘要：飛行試驗振動信號具有采樣率高、數(shù)據(jù)量大、處理復雜的特點，在現(xiàn)有條件下，通過遙測鏈路很難將大量的振動數(shù)據(jù)實時傳輸至地面監(jiān)控系統(tǒng)。針對試飛測試的需要，結合某型號的試飛關鍵技術攻關研究，突破試飛振動數(shù)
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          • 關鍵字：
                        POWER  FPGA  PC  架構                            
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          基于現(xiàn)代DSP技術的QPSK調(diào)制器的設計
          
                                                            
                                        
            
                    	
          • 基于現(xiàn)代DSP技術的QPSK調(diào)制器的設計,摘要：為了提高DSP系統(tǒng)的開發(fā)效率，引入了現(xiàn)代DSP技術，并由此設計了QPSK調(diào)制器。依據(jù)QPSK調(diào)制的基本原理，利用MATLAB／Simulink DSP Builder和Quartusll搭建模型，在模塊的形成方式上，采用DSP Builder中的模塊代替
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          • 關鍵字：
                        調(diào)制器  設計  QPSK  技術  現(xiàn)代  DSP  基于                          
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          基于Cyclone III FPGA的DDR2接口設計分析
          
                                                            
            
                    	
          • DDR SDRAM是Double Data Rate SDRAM的縮寫，即雙倍速率同步動態(tài)隨機存儲器。DDR內(nèi)存是在SDRAM內(nèi)存基礎上發(fā)展而來的，能夠在時鐘的上升沿和下降沿各傳輸一次數(shù)據(jù)，可以在與SDRAM相同的總線時鐘頻率下達到更高的數(shù)據(jù)傳輸率。雖然DDR2和DDR一樣,都采用相同采樣方式進行數(shù)據(jù)傳輸，但DDR2擁有兩倍于DDR的預讀取系統(tǒng)命令數(shù)據(jù)的能力。
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          • 關鍵字：
                        Cyclone  FPGA  DDR2  III                            
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          高性能FPGA中的高速SERDES接口
          
                                                            
            
                    	
          • 引言　    串行接口常用于芯片至芯片和電路板至電路板之間的數(shù)據(jù)傳輸。隨著系統(tǒng)的帶寬不斷增加至多吉比特范圍，并行接口已經(jīng)被高速串行鏈接，或SERDES （串化器/ 解串器）所取代 。起初， SERDES是獨立的ASSP或ASIC器
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          • 關鍵字：
                        SERDES  FPGA  性能  接口                            
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          基于Xilinx FPGA的片上系統(tǒng)無線保密通信終端
          
                                                            
                                        
            
                    	
          • 本設計使用硬件描述語言VHDL在FPGA數(shù)字邏輯層面上實現(xiàn)AES加解密，為了系統(tǒng)的擴展性和構建良好的人機交互，設計通過PS/2鍵盤輸入加密密鑰，并將其顯示在LCD上。在軟核MicroBlaze上，通過SPI總線讀寫FIFO和RAM控制射頻芯片CC2420，使系統(tǒng)具有信道選擇、地址識別、自動CRC校驗功能，使系統(tǒng)更加安全、通信誤碼率更低。

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          • 關鍵字：
                        保密  通信  終端  無線  系統(tǒng)  Xilinx  FPGA  基于                          
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          基于FPGA數(shù)據(jù)流控制動態(tài)可重構的實現(xiàn)
          
                                                            
            
                    	
          • 摘要  基于FPGA基本數(shù)據(jù)流的下載控制方式，利用遺傳算法，通過單片機控制數(shù)據(jù)流的方式對FPGA進行編程配置，實現(xiàn)自身重構，使系統(tǒng)具有自適應、自組織和自修復的特性。
            關鍵詞  FPGA；遺傳算法；動態(tài)重構；單片機
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          • 關鍵字：
                        FPGA  數(shù)據(jù)流  動態(tài)可重構                            
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          基于DSP的軌道移頻信號解調(diào)實現(xiàn)
          
                                                            
                                        
            
                    	
          • 基于DSP的軌道移頻信號解調(diào)實現(xiàn),摘要  提出了以雙路TMS320F2812為核心，接收解調(diào)ZPW-2000A的FSK信號。前端通過信號調(diào)理，利用DSP內(nèi)部的AD對FSK信號采樣。經(jīng)過FFT變換解調(diào)出栽頻頻率、Z—FFT解調(diào)低頻頻率，以及通過DSP的SPI口。對兩路解調(diào)出的信
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          • 關鍵字：
                        解調(diào)  實現(xiàn)  信號  軌道  DSP  基于                          
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          基于DSP的混沌數(shù)字圖像加密與硬件實現(xiàn)
          
                                                            
                                        
            
                    	
          • 基于DSP的混沌數(shù)字圖像加密與硬件實現(xiàn),摘要 介紹了在DSP基礎上，實現(xiàn)數(shù)字圖像的混沌加密及硬件實現(xiàn)方法。根據(jù)離散化和數(shù)字化處理技術，對三維Lorenz混沌系統(tǒng)作離散化處理，用C語言和DSP技術產(chǎn)生三維Lorenz混沌迭代序列，分別對數(shù)字圖像的紅、綠、藍三基色
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          • 關鍵字：
                        加密  硬件  實現(xiàn)  圖像  數(shù)字  DSP  混沌  基于                          
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          基于DSP的混沌數(shù)字圖像加密與硬件設計
          
                                                            
                    
          
                
          
                                
          
                    
          異步FIFO在FPGA與DSP通信中的運用
          
                                                            
                                        
            
                    	
          • 摘要  利用異步FIFO實現(xiàn)FPGA與DSP進行數(shù)據(jù)通信的方案。FPGA在寫時鐘的控制下將數(shù)據(jù)寫入FIFO，再與DSP進行握手后，DSP通過EMIFA接口將數(shù)據(jù)讀入。文中給出了異步FIFO的實現(xiàn)代碼和FPGA與DSP的硬件連接電路。經(jīng)驗證，利用
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          • 關鍵字：
                        通信  運用  DSP  FPGA  FIFO  異步                          
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	共9875條
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          dsp＋fpga介紹
          
      			
          
		      	
          
		      			      			      	您好，目前還沒有人創(chuàng)建詞條dsp＋fpga!
           
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