- 0 引 言
數字信號處理主要研究采用數字序列或符號序列表示信號，并用數字計算方法對這些序列進行處理，以便把信號變換成符合某種需要的形式。在現代數字信號處理中，最常用的變換方法就是離散傅里葉變換(DFT)，
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FPGA FFT 級聯 處理器
- 基于改進型二步索引算法OSD電路的FPGA實現, 0 引 言 OSD(on screen display)，即在屏顯示系統(tǒng)，是實現人機界面交互的基礎，在視頻處理SOC中作為重要功能模塊有著廣泛的應用。 基于SOC技術的模塊化設計要求各功能模塊盡可能小地占用電路資源，以滿足芯片系統(tǒng)
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電路 FPGA 實現 OSD 算法 改進型 索引 基于 FPGA
- 我真的需要那種技術嗎?我現在應該購買嗎?如果我不購買，是不是就會處于劣勢?我會不會因為做出錯誤的決定而出局?即便不想成為先行者，同行的壓力與技術變化的速度，也會使我們不斷面對類似的更多問題。最終，我們還是得想辦法回到正確的技術軌道上來。
研究、保持使用最新技術以及直覺，都將有助于縮小這些決定的范圍，不過最終還是得在冒險一試與放棄之間做出選擇。即使有些不情愿或者也許有點晚，我們仍然擁護變革。
在消費類電子產品前沿，事情并不總是那么順理成章的。無論行業(yè)評論員的權威意見是什么，也不管他們給予怎樣
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Altium FPGA 設計工具
- 隨著軟件無線電的發(fā)展。對于濾波器的處理速度要求越來越高。傳統(tǒng)的FIR濾波器一般采用通用DSP處理器，但是DSP處理器采用的是串行運算，而FPGA是現場可編程陣列，可以實現專用集成電路，另外還可以采用純并行結構
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FPGA FIR 濾波器
- FPGA開發(fā)中常用到單脈沖發(fā)生器。一些文章介紹過產生單脈沖的電路，產生的單脈沖脈寬和相位都不能與時鐘同步，只能用在要求不嚴格的場合。筆者目前從事的課題中需要一個與時鐘周期等寬，相位與時鐘周期相同的鍵
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FPGA 按鍵消抖 單脈沖 發(fā)生器電路
- 大多數軟、硬件工程師都很熟悉 FPGA，這點應該勿庸置疑。這種熟悉不見得是實質性的熟悉，而是從概念上比較了解，也就是說 FPGA 功能的快速發(fā)展和成本的不斷下降是大家都不容忽略的優(yōu)勢。同時，他們也認識到這種可編程器件顯然能方便地作為各種數字電路以及邏輯處理的高靈活度、低成本的載體。
基本說來，在設計方案中發(fā)揮 FPGA 的功能就是簡單地映射出所需的邏輯，然后將其下載至適當容量大小的器件中。這有些像大型處理器系統(tǒng)主體設計的輔助支持工作，而且在該層面上也確實發(fā)揮著自身的支持性作用。
近期一些應
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SoC FPGA
- 設計基于FPGA的8段數碼管動態(tài)顯示IP核，介紹8段數碼管內部結構及其驅動顯示方式和IP核設計方法，給出8段數碼管動態(tài)顯示IP核的Verilog HDL程序源代碼及其C語言驅動程序。此IP核可例化成1～8個共陰極(或共陽極)數碼管控制器，能方便地控制1～8個數碼管同時顯示數字和小數點位。測試結果表明，該IP核工作可靠、穩(wěn)定，可直接應用于電子設計中。
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FPGA 8段數碼管 動態(tài)顯示 IP核
- 針對某恒溫箱控制系統(tǒng)中存在的非線性、時變等特點，結合傳統(tǒng)PID與現代模糊控制理論，以EP1C12型FP-GA為核心控制器，采用模塊化思想，設計并實現溫度模糊自適應PID控制。實際運行結果表明，采用該方法可明顯改善控制效果，在簡化設計的同時，也可提高系統(tǒng)的運算速度和可靠性。
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PID 控制器 設計 適應 模糊 FPGA 溫度 基于
- 1 引 言 同步在通信系統(tǒng)中占有非常重要的地位,同步系統(tǒng)性能的高低在很大程度上決定了通信系統(tǒng)的質量,甚至通信的成敗。相關器是同步系統(tǒng)的關鍵部件之一,因此,要求相關器須有比其它部件更高的可靠性。
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FPGA 數字相關器
- 0引言測頻和測脈寬現在有多種方法。通常基于MCU的信號參數測量，由于其MCU工作頻率很低，所以能夠達到...
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測量 脈沖信號 ADC FPGA
- 0引言隨著網絡流量的不斷增加和路由表容量的不斷增大，路由查找已經成為制約因特網的主要瓶頸。盡...
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FPGA 高速路由 查找 算法
- 可編程邏輯器件FPGA以其開發(fā)周期短、成本低、功耗低、可靠性高等優(yōu)勢，廣泛應用于通信、航空、醫(yī)療等領域，近年來在消費電子領域中的應用也日漸增加。為進一步挖掘FPGA在家庭娛樂如游戲機開發(fā)與應用中的巨大商
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FPGA
- 三維圖像信息處理FPGA+DSP核心架構的設計與實現,三維圖像信息處理一直是圖像視頻處理領域的熱點和難點，目前國內外成熟的三維信息處理系統(tǒng)不多，已有的系統(tǒng)主要依賴高性能通用PC完成圖像采集、預處理、重建、構型等囊括底層和高層的處理工作。三維圖像處理數據量特
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核心 架構 設計 實現 DSP FPGA 圖像 信息 處理 三維 FPGA dsp
- 根據國內主要寬帶運營商的要求及規(guī)劃，未來的發(fā)展依然會以EPON為主，包括10G和1G的EPON。為了應對國內接入網市場對于EPON產品形態(tài)的需求，我們基于芯片設計了一些不同形態(tài)的解決方案：包括能提供2路硬件解碼或軟件解碼的VoIPONU的參考設計;整合了4口以太網交換機的多用戶接入終端的參考設計;高密度16口、24口以太網交換機的MDU參考設計，以及計劃中的整合了16口IPPBX的參考設計等。
普然的10GEPON方案是一個基于FPGA的SoC(系統(tǒng)級芯片)MAC，其包涵一個強大的包處理引擎，從
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FPGA EPON SoC
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