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紫光半導體收購集中美國 專挑寡占市場
- 面對清華紫光集團董事長趙偉國再次放話，將先把收購目光集中在美國半導體產(chǎn)業(yè)的說法，日前臺系IC設計公司均表達不意外，畢竟臺灣政府目前尚未通過相關法令限制，加上相關配套措施還需產(chǎn)官學界互相討論，與其現(xiàn)在買市值不大的臺灣IC設計公司，對清華紫光集團并無法產(chǎn)生立即性的幫助。 產(chǎn)業(yè)界人士指出，以清華紫光的大陸內需市場色彩，加上先前出手目標多鎖定具備一定程度寡占特性的產(chǎn)業(yè)來看，全球三強鼎立的EDA市場、繪圖芯片與FPGA產(chǎn)業(yè)，或許是清華紫光集團在談判桌上的下一個目標。 確實從清華紫光收購動作一路多鎖定
- 關鍵字： 紫光 FPGA
Altera公開業(yè)界第一款集成了HBM2 DRAM和FPGA的異構SiP器件
- Altera公司(Nasdaq)公開業(yè)界第一款異構系統(tǒng)級封裝(SiP，System-in-Package)器件，集成了來自SK Hynix的堆疊寬帶存儲器(HBM2)以及高性能Stratix® 10 FPGA和SoC。Stratix 10 DRAM SiP代表了新一類器件，其特殊的體系結構設計滿足了高性能系統(tǒng)對存儲器帶寬最嚴格的要求。 數(shù)據(jù)中心、廣播、固網(wǎng)和高性能計算等系統(tǒng)要處理的數(shù)據(jù)量不斷攀升，需要的帶寬非常高。相對于目前的分立DRAM解決方案，Stratix 10 DRAM SiP的
- 關鍵字： Altera FPGA
Altera公開業(yè)界第一款集成了HBM2 DRAM和FPGA的異構SiP器件
- Altera公司今天公開業(yè)界第一款異構系統(tǒng)級封裝(SiP，System-in-Package)器件，集成了來自SK Hynix的堆疊寬帶存儲器(HBM2)以及高性能Stratix® 10 FPGA和SoC。Stratix 10 DRAM SiP代表了新一類器件，其特殊的體系結構設計滿足了高性能系統(tǒng)對存儲器帶寬最嚴格的要求。 數(shù)據(jù)中心、廣播、固網(wǎng)和高性能計算等系統(tǒng)要處理的數(shù)據(jù)量不斷攀升，需要的帶寬非常高。相對于目前的分立DRAM解決方案，Stratix 10 DRAM SiP的存儲器帶寬提
- 關鍵字： Altera FPGA
小梅哥和你一起深入學習FPGA之串口調試（一）(上)
- 大家好，這幾天在各個論壇上，經(jīng)常就有人在向我咨詢基于FPGA的串口通信代碼，大部分都是在網(wǎng)上下載一個現(xiàn)成的代碼，但是在使用中就遇到了各種問題，于是就發(fā)到了論壇上來求助。在閱讀了他們的代碼之后，我發(fā)現(xiàn)幾乎出自同一個版本(目前確定為特權同學的基于EPM240入門實驗的代碼)。他們在調試這個代碼的時候，經(jīng)常存在這樣幾個問題：1、部分人對該串口通訊模塊完全不理解，對每句話，甚至每個模塊的功能都不理解;2、部分人采用最原始的畫波形的方式來對該模塊進行仿真，結果無法得到仿真結果;3、部分人不會使用modelsim
- 關鍵字： FPGA 串口調試
Altera榮獲Frost & Sullivan全球FPGA技術創(chuàng)新領先獎
- Altera公司榮獲分析公司Frost & Sullivan的全球FPGA技術創(chuàng)新領先獎，表彰Altera在技術特性和未來業(yè)務價值方面更勝一籌。該獎項彰顯Altera在其Arria® 10 FPGA中實現(xiàn)IEEE 754單精度硬核浮點DSP (數(shù)字信號處理)模塊——處理速率高達1.5 TFLOPS (每秒萬億次浮點運算)，進一步提高了數(shù)字系統(tǒng)設計的能效和生產(chǎn)效率。Altera的可編程器件幫助客戶針對大數(shù)據(jù)和搜索應用、數(shù)據(jù)中心加速、軍事通信和高性能計算等需要高精度
- 關鍵字： Altera FPGA
使用面向FPGA的OpenCL設計兩百萬點頻域濾波器
- 快速傅里葉變換(FFT)是信號處理應用的基礎。FPGA供應商一直以來提供了運行良好的FFT庫，處理適配到FPGA片內存儲器中的大量數(shù)據(jù)。但是，如果數(shù)據(jù)規(guī)模太大，應該如何應對? 為解決這一問題，F(xiàn)PGA設計人員現(xiàn)在必須要做出設計決定，這些決定互相糾纏在一起，例如，片內FFT內核的配置選擇，其數(shù)量，它們怎樣連接并訪問外部存儲器，多個內核之間的同步等。分析所有這類設計決定就是要能夠很好的結合現(xiàn)有產(chǎn)品，在HDL中編程，這會非常耗時，而且?guī)砹诵阅軉栴}。采用OpenCL等高級編程語言，能夠很快的完成系統(tǒng)設計分析。本
- 關鍵字： FPGA 頻域濾波器 OpenCL 201511
在Xilinx FPGA上快速實現(xiàn)JESD204B
- 簡介 JESD204是一種連接數(shù)據(jù)轉換器(ADC和DAC)和邏輯器件的高速串行接口，該標準的 B 修訂版支持高達 12.5 Gbps串行數(shù)據(jù)速率，并可確保 JESD204 鏈路具有可重復的確定性延遲。隨著轉換器的速度和分辨率不斷提升，JESD204B接口在ADI高速轉換器和集成RF收發(fā)器中也變得更為常見。此外，F(xiàn)PGA和ASIC中靈活的串行器/解串器(SERDES)設計正逐步取代連接轉換器的傳統(tǒng)并行LVDS/CMOS接口，并用來實現(xiàn) JESD204B物理層。本文介紹如何快速在Xilinx?
- 關鍵字： Xilinx FPGA
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