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基于FPGA和DDS技術的任意波形發(fā)生器設計
- 摘要：根據(jù)現(xiàn)代電子系統(tǒng)對信號源的頻率穩(wěn)定度、準確度及分辨率越來越高的要求，結(jié)合直接數(shù)字式頻率合成器(DDS)的優(yōu)點，利用FPGA芯片的可編程性和實現(xiàn)方案易改動的特點，提出了一種基于FPGA和DDS技術的任意波形發(fā)生器
- 關鍵字： FPGA DDS 任意波形發(fā)生器
基于FPGA的數(shù)字示波器
- 摘要：提出一種基于FPGA的簡易數(shù)字示波器設計方法，硬件上采用以Altera公司的EP2C8Q208CN現(xiàn)場可編程門陣列芯片作為核心器件，同時結(jié)合FPGA和NIOS軟核的優(yōu)勢，設計高效的片上可編程系統(tǒng)(SoPC)對高速A／D所采集的數(shù)據(jù)進
- 關鍵字： FPGA 數(shù)字示波器
基于FPGA的FFT算法硬件實現(xiàn)
- 設計了一種基于FPGA的1024點16位FFT算法，采用了基4蝶形算法和流水線處理方式，提高了系統(tǒng)的處理速度，改善了系統(tǒng)的性能。提出了先進行前一級4點蝶形運算，再進行本級與旋轉(zhuǎn)因子復乘運算的結(jié)構(gòu)。合理地利用了硬件資源。對系統(tǒng)劃分的各個模塊使用Verilog HDL進行編碼設計。對整個系統(tǒng)整合后的代碼進行功能驗證之后，采用QuartusⅡ與Matlab進行聯(lián)合仿真，其結(jié)果是一致的。該系統(tǒng)既有DSP器件實現(xiàn)的靈活性又有專用FFT芯片實現(xiàn)的高速數(shù)據(jù)吞吐能力，在數(shù)字信號處理領域有廣泛應用。
- 關鍵字： FPGA FFT 算法 硬件實現(xiàn)
基于FPGA控制的數(shù)字化語音存儲與回放系統(tǒng)
- 摘要：數(shù)字化語音存儲與回放系統(tǒng)的作用是對語音進行錄音和放音，并實現(xiàn)數(shù)字化控制。能夠做到語音回放的方法有很多，本課題研究的是基于FPGA控制下的語音存儲與回放系統(tǒng)。
關鍵詞：語音錄放；數(shù)模轉(zhuǎn)換；模數(shù)轉(zhuǎn)換；FP - 關鍵字： FPGA 數(shù)字化 回放系統(tǒng) 語音存儲
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