fpga+dsp 文章進(jìn)入fpga+dsp技術(shù)社區(qū)

使用面向FPGA的OpenCL設(shè)計(jì)兩百萬(wàn)點(diǎn)頻域?yàn)V波器

快速傅里葉變換(FFT)是信號(hào)處理應(yīng)用的基礎(chǔ)。FPGA供應(yīng)商一直以來(lái)提供了運(yùn)行良好的FFT庫(kù)，處理適配到FPGA片內(nèi)存儲(chǔ)器中的大量數(shù)據(jù)。但是，如果數(shù)據(jù)規(guī)模太大，應(yīng)該如何應(yīng)對(duì)? 為解決這一問(wèn)題，F(xiàn)PGA設(shè)計(jì)人員現(xiàn)在必須要做出設(shè)計(jì)決定，這些決定互相糾纏在一起，例如，片內(nèi)FFT內(nèi)核的配置選擇，其數(shù)量，它們?cè)鯓舆B接并訪問(wèn)外部存儲(chǔ)器，多個(gè)內(nèi)核之間的同步等。分析所有這類設(shè)計(jì)決定就是要能夠很好的結(jié)合現(xiàn)有產(chǎn)品，在HDL中編程，這會(huì)非常耗時(shí)，而且?guī)?lái)了性能問(wèn)題。采用OpenCL等高級(jí)編程語(yǔ)言，能夠很快的完成系統(tǒng)設(shè)計(jì)分析。本
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OpenPOWER+CAPI實(shí)現(xiàn)第二代分布計(jì)算

本文介紹了CAPI技術(shù)，并給出基于CAPI應(yīng)用的三個(gè)案例。
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睿致科技選擇CEVA圖像和視覺(jué)DSP內(nèi)核用于監(jiān)控和智能攝像機(jī)SoC

　　全球領(lǐng)先的蜂窩通信、多媒體和無(wú)線連接DSP IP平臺(tái)授權(quán)廠商CEVA公司宣布臺(tái)灣領(lǐng)先的多媒體系統(tǒng)級(jí)芯片(system-on-chip, SoC)解決方案供應(yīng)商睿致科技(Vatics Inc.)已經(jīng)獲得了CEVA圖像和視覺(jué) DSP 的授權(quán)許可，用于其針對(duì)安防監(jiān)控和智能網(wǎng)絡(luò)攝像機(jī)應(yīng)用的下一代SoC器件中。睿致科技將通過(guò)這款DSP內(nèi)核強(qiáng)大的計(jì)算機(jī)視覺(jué)和場(chǎng)景分析功能，大幅地提升圖像質(zhì)量并實(shí)現(xiàn)全新的智能監(jiān)控功能。　　睿致科技副總裁Sor Shen表示：“在終端設(shè)備中增添智能視覺(jué)處理功能，可實(shí)現(xiàn)強(qiáng)
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在Xilinx FPGA上快速實(shí)現(xiàn)JESD204B

　　簡(jiǎn)介　　JESD204是一種連接數(shù)據(jù)轉(zhuǎn)換器(ADC和DAC)和邏輯器件的高速串行接口，該標(biāo)準(zhǔn)的 B 修訂版支持高達(dá) 12.5 Gbps串行數(shù)據(jù)速率，并可確保 JESD204 鏈路具有可重復(fù)的確定性延遲。隨著轉(zhuǎn)換器的速度和分辨率不斷提升，JESD204B接口在ADI高速轉(zhuǎn)換器和集成RF收發(fā)器中也變得更為常見(jiàn)。此外，F(xiàn)PGA和ASIC中靈活的串行器/解串器(SERDES)設(shè)計(jì)正逐步取代連接轉(zhuǎn)換器的傳統(tǒng)并行LVDS/CMOS接口，并用來(lái)實(shí)現(xiàn) JESD204B物理層。本文介紹如何快速在Xilinx?
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Altera：通信領(lǐng)域，我們做得更好

　　EEPW：我想了解一下Patrick Dorsey先生對(duì)英特爾收購(gòu)了Altera的一些看法，其次就是Altera也是OpenPower的一個(gè)成員，因?yàn)榧尤肓薎ntel之后，Altera這邊會(huì)不會(huì)繼續(xù)跟OpenPower合作。　　Patrick Dorsey：就像您所說(shuō)的，我們也是OpenPower機(jī)構(gòu)的一個(gè)成員。關(guān)于我們的看法，我們FPGA會(huì)繼續(xù)支持不同的架構(gòu)，包括ARM架構(gòu)，Power架構(gòu)還有Intel自己的架構(gòu)。　　6月份我看我們的新聞發(fā)布宣布我們的OpenCL這個(gè)工具可以支持普通的架構(gòu)，
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基于DSP的自適應(yīng)濾波器的設(shè)計(jì)方案

　　簡(jiǎn)介：　根據(jù)自適應(yīng)濾波的原理，主要論述和分析了易于實(shí)現(xiàn)的最小均方差算法，通過(guò)比較IIR結(jié)構(gòu)和FIR結(jié)構(gòu)濾波器的優(yōu)缺點(diǎn)，采用橫向FIR結(jié)構(gòu)的自適應(yīng)濾波器來(lái)實(shí)現(xiàn)。為了滿足自適應(yīng)濾波的實(shí)時(shí)性要求，采用TMS320F28234芯片的系統(tǒng)設(shè)計(jì)，并設(shè)計(jì)了其硬件最小系統(tǒng)和軟件系統(tǒng)，最后用TMS320F28234實(shí)現(xiàn)自適應(yīng)濾波器。仿真結(jié)果表明，本方案的自適應(yīng)濾波器濾波效果優(yōu)越，具有較強(qiáng)的實(shí)用性。　　0 引言　　濾波是信號(hào)處理領(lǐng)域的一種最基本而又極其重要的技術(shù)。利用濾波技術(shù)可以從復(fù)雜的信號(hào)中提取所需要的信號(hào)，同
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Xilinx跨界擴(kuò)張，五年預(yù)增5倍用戶

編者按：五年來(lái)，Xilinx正經(jīng)歷轉(zhuǎn)型: 從FPGA供應(yīng)商到可以支持系統(tǒng)和軟件工程師的全可編程技術(shù)(All Programmable technology )公司，致力于未來(lái)五年內(nèi)增長(zhǎng)5倍的潛在用戶，并為此推出了多處理器SoC和一系列軟件定義的設(shè)計(jì)環(huán)境。近日該公司的戰(zhàn)略規(guī)劃師Steve Glaser來(lái)華，向我們解釋了其構(gòu)想。
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基于DSP的吉他音效器的設(shè)計(jì)與實(shí)現(xiàn)

為使吉他在非聲學(xué)標(biāo)準(zhǔn)建筑內(nèi)達(dá)到較為完美的音質(zhì)和效果而設(shè)計(jì)一套基于數(shù)字信號(hào)處理器(Digital Signal Processer, DSP)的音效器。使用拾音器獲取吉他模擬音頻信號(hào)，經(jīng)轉(zhuǎn)換芯片成為數(shù)字信號(hào)后分幀輸入到DSP芯片的多通道緩沖同步串口，使用芯片完成最后音頻信號(hào)的數(shù)模轉(zhuǎn)換并輸出到音響。軟件方面主要使用內(nèi)存中定義的環(huán)形緩沖區(qū)從而以DSP的零消耗循環(huán)控制實(shí)現(xiàn)高效的延時(shí)，并使用嵌套的全通濾波器實(shí)現(xiàn)較好的混響功能。使用音頻硬件測(cè)試軟件RMAA(Right Mark Audio Analyzer)的測(cè)試結(jié)
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Synopsys的全新HAPS-80基于FPGA的原型解決方案提供高達(dá)100MHz的系統(tǒng)性能

　　新思科技(Synopsys, Inc.)日前宣布：推出全新HAPS®-80基于FPGA的原型系統(tǒng)，該系統(tǒng)為Synopsys的端到端原型解決方案的一部分。HAPS-80系統(tǒng)提供了高達(dá)100MHz的多FPGA性能，以及全新的專用高速時(shí)分復(fù)用(HSTDM)技術(shù)。HAPS-80采用Xilinx最新的Virtex UltraScale VU440 FPGA器件，每顆FPGA可容納2600萬(wàn)個(gè)ASIC門(mén)，結(jié)合ProtoCompiler設(shè)計(jì)自動(dòng)化和調(diào)試軟件，可支持高達(dá)16億個(gè)ASIC門(mén)的設(shè)計(jì)。HAPS硬件與
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第一屆5G算法創(chuàng)新大賽公布復(fù)賽入圍名單

　　Altera公司宣布，由Altera、西安電子科技大學(xué)、友晶科技主辦，華為、英特爾、展訊通信贊助的第一屆5G算法創(chuàng)新大賽公布進(jìn)入復(fù)賽的團(tuán)隊(duì)名單。第一屆5G算法創(chuàng)新大賽是業(yè)界首個(gè)面向未來(lái)無(wú)線通信技術(shù)的高校大賽，旨在促進(jìn)創(chuàng)新。大賽共有184支隊(duì)伍報(bào)名參賽，462名參賽學(xué)生，覆蓋全國(guó)31個(gè)城市、76所高校，其中包括28所985高校和47所211高校。初賽角逐后進(jìn)入復(fù)賽共49支隊(duì)伍。由于初賽交付的高質(zhì)量作品較多并不乏創(chuàng)新性，大賽組委會(huì)宣布在原定一、二、三等獎(jiǎng)基礎(chǔ)上，增設(shè)優(yōu)秀獎(jiǎng)——&ld
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OpenPOWER基金會(huì)推第二代分布式計(jì)算為企業(yè)“互聯(lián)網(wǎng)+”轉(zhuǎn)型加速

　　今天，OpenPOWER基金會(huì)在京召開(kāi)主題為“開(kāi)放力量?引領(lǐng)新一代計(jì)算技術(shù)”的第二代分布式計(jì)算技術(shù)峰會(huì)。來(lái)自IBM公司、賽靈思公司、深圳市恒揚(yáng)科技股份有限公司、聯(lián)科集團(tuán)(中國(guó))有限公司、無(wú)錫中太服務(wù)器有限公司、新浪網(wǎng)、清華大學(xué)等機(jī)構(gòu)的領(lǐng)導(dǎo)、專家，以及ISV、FPGA技術(shù)人員和行業(yè)用戶200余人共同出席了峰會(huì)。峰會(huì)期間，OpenPOWER基金會(huì)宣布成立第二代分布式計(jì)算聯(lián)盟，以推動(dòng)新一代計(jì)算技術(shù)和應(yīng)用的發(fā)展。同時(shí)，構(gòu)建于SuperVessel云平臺(tái)上的CAPI FPGA應(yīng)
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Altera啟動(dòng)全球 SoC FPGA開(kāi)發(fā)者論壇

　　Altera公司今天宣布，啟動(dòng)Altera SoC開(kāi)發(fā)者論壇(ASDF，Altera SoC Developers Forum)。這些開(kāi)幕活動(dòng)在硅谷、中國(guó)深圳和德國(guó)法蘭克福舉行，合作伙伴、開(kāi)發(fā)者和工程師將匯聚一堂，他們共同關(guān)注使用基于ARM的SoC FPGA中的精細(xì)粒度異構(gòu)計(jì)算技術(shù)，滿足下一代嵌入式計(jì)算應(yīng)用需求。在ASDF提供的環(huán)境中，系統(tǒng)架構(gòu)師、硬件工程師、軟件開(kāi)發(fā)人員和固件工程師一起協(xié)作，討論概念和遇到的難題，學(xué)習(xí)最新的技術(shù)，了解Altera及其合作伙伴提供的SoC FPGA新產(chǎn)品。　　A
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那些年的通用FPGA廠商去哪了？

當(dāng)你看到軟盤(pán)，是否在感嘆，當(dāng)年覺(jué)得很實(shí)用的存儲(chǔ)利器早已經(jīng)被云存儲(chǔ)等各種存儲(chǔ)方式取代。當(dāng)你看到CPLD，是否也在感嘆，當(dāng)年給我們帶來(lái)刺激的可編程邏輯，已經(jīng)被FPGA一統(tǒng)天下，現(xiàn)在輪到FPGA了
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美高森美成立卓越安全中心旨在解決最具挑戰(zhàn)性的網(wǎng)絡(luò)安全問(wèn)題

　　致力于在電源、安全、可靠和性能方面提供差異化半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation)宣布成立卓越安全中心 (Security Center of Excellence)，以響應(yīng)互聯(lián)世界中快速演變的網(wǎng)絡(luò)安全威脅。卓越安全中心駐有安全和系統(tǒng)分析員團(tuán)隊(duì)，以及加密、硬件和軟件工程師，積極主動(dòng)地解決多個(gè)垂直市場(chǎng)中最關(guān)鍵的安全問(wèn)題，旨在為客戶提供附加價(jià)值，并且在創(chuàng)建更安全的世界方面發(fā)揮領(lǐng)導(dǎo)作用。　　美高森美總裁兼首席運(yùn)營(yíng)官Paul Pickle表示：“我
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PLD/FPGA入門(mén)，新手必備基礎(chǔ)知識(shí)

　　簡(jiǎn)介：PLD是可編程邏輯器件(Programable Logic Device)的簡(jiǎn)稱，F(xiàn)PGA是現(xiàn)場(chǎng)可編程門(mén)陣列(Field Programable Gate Array)的簡(jiǎn)稱，兩者的功能基本相同，只是實(shí)現(xiàn)原理略有不同，所以我們有時(shí)可以忽略這兩者的區(qū)別，統(tǒng)稱為可編程邏輯器件或PLD/FPGA。 PLD是電子設(shè)計(jì)領(lǐng)域中最具活力和發(fā)展前途的一項(xiàng)技術(shù)，它的影響絲毫不亞于70年代單片機(jī)的發(fā)明和使用。　　PLD能做什么呢?可以毫不夸張的講，PLD能完成任何數(shù)字器件的功能，上至高性能CPU,下至簡(jiǎn)單的74
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