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利用Virtex-5LXT應對串行背板接口設計挑戰(zhàn)
- 采用串行技術進行高端系統(tǒng)設計已占很大比例。在《EETimes》雜志最近開展的一次問卷調(diào)查中，有92%的受訪者...
- 關鍵字： FPGA Virtex-5LXT 嵌入式 串行背板接口
基于VHDL語言的99小時定時器設計及實現(xiàn)
- 0引言傳統(tǒng)的定時器硬件連接比較復雜，可靠性差，而且計時時間短，難以滿足需要。本設計采用可編程芯片...
- 關鍵字： FPGA VHDL 定時器 EP1C6Q240C8
多功能數(shù)據(jù)采集處理系統(tǒng)實現(xiàn)
- 介紹了一種基于FPGA和DSP的多功能高速數(shù)據(jù)采集處理系統(tǒng)的設計，該系統(tǒng)的數(shù)據(jù)采集速度最高可達到105 Msps ,運算能力強，通過更改軟件可適用于大部分的高速數(shù)據(jù)處理場合，具有較強的通用性。
- 關鍵字： 數(shù)據(jù)采集 FPGA DSP 201007
基于FPGA的自適應譜線增強系統(tǒng)設計
- 在此基于Altera公司的現(xiàn)場可編程門陣列(FPGA)芯片EP2C8F256C6,采用最小均方算法設計了自適應譜線增強(ALE)處理系統(tǒng)。以FPGA為處理核心,實現(xiàn)數(shù)據(jù)采樣控制、數(shù)據(jù)延時控制、LMS核心算法和輸出存儲控制等。充分利用FPGA高速的數(shù)據(jù)處理能力和豐富的片內(nèi)乘法器,設計了LMS算法的流水線結構,保證整個系統(tǒng)具有高的數(shù)據(jù)吞吐能力和處理速度。并且通過編寫相應的VHDL程序在QuartusⅡ軟件上進行仿真,仿真結果表明該設計可以快速、準確地實現(xiàn)自適應譜線增強。
- 關鍵字： FPGA 譜線 系統(tǒng)設計
基于FPGA和DDS技術的正弦信號發(fā)生器設計
- 該系統(tǒng)由FPGA、單片機控制模塊、鍵盤、LED顯示組成，采用直接數(shù)字頻率合成(DDS)，D／A以及實時計算波形值等技術，設計出具有頻率設置功能，頻率步進為100 Hz，頻率范圍為1 kHz～10 MHz之間正弦信號發(fā)生器。該系統(tǒng)的頻率范圍寬，步進小，頻率精度較高。
- 關鍵字： FPGA DDS 正弦信號發(fā)生器
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