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FPGA的可重構(gòu)測控系統(tǒng)應用設計的研究
- 1可重構(gòu)測控系統(tǒng)的提出測控系統(tǒng)一般是指基于計算機實現(xiàn)數(shù)據(jù)采集和控制的系統(tǒng)。測控系統(tǒng)在工業(yè)現(xiàn)場控制、家...
- 關(guān)鍵字： FPGA 測控系統(tǒng) 應用設計
SERDES的FPGA實現(xiàn)(07-100)
- 芯片功能的增加和數(shù)據(jù)吞吐量的要求，促使芯片行業(yè)從較低數(shù)據(jù)率的并行連接，轉(zhuǎn)向較高速度的串行連接。SERDES(Serializer-Dese rializer，)是經(jīng)高速差分對，而不是經(jīng)較低速度的并行總線傳輸串行化的數(shù)據(jù)。一個實例是用單個PCI-Express通道，替代傳統(tǒng)的32位、64MHz PCI總線(可達到2.112Gb/s)，僅用4條線(運行在2.5GHz)，可達到4Gb/s總數(shù)據(jù)率。簡言之，SERDES協(xié)議允許用較少的引腳數(shù)傳輸較高的數(shù)據(jù)率。
- 關(guān)鍵字： SERDES FPGA
如何發(fā)現(xiàn)并解決FPGA設計中的時序問題
- 耗費數(shù)月精力做出的設計卻無法滿足時序要求，這確實非常令人傷心。然而，試圖正確地對設計進行約束以保證滿足時序要求的過程幾乎同樣令人費神。找到并確定時序約束本身通常也是非常令人頭痛的問題。時序問題的惱人之
- 關(guān)鍵字： FPGA 發(fā)現(xiàn) 時序
高可靠FPGA通信系統(tǒng)(08-100)
- 本作品主要目的在于針對ZigBee無線傳感器網(wǎng)絡中中心節(jié)點到控制中心的信息通信過程中存在的信息泄露和安全隱患，自行設計一套可移動基于FPGA平臺的高可靠通信系統(tǒng)。在獨立開發(fā)的基于CC2430芯片的無線傳感器星型網(wǎng)絡中，無線網(wǎng)絡節(jié)點與Spartan平臺進行信息交互，其中端到端的數(shù)據(jù)傳輸均實現(xiàn)AES加密。中心節(jié)點的服務器對有線網(wǎng)絡進行實時安全監(jiān)測，當網(wǎng)絡中存在危險情況時通過GSM報警，由此實現(xiàn)了高可靠的網(wǎng)絡通信保障環(huán)境。
- 關(guān)鍵字： ZigBee FPGA 加密
高可靠FPGA通信系統(tǒng)
- 1 系統(tǒng)設計 在工業(yè)控制領(lǐng)域，利用ZigBee和傳感器網(wǎng)絡，使得數(shù)據(jù)的自動采集、分析和處理變得更加容易，作為決策輔助系統(tǒng)的重要組成部分，ZigBee無線傳感器網(wǎng)絡在無線數(shù)據(jù)采集及監(jiān)控等領(lǐng)域得到了廣泛應用。無線傳感
- 關(guān)鍵字： FPGA 通信系統(tǒng)
用內(nèi)部邏輯分析儀調(diào)試FPGA(08-100)
- 進行硬件設計的功能調(diào)試時，F(xiàn)PGA的再編程能力是關(guān)鍵的優(yōu)點。CPLD和FPGA早期使用時，如果發(fā)現(xiàn)設計不能正常工作，工程師就使用“調(diào)試鉤”的方法。先將要觀察的FPGA內(nèi)部信號引到引腳，然后用外部的邏輯分析儀捕獲數(shù)據(jù)。然而當設計的復雜程度增加時，這個方法就不再適合了，其中有幾個原因。第一是由于FPGA的功能增加了，而器件的引腳數(shù)目卻緩慢地增長。因此，可用邏輯對I/O的比率減小了，參見圖1。此外，設計很復雜時，通常完成設計后只有幾個空余的引腳，或者根本就沒有空余的引腳能用于調(diào)試。
- 關(guān)鍵字： 萊迪思 FPGA 邏輯分析儀
提升創(chuàng)造力的數(shù)字設計工具：FPGA Editor(08-100)
- 工程師在設計過程中，經(jīng)常需要一定的創(chuàng)造力(不妨稱之為數(shù)字管道膠帶)才能夠保證設計的順利完成。過去8年時間里，我曾經(jīng)目睹許多優(yōu)秀工程師利用這一方法出色地完成了許多工作，而他們采用的最主要工具就是FPGA Editor。
- 關(guān)鍵字： 賽靈思 FPGA Editor
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