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fpga-to-asic 文章進(jìn)入fpga-to-asic技術(shù)社區(qū)

FPGA配置模式

FPGA配置模式,FPGA有多種配置模式：并行主模式為一片F(xiàn)PGA加一片EPROM的方式;主從模式可以支持一片PROM編程多片F(xiàn)PGA;串行模式可以采用串行PROM編程FPGA;外設(shè)模式可以將FPGA作為微處理器的外設(shè)，由微處理器對其編程?！　∪绾螌崿F(xiàn)快
關(guān)鍵字：模式配置 FPGA

FPGA芯片結(jié)構(gòu)分析

FPGA芯片結(jié)構(gòu)分析,目前主流的FPGA仍是基于查找表技術(shù)的，已經(jīng)遠(yuǎn)遠(yuǎn)超出了先前版本的基本性能，并且整合了常用功能(如RAM、時鐘管理和DSP)的硬核(ASIC型)模塊。如圖1-1所示(注：圖1-1只是一個示意圖，實際上每一個系列的FPGA都有其相應(yīng)的
關(guān)鍵字：分析結(jié)構(gòu) 芯片 FPGA

現(xiàn)代FPGA設(shè)計的能源優(yōu)化方案

現(xiàn)代FPGA設(shè)計的能源優(yōu)化方案,引言　　減少FPGA的功耗可帶來許多好處，如提高可靠性、降低冷卻成本、簡化電源和供電方式、延長便攜系統(tǒng)的電池壽命等。無損于性能的低功耗設(shè)計既需要有高功率效率的FPGA架構(gòu)，也需要有能駕馭架構(gòu)組件的良好設(shè)計規(guī)范
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TMS320C61416控制FPGA數(shù)據(jù)加載設(shè)計

TMS320C61416控制FPGA數(shù)據(jù)加載設(shè)計,本文提出了采用通過市面上常見的Flash ROM芯片替代專用PROM的方式，通過DSP的外部高速總線進(jìn)行FPGA加載;既節(jié)約了系統(tǒng)成本，也能達(dá)到FPGA上電迅速加載的目的;特別適用于在FPGA調(diào)試后期，待固化程序的階段。下面以兩片Xilinx公司Virtex-4系列XC4VLX60芯片為例，詳細(xì)介紹采用TI公司的TMS320C61416 DSP控制FPGA芯片數(shù)據(jù)加載的軟硬件設(shè)計。
關(guān)鍵字：加載設(shè)計數(shù)據(jù) FPGA 控制 TMS320C61416

可擴(kuò)展動態(tài)重配置的新型FPGA平臺設(shè)計

可擴(kuò)展動態(tài)重配置的新型FPGA平臺設(shè)計,新型 FPGA 平臺具有高度的靈活性和可擴(kuò)展性，且集成度高，能夠在單個或兩個芯片上集成一個完整的異構(gòu)動態(tài)運(yùn)算系統(tǒng)?！　∽赃m應(yīng)硬件在諸如導(dǎo)彈電子和軟件無線電等功耗和系統(tǒng)尺寸有限，同時對環(huán)境高度敏感的應(yīng)用中非常
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Altera樹立新里程碑發(fā)布首款28nmFPGA開發(fā)套件

　　Altera公司日前宣布開始提供第一款帶有28-nm FPGA的開發(fā)套件——Stratix V GX FPGA信號完整性套件，在推動業(yè)界28-nm FPGA發(fā)展方面樹立了新里程碑。這一全功能套件支持設(shè)計工程師加速高性能系統(tǒng)的設(shè)計和開發(fā)，滿足了業(yè)界對提高帶寬的需求。Stratix V GX FPGA信號完整性開發(fā)套件為用戶提供的平臺能夠測量并評估從600 Mbps到12.5 Gbps的收發(fā)器鏈路性能。　
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基于FPGA的TMR方法改進(jìn)策略

基于FPGA的TMR方法改進(jìn)策略,基于SRAM的FPGA對于空間粒子輻射非常敏感，很容易產(chǎn)生軟故障，所以對基于FPGA的電子系統(tǒng)采取容錯措施以防止此類故障的出現(xiàn)是非常重要的。三模冗余(TMR)方法以其實現(xiàn)的簡單性和效果的可靠性而被廣泛用于對單粒子翻轉(zhuǎn)(
關(guān)鍵字：改進(jìn) 策略方法 TMR FPGA 基于

Altera發(fā)布業(yè)界第一款28-nm FPGA開發(fā)套件

2011年9月7號，北京——Altera公司(NASDAQ:ALTR)今天宣布開始提供第一款帶有28-nm FPGA的開發(fā)套件——Stratix V GX FPGA信號完整性套件，在推動業(yè)界28-nm FPGA發(fā)展方面樹立了新里程碑。這一全功能套件支持設(shè)計工程師加速高性能系統(tǒng)的設(shè)計和開發(fā)，滿足了業(yè)界對提高帶寬的需求。Stratix V GX FPGA信號完整性開發(fā)套件為用戶提供的平臺能夠測量并評估從600 Mbps到12.5 Gbps的收發(fā)器鏈路性能。
關(guān)鍵字： Altera FPGA Stratix V GX

Microsemi宣布提供SmartFusion cSoC成本優(yōu)化版本

致力于提供幫助功率管理、安全、可靠與高性能半導(dǎo)體技術(shù)產(chǎn)品的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation，紐約納斯達(dá)克交易所代號：MSCC) 宣布提供經(jīng)成本優(yōu)化的SmartFusion 可定制單芯片系統(tǒng) (customizable system-on-chip, cSoC) 器件A2F060，該器件備有商用和工業(yè)溫度等級型款，專門針對大批量應(yīng)用而設(shè)計，包括馬達(dá)和運(yùn)動控制、游戲機(jī)、太陽能逆變器，以及臨床和成像醫(yī)療電子設(shè)備。
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賽靈思FPGA：面向動態(tài)應(yīng)用的靈活操作系統(tǒng)

利用賽靈思FPGA的動態(tài)重配置功能，同構(gòu)多線程執(zhí)行模型可同時兼得軟件靈活性和硬件性能。一臺在未知的土地...
關(guān)鍵字：賽靈思 FPGA

多時鐘域數(shù)據(jù)傳遞的Spartan-II FPGA實現(xiàn)

本文采用FPGA來設(shè)計一款廣泛應(yīng)用于計算機(jī)、Modem、數(shù)據(jù)終端以及許多其他數(shù)字設(shè)備之間的數(shù)據(jù)傳輸?shù)膶Ｓ卯惒讲⑿型ㄐ沤涌谛酒?，實現(xiàn)了某一時鐘域(如66 MHz)的8位并行數(shù)據(jù)到另一低時鐘域(如40 MHz)16位并行數(shù)據(jù)的異步轉(zhuǎn)換，并且客戶可以根據(jù)自己的要求進(jìn)行數(shù)據(jù)定義。完成數(shù)據(jù)在不同時鐘域間的正確傳遞的同時防止亞穩(wěn)態(tài)的出現(xiàn)，保持系統(tǒng)的穩(wěn)定，是電路設(shè)計的關(guān)鍵。
關(guān)鍵字： Spartan-II FPGA 多時鐘域數(shù)據(jù)

基于FPGA的高速自適應(yīng)濾波器的實現(xiàn)

在LMS算法進(jìn)行變步長處理的基礎(chǔ)上，結(jié)合馳豫超前流水線技術(shù)和時序重構(gòu)技術(shù)提出了創(chuàng)新結(jié)構(gòu)和改進(jìn)算法，在FPGA的仿真綜合環(huán)境中設(shè)計實現(xiàn)了該高速自適應(yīng)濾波器，并且在Altera DE2-70開發(fā)板上進(jìn)行了板級測試。
關(guān)鍵字： FPGA 自適應(yīng)濾波器

基于DSP和FPGA的多波形雷達(dá)回波中頻模擬器實現(xiàn)

基于DSP和FPGA的多波形雷達(dá)回波中頻模擬器實現(xiàn),本文論述一種自主產(chǎn)生式的雷達(dá)回波模擬器中頻部分的設(shè)計實現(xiàn)方法，該模擬器可產(chǎn)生脈沖單頻、脈沖線性調(diào)頻、步進(jìn)頻、步進(jìn)頻+線性調(diào)頻等多種波形的雷達(dá)回波信號，并可產(chǎn)生雙目標(biāo)和參數(shù)可控的帶限高斯白噪聲，可模擬主要
關(guān)鍵字：中頻模擬器實現(xiàn) 雷達(dá) 波形 DSP FPGA 基于

面向動態(tài)應(yīng)用的靈活操作系統(tǒng)

一臺在未知的土地上行進(jìn)的自動機(jī)器人；一部能夠根據(jù)信號強(qiáng)度改變解壓縮格式的視頻解碼器；一套寬帶電子對抗系統(tǒng)；一種用于機(jī)動車輛的自適應(yīng)圖像跟蹤算法……這些都屬于大量涌現(xiàn)的隨環(huán)境瞬變做出快速響應(yīng)的新興嵌入式或者關(guān)鍵任務(wù)應(yīng)用。在過去，靜態(tài)決策最壞情況分配曾為嚴(yán)格的實時約束提供了解決方案，而現(xiàn)在靈活性也成為一項要求。法國某研究項目建議使用的解決方案是一種分布在 FPGA 資源上，對軟硬件線程進(jìn)行管理的操作系統(tǒng)。
關(guān)鍵字：賽靈思 FPGA

從特殊應(yīng)用領(lǐng)域入手滿足FPGA客戶需求

FPGA未來的發(fā)展必然是以客戶需求為牽引，目前FPGA產(chǎn)品已經(jīng)進(jìn)入了“應(yīng)用為王”的時代，構(gòu)建不同應(yīng)用領(lǐng)域的平臺...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費(fèi)電子 FPGA

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fpga-to-asic介紹

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fpga-to-asic電路

利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計的方法
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計與實現(xiàn)
基于FPGA的LCD顯示遠(yuǎn)程更新

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