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一種基于FPGA+ARM架構(gòu)HDLC協(xié)議控制器設(shè)計(jì)
- 摘要：針對飛控模擬裝置中基于HDLC協(xié)議通信需求，完成了一種新的基于FPGA+ARM架構(gòu)HDLC協(xié)議控制器的設(shè)計(jì)。文中首先介紹了HDLC協(xié)議的幀結(jié)構(gòu)和循環(huán)冗余校驗(yàn)(CRC)原理，然后結(jié)合FPGA可進(jìn)行任意數(shù)據(jù)寬度操作和ARM編程簡單靈活的優(yōu)點(diǎn)，有效實(shí)現(xiàn)了符合HDLC協(xié)議的幀結(jié)構(gòu)和CRC校驗(yàn)的應(yīng)用方法，滿足HDLC協(xié)議要求。應(yīng)用結(jié)果表明設(shè)計(jì)能夠很好地滿足各項(xiàng)功能指標(biāo)的技術(shù)要求。 高級數(shù)據(jù)鏈路控制(HDLC，High-Level Data Control)是一種同步數(shù)據(jù)傳輸、面向比特的數(shù)據(jù)鏈路層協(xié)議
- 關(guān)鍵字： FPGA ARM HDLC
基于FPGA+DSP的HDLC(高級數(shù)據(jù)鏈路控制)功能實(shí)現(xiàn)
- 基于FPGA+DSP的HDLC(高級數(shù)據(jù)鏈路控制)功能實(shí)現(xiàn),引言 HDLC的ASIC芯片使用簡易，功能針對性強(qiáng)，性能可靠，適合應(yīng)用于特定用途的大批量產(chǎn)品中。但由于HDLC標(biāo)準(zhǔn)的文本較多，ASIC芯片出于專用性的目的難以通用于不同版本，缺乏應(yīng)用靈活性。有的芯片公司還有自己的標(biāo)
- 關(guān)鍵字： 鏈路 控制 功能 實(shí)現(xiàn) 數(shù)據(jù) 高級 FPGA DSP HDLC 基于
HDLC的FPGA實(shí)現(xiàn)方法
- 1 引言 HDLC（High-level Data Link Control Procedures, 高級數(shù)據(jù)鏈路控制規(guī)程）廣泛應(yīng)用于數(shù)據(jù)通信領(lǐng)域，是確保數(shù)據(jù)信息可靠互通的重要技術(shù)。實(shí)施HDLC的一般方法通常是采用ASIC（Application Specific Integr
- 關(guān)鍵字： HDLC FPGA 實(shí)現(xiàn)方法
MSP430F5xxx 在高速公路不停車收費(fèi)系統(tǒng)（ETC）中的應(yīng)用
- 本文探討了使用MSP430F5xxx實(shí)現(xiàn)ETC系統(tǒng)中實(shí)時HDLC編解碼的方法。MSP430F5xxx是TI公司MSP430家族最新產(chǎn)品序...
- 關(guān)鍵字： MSP430F5xxx ETC系統(tǒng) HDLC
基于FPGA的高速同步HDLC通信控制器設(shè)計(jì)
- 摘要：高級數(shù)據(jù)鏈路控制HDLC協(xié)議是一種面向比特的鏈路層協(xié)議，具有同步傳輸數(shù)據(jù)、冗余度低等特點(diǎn)，是在通信領(lǐng)域中應(yīng)用最廣泛的鏈路層協(xié)議之一。提出實(shí)現(xiàn)HDLC通信協(xié)議的主要模塊——CRC校驗(yàn)?zāi)K及l(fā)squo;0
- 關(guān)鍵字： FPGA HDLC 通信 制器設(shè)計(jì)
用FPGA+DSP實(shí)現(xiàn)HDLC(高級數(shù)據(jù)鏈路控制)功能
- 用FPGA+DSP實(shí)現(xiàn)HDLC(高級數(shù)據(jù)鏈路控制)功能, 引言 HDLC的ASIC芯片使用簡易，功能針對性強(qiáng)，性能可靠，適合應(yīng)用于特定用途的大批量產(chǎn)品中。但由于HDLC標(biāo)準(zhǔn)的文本較多，ASIC芯片出于專用性的目的難以通用于不同版本，缺乏應(yīng)用靈活性。有的芯片公司還有自己
- 關(guān)鍵字： 鏈路 控制 功能 數(shù)據(jù) 高級 DSP 實(shí)現(xiàn) HDLC FPGA
HDLC的DSP與FPGA實(shí)現(xiàn)
- 引言 HDLC(高級數(shù)據(jù)鏈路控制)廣泛應(yīng)用于數(shù)據(jù)通信領(lǐng)域，是確保數(shù)據(jù)信息可靠互通的重要技術(shù)。實(shí)施HDLC的一般方法通常是采用ASIC器件或軟件編程等。 HDLC的ASIC芯片使用簡易，功能針對性強(qiáng)，性能可靠，適合應(yīng)用于特定用途的大批量產(chǎn)品中。但由于HDLC標(biāo)準(zhǔn)的文本較多，ASIC芯片出于專用性的目的難以通用于不同版本，缺乏應(yīng)用靈活性。有的芯片公司還有自己的標(biāo)準(zhǔn)，對HDLC的CRC(循環(huán)冗余碼校驗(yàn))序列生成多項(xiàng)式等有不同的規(guī)定。專用于HDLC的ASIC芯片其片內(nèi)數(shù)據(jù)存儲器容量有限，通常只有不
- 關(guān)鍵字： HDLC DSP FPGA 201008
基于FPGA的多通道HDLC收發(fā)電路設(shè)計(jì)
- HDLC(High Level Date Link Control)協(xié)議是通信領(lǐng)域中應(yīng)用最廣泛的協(xié)議之一，它是面向比特的高級數(shù)據(jù)鏈路控制規(guī)程，具有差錯檢測功能強(qiáng)大、高效和同步傳輸?shù)奶攸c(diǎn)。目前市場上有很多專用的HDLC芯片，但這些芯片大
- 關(guān)鍵字： FPGA HDLC 多通道 電路設(shè)計(jì)
基于NiosII的HDLC協(xié)議控制系統(tǒng)的實(shí)現(xiàn)
- 本系統(tǒng)在保證雙方可靠通信的前提下，最終實(shí)現(xiàn)PC主控機(jī)與基站之間實(shí)時、可靠的信息交互與監(jiān)控管理功能。
- 關(guān)鍵字： NiosII HDLC 協(xié)議 控制系統(tǒng)
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高級數(shù)據(jù)鏈路控制（High-Level Data Link Control或簡稱HDLC），是一個在同步網(wǎng)上傳輸 數(shù)據(jù)、面向比特的數(shù)據(jù)鏈路層協(xié)議，它是由國際標(biāo)準(zhǔn)化組織(ISO)根據(jù)IBM公司的SDLC(Synchronous Data Link Control)協(xié)議擴(kuò)展開發(fā)而成的.
七十年代初，IBM公司率先提出了面向比特的同步數(shù)據(jù)鏈路控制規(guī)程SDLC（Synchronous Data Li [ 查看詳細(xì) ]
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