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Tensilica結(jié)盟SPIRIT DSP移動(dòng)多媒體音視頻解決方案

　　音視頻軟件供應(yīng)商SPIRIT公司和Tensilica公司今日宣布雙方結(jié)成戰(zhàn)略伙伴關(guān)系，并發(fā)布18個(gè)經(jīng)過優(yōu)化的高質(zhì)量數(shù)字音頻和語音算法軟件包，可支持SOC設(shè)計(jì)中日益流行的HIFI2音頻引擎。　　SPIRIT音頻軟件包現(xiàn)包括：AAC-LC 編解碼器、aacPlus v1及v2編解碼器、BSAC 解碼器、MP3編解碼器、Ogg Vorbis解碼器, 和WMA編解碼器。語音編碼包括AMR-NB (窄帶)、AMR-WB和G.729AB。　　此外，在戰(zhàn)略伙伴關(guān)系框架下，雙方將致力于在Tensilica公
關(guān)鍵字： DSP Tensilica SPIRIT 移動(dòng)多媒體音視頻 SOC

恩智浦推出新型蜂窩調(diào)制解調(diào)器

　　恩智浦半導(dǎo)體推出高帶寬蜂窩軟調(diào)制解調(diào)器——Nexperia蜂窩系統(tǒng)解決方案PNX6910。PNX6910由恩智浦功能強(qiáng)大的數(shù)字信號處理(DSP)內(nèi)核——嵌入式矢量處理器（EVP）驅(qū)動(dòng)，可實(shí)現(xiàn)高達(dá)150 Mbits的下行和50 Mbits的上行數(shù)據(jù)傳輸速率，并且支持多種模式（LTE/HSPA/UMTS/EDGE/GPRS/GSM）。　　由于下一代移動(dòng)設(shè)備提供超高速互聯(lián)網(wǎng)瀏覽、視頻流服務(wù)、多人聯(lián)機(jī)游戲甚至標(biāo)準(zhǔn)長度的高清影片，因而消費(fèi)者可以從精彩紛呈的用戶
關(guān)鍵字：恩智浦蜂窩調(diào)制解調(diào)器 DSP EVP

高效FPGA乘法器在無線基站中的使用

　　基于WiMax及其派生標(biāo)準(zhǔn)的新興寬帶無線協(xié)議需要越來越高的吞吐量和數(shù)據(jù)速率。這些協(xié)議提出的快速芯片速率和數(shù)字射頻處理可以在使用FPGA方案的硬件上得到最佳的實(shí)現(xiàn)。　　FPGA非常適合作為高性能、高性價(jià)比的解決方案來實(shí)現(xiàn)這些物理層協(xié)議中的數(shù)字功能，因?yàn)樗鼈儼ㄒ韵仑S富的資源：　　1.DSP模塊，可以用來實(shí)現(xiàn)各種FIR濾波和FFT/IFFT操作所要求的乘法器和加法器/累加器功能；　　2. SERDES收發(fā)器，可以支持無線前端與基帶數(shù)字板之間的CPRI和OBSAI接口；　　3. 重要的FPG
關(guān)鍵字： FPGA 乘法器無線基站 WiMax DSP IP核

一種基于多DSP協(xié)同工作的控制系統(tǒng)

　　盡管數(shù)字信號處理器(DSP)的性能越來越強(qiáng)，基于DSP嵌入式系統(tǒng)的功能也越來越多，但對于實(shí)時(shí)性、容錯(cuò)性、可靠性要求很高的多任務(wù)信號處理及多路過程控制方面的應(yīng)用，單個(gè)DSP嵌入式系統(tǒng)的處理能力是不夠的。分布式系統(tǒng)處理能力強(qiáng)、可靠性高，采用多個(gè)DSP嵌入式子系統(tǒng)構(gòu)成分布式系統(tǒng)，利用分布式系統(tǒng)的并發(fā)性實(shí)現(xiàn)多個(gè)DSP的并行處理，滿足多任務(wù)、實(shí)時(shí)性的要求。同時(shí)，通過硬件和軟件冗余設(shè)計(jì)，保證了系統(tǒng)的可靠性。　　本文采用TMS320F2812 DSP實(shí)現(xiàn)了三個(gè)同構(gòu)的、具有多種實(shí)時(shí)信號處理和多個(gè)過程控制功能的嵌入
關(guān)鍵字： DSP CAN總線嵌入式分布式系統(tǒng)

用FPGA實(shí)現(xiàn)低成本實(shí)時(shí)深度感知

引言　　對于自主機(jī)器人導(dǎo)航和其它機(jī)器視覺應(yīng)用來說，實(shí)時(shí)深度感知是很關(guān)鍵的。目前通過立體圖像來計(jì)算深度的算法計(jì)算量很大，例如差異測繪，要占用CPU大量的時(shí)間，或者需要用昂貴的器件進(jìn)行實(shí)時(shí)操作。　　針對立體攝像的深度感知，F(xiàn)PGA解決方案能使處理器的時(shí)間得到緩解，減少或除去器件的成本，例如MPU、DSP、激光器和昂貴的鏡頭。通過提供給機(jī)器人其環(huán)境中的差異測繪，F(xiàn)PGA使機(jī)器人中的CPU專注于重要的高層任務(wù)，例如建圖和定位。差異測繪　　加深度感知到機(jī)器人的常用技術(shù)是用兩個(gè)水平放置的
關(guān)鍵字：機(jī)器視覺 FPGA 深度感知嵌入式 DSP 200806

基于CMOS圖像傳感器的嵌入式圖像采集與格式轉(zhuǎn)化

開發(fā)了一種基于CMOS圖像傳感器的嵌入式圖像采集系統(tǒng)。該系統(tǒng)實(shí)現(xiàn)了圖像有效采集傳輸?shù)墓δ埽瑢⒉杉降腂ayer格式數(shù)據(jù)轉(zhuǎn)化為RGB格式，采用嵌入式系統(tǒng)有利集成化、小型化設(shè)計(jì)。
關(guān)鍵字： CMOS 圖像傳感器 DSP Bayer格式圖像采集 200806

基于USB接口和DSP的飛機(jī)防滑剎車測試系統(tǒng)設(shè)計(jì)

提出了以DSP為控制核心，采用USB通信設(shè)計(jì)的飛機(jī)防滑剎車測試系統(tǒng)。分析了飛機(jī)防滑剎車測試系統(tǒng)的組成，并介紹了測試系統(tǒng)主要硬件電路設(shè)計(jì)和系統(tǒng)上下位機(jī)軟件設(shè)計(jì)。
關(guān)鍵字：剎車測試系統(tǒng) 設(shè)計(jì) 防滑飛機(jī) USB 接口 DSP 基于

異步DSP核心設(shè)計(jì):更低功耗,更高性能

目前，處理器性能的主要衡量指標(biāo)是時(shí)鐘頻率。絕大多數(shù)的集成電路 (IC) 設(shè)計(jì)都基于同步架構(gòu)，而同步架構(gòu)都采用全球一致的時(shí)鐘。這種架構(gòu)非常普及，許多人認(rèn)為它也是數(shù)字電路設(shè)計(jì)的唯一途徑。然而，有一種截然不同的設(shè)計(jì)技術(shù)即將走上前臺：異步設(shè)計(jì)。
這一新技術(shù)的主要推動(dòng)力來自硅技術(shù)的發(fā)展?fàn)顩r。隨著硅產(chǎn)品的結(jié)構(gòu)縮小到 90 納米以內(nèi)，降低功耗就已成為首要事務(wù)。異步設(shè)計(jì)具有功耗低、電路更可靠等優(yōu)點(diǎn)，被看作是滿足這一需要的途徑。

異步技術(shù)由于諸多原因曾經(jīng)備受冷落，其中最重要的是缺乏標(biāo)準(zhǔn)化的
關(guān)鍵字：功耗高性能設(shè)計(jì) 核心 DSP 異步

基于DSP和模糊控制的尋線行走機(jī)器人設(shè)計(jì)與實(shí)現(xiàn)

　　在最近的機(jī)器人比賽和電子設(shè)計(jì)競賽中，較多參賽題目要求機(jī)器人沿場地內(nèi)白色或黑色指引線行進(jìn)。一些研究人員提出了基于尋線的機(jī)器人設(shè)計(jì)策略，主要是關(guān)注指引線的檢測，但對于機(jī)器人的整體設(shè)計(jì)未做說明。本文在總結(jié)此類賽事的基礎(chǔ)上，提出了一種將DSP(Digital Signal Processor)和CPLD(Complex Programmable Logic Device)作為核心處理器，采用模糊控制策略處理來自檢測指引線傳感器信號的機(jī)器人行走機(jī)構(gòu)的通用性設(shè)計(jì)方法。　　1 車體機(jī)械設(shè)計(jì) 　　由于機(jī)器人比賽
關(guān)鍵字： DSP 模糊控制機(jī)器人傳感器單片機(jī)

FPGA+DSP實(shí)時(shí)三維圖像信息處理系統(tǒng)

　　三維圖像信息處理一直是圖像視頻處理領(lǐng)域的熱點(diǎn)和難點(diǎn)，目前國內(nèi)外成熟的三維信息處理系統(tǒng)不多，已有的系統(tǒng)主要依賴高性能通用PC完成圖像采集、預(yù)處理、重建、構(gòu)型等囊括底層和高層的處理工作。三維圖像處理數(shù)據(jù)量特別大、運(yùn)算復(fù)雜，單純依靠通用PC很難達(dá)到實(shí)時(shí)性要求，不能滿足現(xiàn)行高速三維圖像處理應(yīng)用。　　本系統(tǒng)中，采用FPGA實(shí)現(xiàn)底層的信號預(yù)處理算法，其處理數(shù)據(jù)量很大，處理速度高，但算法結(jié)構(gòu)相對比較簡單，可同時(shí)兼顧速度和靈活性。高層處理算法數(shù)據(jù)量較少、算法結(jié)構(gòu)復(fù)雜，可采用運(yùn)算速度快、尋址方式靈活、通信機(jī)制強(qiáng)大的
關(guān)鍵字： FPGA DSP 三維圖像信息處理 EVIP PCI

EDGE手機(jī)基帶處理設(shè)計(jì)的幾種實(shí)現(xiàn)方法評估

在無線市場上，EDGE協(xié)議已迅速為業(yè)者所接受，EDGE手機(jī)設(shè)計(jì)中支持多時(shí)隙傳輸、多種調(diào)制解調(diào)器/語音編譯碼器是基...
關(guān)鍵字： EDGE系統(tǒng) 基帶 DSP 語音編碼器 GMSK 形狀因子算術(shù)邏輯單元信道質(zhì)量頻率誤差音頻電路

基于DSP Builder的14階FIR濾波器的設(shè)計(jì)

數(shù)字濾波器在數(shù)字信號處理的各種應(yīng)用中發(fā)揮著十分重要的作用，他是通過對采樣數(shù)據(jù)信號進(jìn)行數(shù)學(xué)運(yùn)算處理來達(dá)到頻域?yàn)V波的目的。數(shù)字濾波器既可以是有限長單脈沖響應(yīng)(FIR)濾波器也可以是無限長單脈沖響應(yīng)(IIR)濾波器。在維納濾波器理論發(fā)明的早期，人們使用IIR濾波器，但現(xiàn)在更多是使用FIR濾波器。本文按照Matlab／Simulink／DSP Builder／QuartusⅡ流程，設(shè)計(jì)一個(gè)FIR濾波器。Altera DSP Builder是連接Simulink和QuartusⅡ開發(fā)軟件的DSP開發(fā)工具。在DSP
關(guān)鍵字：濾波器設(shè)計(jì) FIR Builder DSP 基于

異步 DSP 核心設(shè)計(jì): 更低功耗，更高性能

這一新技術(shù)的主要推動(dòng)力來自硅技術(shù)的發(fā)展?fàn)顩r。隨著硅產(chǎn)品的結(jié)構(gòu)縮小到 90 納米以內(nèi)，降低功耗就已成為首要事務(wù)。異步設(shè)計(jì)具有功耗低、電路更可靠等優(yōu)點(diǎn)，被看作是滿足這一需要的途徑。
關(guān)鍵字：功耗高性能設(shè)計(jì) 核心 DSP 異步

用8位微處理器實(shí)現(xiàn)數(shù)字低通濾波器設(shè)計(jì)

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關(guān)鍵字： 8位微處理器 DSP 數(shù)字低通濾波器