本硬件方案既簡(jiǎn)單又直接，但設(shè)計(jì)師需要考慮與主微處理器架構(gòu)和等待時(shí)間相關(guān)的數(shù)據(jù)吞吐量的潛在瓶頸。因此必須認(rèn)真考慮平臺(tái)的系統(tǒng)性能。例如，在便攜式媒體處理器中，有可能存在圖像處理器共享同一個(gè)總線。因此，如果希望得到更高的性能，可以考慮采用Quick Logic IDE與SDRAM控制器設(shè)計(jì)方案。

　　QuickLogic IDE與SDRAM控制器

　　優(yōu)點(diǎn)

　　如果主處理器的本地總線或SDRAM控制器，允許外部設(shè)備來(lái)控制總線并直接向主存儲(chǔ)器寫入數(shù)據(jù)，那么橋接器可以向主存儲(chǔ)器直接存取512字節(jié)扇區(qū)的數(shù)據(jù)。這樣將大大節(jié)省主處理器的周期，消除主處理器對(duì)局部總線進(jìn)行傳輸請(qǐng)求的響應(yīng)等待時(shí)間，并且可以減少微處理器進(jìn)行磁盤相關(guān)數(shù)據(jù)傳輸操作的執(zhí)行時(shí)間。這使得主處理器可以同時(shí)運(yùn)行其他系統(tǒng)進(jìn)程或降低操作速度來(lái)節(jié)省功耗。主處理器并不積極地參與跟硬盤驅(qū)動(dòng)器之間的數(shù)據(jù)傳輸。預(yù)先在主存儲(chǔ)器中寫入數(shù)據(jù)，可以防止在執(zhí)行中出現(xiàn)遺漏。主存儲(chǔ)器更快且更有效的數(shù)據(jù)傳輸，可降低硬盤驅(qū)動(dòng)器的活動(dòng)時(shí)間以及硬盤驅(qū)動(dòng)器的整體功耗。根據(jù)具體應(yīng)用的不同，功耗降低的程度也不相同。一個(gè)完整的單芯片配套解決方案是由硬件來(lái)控制數(shù)據(jù)的傳輸，從而大大增強(qiáng)系統(tǒng)的性能。由于基本數(shù)據(jù)的傳輸都在硬件中進(jìn)行處理，不必再擔(dān)心中斷反應(yīng)時(shí)間和中斷堆棧。UDMA的ATA-66也應(yīng)能夠在這方案中被實(shí)現(xiàn)，而且更能有效地提高系統(tǒng)性能。

　　缺點(diǎn)

　　一般情況下，只有一個(gè)外部主設(shè)備可以對(duì)SDRAM進(jìn)行直接訪問(wèn)。大部分具有外部圖形協(xié)處理器或者其他相關(guān)硬件加速器的CPU，都具有專供該外部設(shè)備使用的SDRAM控制，使得IDE失去了用武之地。雖然可編程QuickLogicIDE橋接處理器中使用的某些仲裁邏輯可以允許超過(guò)一個(gè)總線主控，但是一般情況下，系統(tǒng)要求專用硬件加速器必須具有優(yōu)先級(jí)別和總線讀寫。本方案有利于提升系統(tǒng)性能和驅(qū)動(dòng)程序開(kāi)發(fā)，但是隨著系統(tǒng)內(nèi)存總線速率的提升和向DDR SDRAM技術(shù)的轉(zhuǎn)移，允許外部?jī)?nèi)存總線主控的CPU已經(jīng)不再是主流產(chǎn)品。而且，由于SDRAM控制器和用于控制的外部總線接口，這種方案還需要配備更多的邏輯電路，這就不可避免地增加了該設(shè)計(jì)的成本。

　　性能測(cè)試

　　用于低功耗應(yīng)用領(lǐng)域的嵌入式處理器缺乏硬盤控制器，這使得系統(tǒng)設(shè)計(jì)師不得不自己解決連接性難題。 支持下一代迷你硬盤的標(biāo)準(zhǔn)如CE-ATA(類似SDIO協(xié)議)和iVDR(基于串行ATA)可能進(jìn)一步延緩在新SoC上硬盤驅(qū)動(dòng)器控制器的出現(xiàn)。

　　然而，由于處理器和硬盤消耗了大量的系統(tǒng)功耗，因此，要想實(shí)現(xiàn)主內(nèi)存和硬盤驅(qū)動(dòng)之間的更有效的信息傳遞必然會(huì)影響電池的壽命。巧妙地采用橋接器，可以提高主內(nèi)存和硬盤驅(qū)動(dòng)這兩個(gè)子系統(tǒng)處于節(jié)電狀態(tài)的時(shí)間百分比，從而實(shí)現(xiàn)更高的電池效率。

　　QuickLogic提供了超低功耗的IDE橋接控制器作為配套芯片來(lái)連接低功耗嵌入式處理器，從而在提升系統(tǒng)性能的同時(shí)減少了硬盤存儲(chǔ)相關(guān)作業(yè)的CPU占用率，最大限度地降低了功耗。QuickLogic提供的IDE橋接器可以在實(shí)際應(yīng)用中實(shí)現(xiàn)10Mbps~13Mbps的數(shù)據(jù)傳輸速率。尤其是該產(chǎn)品基于QuickLogic 微瓦FPGA技術(shù)，這意味著移動(dòng)平臺(tái)系統(tǒng)設(shè)計(jì)師可以跨越基于傳統(tǒng)SRAM的FPGA造成的功耗限制和CPLD性能的挑戰(zhàn)。同時(shí)它還遵循正興起的總線標(biāo)準(zhǔn)，并具有整合額外系統(tǒng)功能的能力。

　　人們?cè)絹?lái)越意識(shí)到，在便攜式系統(tǒng)增加額外系統(tǒng)功能的同時(shí)，必須注意其對(duì)電池壽命的影響。系統(tǒng)性能和功耗的最佳搭配，是通過(guò)在基于可編程邏輯的配套設(shè)備中，用硬件方法實(shí)現(xiàn)大量的數(shù)學(xué)算法和數(shù)據(jù)通道管理，而不是在嵌入式處理器上用軟件的方法來(lái)實(shí)現(xiàn)。QuickLogic配套芯片方法可以為系統(tǒng)設(shè)計(jì)師提供更多的工具來(lái)權(quán)衡系統(tǒng)性能和功耗，從而實(shí)現(xiàn)最佳搭配。