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          一種多通道ARINC429總線收發(fā)容錯(cuò)方法的研究

          作者: 時(shí)間:2013-06-15 來(lái)源:網(wǎng)絡(luò) 收藏

          3 總線接收模塊設(shè)計(jì)
          總線接收模塊,要實(shí)現(xiàn)能自動(dòng)識(shí)別兩種速率100 Kb/s和12.5 Kb/s,并對(duì)數(shù)據(jù)進(jìn)行校驗(yàn)。
          3.1 電平轉(zhuǎn)換電路
          和發(fā)送模塊類似,接收模塊在接收信號(hào)之前,也要進(jìn)行電平轉(zhuǎn)換,將信號(hào)轉(zhuǎn)換成FPGA能識(shí)別的電平,接收模塊電平轉(zhuǎn)換電路圖如圖3所示。

          本文引用地址:http://cafeforensic.com/article/175788.htm

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          3.2 接收狀態(tài)轉(zhuǎn)換
          接收模塊主要有5個(gè)輸入端口和2個(gè)輸出端口,輸入端口分別為:時(shí)鐘clk_800khz、復(fù)位rst_n、校驗(yàn)方式set_od、ARINC429總線busa和busb,輸出端口包括:輸出數(shù)據(jù)outdata、輸出使能done_rec。
          接收模塊主要包括兩個(gè)狀態(tài):空閑和接收。在空閑狀態(tài)時(shí),ARINC429總線上沒(méi)有數(shù)據(jù)傳輸時(shí),兩根線busa和busb都為邏輯“0”,即clk_429=0時(shí),說(shuō)明有數(shù)據(jù)到來(lái),轉(zhuǎn)到發(fā)送狀態(tài)。
          在接收狀態(tài)時(shí),接收數(shù)據(jù)并移入移位寄存器,當(dāng)有連續(xù)4個(gè)周期busa和busb都為0,即clk_429=1時(shí),表示接收完成,轉(zhuǎn)到空閑狀態(tài)。然而,在傳送最后一位數(shù)據(jù)時(shí)還有半個(gè)位周期clk_429=0,所以實(shí)際上是連續(xù)4.5個(gè)位周期如圖4所示。由于ARINC429總線有兩種發(fā)送速率即12.5 Kb/s和100 Kb/s,所以不同速率時(shí)的4個(gè)周期的時(shí)間也不一樣,而且傳輸數(shù)據(jù)時(shí)每一位都有半個(gè)位周期是時(shí)鐘周期,因此需列出不同速率和周期對(duì)應(yīng)的時(shí)長(zhǎng)。本設(shè)計(jì)的時(shí)鐘選取為800 kHz,表2為此時(shí)鐘下的計(jì)數(shù)值。

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          從表2中可以看出,在100 Kb/s速率下4個(gè)位周期的計(jì)數(shù)值為32,而12.5 Kb/s時(shí)為256,所以無(wú)論任何速率當(dāng)計(jì)數(shù)值為32時(shí)可認(rèn)為是當(dāng)前傳輸結(jié)束。但是,12.5 Kb/s速率時(shí)的半個(gè)位周期的計(jì)數(shù)值也為32,會(huì)出現(xiàn)錯(cuò)誤。所以,選擇33為傳輸結(jié)束的計(jì)數(shù)值。



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