基于FPGA的全新數(shù)字化PCM中頻解調(diào)器設計
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2．2 數(shù)宇變頻及濾波器設計
變頻模塊的設計是整個設計的關鍵部分之一。如圖2所示，該模塊由NCO、CIC濾波器、半帶濾波器和FIB濾波器組成。NCO通過與A／D之后的中頻信號進行混頻，從而得到基帶頻率的I、O兩路正交信號，這兩路信號分別通過CIC濾波器、半帶濾波器以及FIR濾波器的抽取和濾波，最終得到要求速率的數(shù)字信號，從而實現(xiàn)數(shù)字信號由中頻頻率到基帶頻率的轉(zhuǎn)變。本文引用地址：http://cafeforensic.com/article/190341.htm
2．3 鑒頻單元設計
從理論上來說，可以直接利用頻率是相位對時間的微分關系來實現(xiàn)鑒頻。假設瞬時頻率為f(t)，瞬時相位為φ(t)，同相分量為I(t)，正交分量為Q(t)，則根據(jù)：
這就是利用I(n)、Q(n)計算瞬時頻率f(n)的近似公式。
數(shù)字鑒頻單元實現(xiàn)結構如圖3所示。
2．4 跟蹤環(huán)路設計
本系統(tǒng)設計中采用的是均勻采樣二階DPLL。
典型均勻采樣二階DPLL相位模型可以用圖4來表示，它由相位檢測器PD、數(shù)字環(huán)路濾波器(Digital Loop Filter)和數(shù)字控制本振(Numeri cally Control Oscillator)組成。在這個DPLL中，相位檢測器PD根據(jù)輸入相位或計算相位誤差。相位誤差通過數(shù)字環(huán)路濾波DLF并用于控制數(shù)字控制本振RCO的瞬時輸出相位。在圖4中，系數(shù)C1和C2是數(shù)字環(huán)路濾波器(DLF)的參數(shù)，是影響環(huán)路帶寬和環(huán)路響應時間的重要參數(shù)，而C是確定DPLL中心頻率的常數(shù)。這種DPLL的最大優(yōu)點就是具有線性相位，從而保證了捕獲時間小和鎖相范圍大的性能。
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