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          簡單的JK觸發(fā)器的VHDL程序

          作者: 時(shí)間:2016-11-30 來源:網(wǎng)絡(luò) 收藏
          簡單的JK觸發(fā)器
          LIBRARY IEEE;
          USE IEEE.STD_LOGIC_1164.ALL;
          ENTITY JKff_1 IS
          PORT (J,K:IN STD_LOGIC;
          clk : IN std_logic;
          Q: out STD_LOGIC);
          end JKff_1;
          ARCHITECTURE behave OF JKff_1 IS
          signal S:STD_LOGIC;
          BEGIN
          S<= (J and (not S)) or (S and (not K)) when clkevent and clk=0 ;
          Q<=S ;
          end behave;


          關(guān)鍵詞: JK觸發(fā)器VHDL程

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