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          一種用于超高速ADC的輸入信號(hào)緩沖器設(shè)計(jì)

          作者:胡遠(yuǎn)冰 時(shí)間:2018-05-30 來(lái)源:電子產(chǎn)品世界 收藏
          編者按:提出一種基于TSMC40LP工藝的輸入信號(hào)緩沖器,用于12 bit 4 GSPS ADC的緩沖器設(shè)計(jì)。本緩沖器采用開(kāi)環(huán)源隨器結(jié)構(gòu),由于工藝角和溫度變化,開(kāi)環(huán)結(jié)構(gòu)的緩沖器的輸出共模將會(huì)漂移,導(dǎo)致比較器的輸入共模發(fā)生漂移,使得比較器的比較結(jié)果發(fā)生錯(cuò)誤。采用Replica共模反饋的方式為主緩沖器提供共模,實(shí)現(xiàn)緩沖器的輸出共模的穩(wěn)定,避免比較器因?yàn)楣材W兓ぷ鞑徽?。為了達(dá)到線性度的要求,通過(guò)疊層源隨器和電容,將輸入信號(hào)耦合到源隨器的漏端,避免了短溝道器件的溝調(diào)效應(yīng)。源隨器采用深N阱器件,消除了襯底偏置效應(yīng)。本

          作者 胡遠(yuǎn)冰 電子科技大學(xué) 微電子與固體電子學(xué)院(四川 成都 610054)

          本文引用地址:http://cafeforensic.com/article/201805/380762.htm

            胡遠(yuǎn)冰(1989-),男,碩士生,研究方向:模擬集成電路設(shè)計(jì)。

          摘要:提出一種基于TSMC40LP工藝的輸入信號(hào),用于12 bit 4 GSPS ADC的設(shè)計(jì)。本采用開(kāi)環(huán)源隨器結(jié)構(gòu),由于工藝角和溫度變化,開(kāi)環(huán)結(jié)構(gòu)的緩沖器的輸出共模將會(huì)漂移,導(dǎo)致比較器的輸入共模發(fā)生漂移,使得比較器的比較結(jié)果發(fā)生錯(cuò)誤。采用Replica共模反饋的方式為主緩沖器提供共模,實(shí)現(xiàn)緩沖器的輸出共模的穩(wěn)定,避免比較器因?yàn)楣材W兓ぷ鞑徽?。為了達(dá)到的要求,通過(guò)疊層源隨器和電容,將輸入信號(hào)耦合到源隨器的漏端,避免了短溝道器件的溝調(diào)效應(yīng)。源隨器采用深N阱器件,消除了。本源隨器提供強(qiáng)大的輸入信號(hào)驅(qū)動(dòng),避免多通道ADC交織時(shí),相互之間的影響。同時(shí)驅(qū)動(dòng)大的電容負(fù)載,并提供高質(zhì)量的輸入信號(hào)。后仿真得到源隨器的最小帶寬為9.7 GHz,在1 pF負(fù)載,500 MHz,800 mVpp輸入信號(hào)時(shí),SFDR為79.86 dB,滿足12 bit 4 GSPS ADC的要求。

          0 引言

            輸入信號(hào)緩沖器,可以采用閉環(huán)單位增益運(yùn)放的方式實(shí)現(xiàn),這也是最為常見(jiàn)的方式。對(duì)于低速ADC而言,可以不用緩沖器,或者閉環(huán)運(yùn)放的方式,而超高速ADC而言,如果不采用緩沖器,通常封裝的寄生電感會(huì)使得輸入信號(hào)質(zhì)量變差。高速高帶寬應(yīng)用的閉環(huán)運(yùn)放穩(wěn)定性是很難保證的。緩沖器將提供強(qiáng)大的輸入信號(hào)驅(qū)動(dòng),避免多通道ADC交織時(shí),相互之間的影響。同時(shí)驅(qū)動(dòng)大的電容負(fù)載,并提供高質(zhì)量的輸入信號(hào)。因此對(duì)于超高速ADC而言,輸入信號(hào)緩沖器是至關(guān)重要的模塊之一。源隨器作為ADC的緩沖器,其輸出阻抗低,結(jié)合ADC的采樣電容,可以達(dá)到寬帶的目的。

          1 硬件設(shè)計(jì)

            常見(jiàn)的源隨器主要有兩種結(jié)構(gòu):?jiǎn)喂茉措S器[1](Source follower)和超級(jí)源隨器[2](Super-source follower)。

            圖1為單管源隨器電路及其小信號(hào)等效電路,通過(guò)小信號(hào)等效模型可以計(jì)算出輸入輸出增益和輸出阻抗。從其表達(dá)式也可以看出,輸入輸出增益近似為單位增益,輸出阻抗小,但是輸入輸出的、襯偏效應(yīng)(深N阱工藝不受影響)的影響,使得輸入輸出在高頻時(shí)迅速變差。


          (1)

            由于MOS管的跨導(dǎo)較小,單管源隨器的輸出阻抗較大,要實(shí)現(xiàn)大帶寬較為困難,需要較大的功耗。為了進(jìn)一步減小輸出阻抗,采用負(fù)反饋方式的超級(jí)源隨器,以輸出阻抗減小環(huán)路增益的倍數(shù)。超級(jí)源隨器及其小信號(hào)等效電路[2],如圖2所示。

            當(dāng)輸入信號(hào)保持不變時(shí),輸出減小,使得NM1的漏端也減小,PM1的柵源電壓增大,流過(guò)PM1的電流變大,使得輸出電壓增大,實(shí)現(xiàn)電壓負(fù)反饋,達(dá)到穩(wěn)定輸出的目的。根據(jù)KCL方程可以得到超級(jí)源隨器的增益和輸出阻抗的表達(dá)式:其中rno與rpo分別為NM1與PM1的輸出阻抗;r1與r2為電流源的輸出電阻。

          (2)

            假設(shè)電流源是理想電流源,與單管源隨器相比具有更大的增益,更小的輸出阻抗。但是超級(jí)源隨器仍然存在溝調(diào)效應(yīng)和襯偏效應(yīng)非理想因素的影響,導(dǎo)致高頻輸出信號(hào)的線性度變差。調(diào)研發(fā)現(xiàn),有不少的文章都在致力于解決上述源隨器存在的非理想效應(yīng)[3-6],但是效果不是很理想,不能應(yīng)用于超高速ADC。

            通過(guò)上述的分析,傳統(tǒng)的源隨器與超級(jí)源隨器結(jié)構(gòu)均存在,會(huì)影響高速ADC輸入信號(hào)的線性度,惡化ADC的性能[7]?;谡{(diào)研分析,采用一種解決的源隨器結(jié)構(gòu)[3-4],同時(shí)能夠滿足超高速ADC的線性度要求。圖3為本設(shè)計(jì)采用的適用于超高速ADC輸入信號(hào)緩沖器的基本電路結(jié)構(gòu)。NM1、NM2、NM3、NM4構(gòu)成源隨器的主要輸入對(duì)管。R1、C1解決高頻輸入時(shí)的源隨器線性度下降。R3為終端電阻,其共模電壓由共模反饋部分提供。NM5、NM6、NM7、NM8和Amp構(gòu)成共模反饋。

            本設(shè)計(jì)所采用的源隨器電路解決了傳統(tǒng)源隨器存在的非理想因素。NM1、NM2、NM3、NM4均為深N阱器件,在設(shè)計(jì)時(shí)不用考慮襯底偏置效應(yīng)的影響。通過(guò)C1、NM3、NM4將輸入信號(hào)耦合到節(jié)點(diǎn)NA、NB,使得NM1、NM2的漏源電壓變化減小,減小了溝調(diào)效應(yīng)的影響,提高線性度。傳統(tǒng)的設(shè)計(jì)是不含共模反饋的,對(duì)于超高速ADC應(yīng)用的緩沖器設(shè)計(jì)共模反饋需要很高的帶寬,在穩(wěn)定性方面是很難保證的,而且功耗非常大。為了克服輸出輸共模隨溫度和工藝的變化,提出了共模反饋的解決方案,為了滿足超高速ADC的應(yīng)用,本設(shè)計(jì)提出了Replica的共模反饋方式,給主源隨器提供共模電壓,將源隨器按比例復(fù)制用于共模反饋,那么共模反饋部分工作在DC狀態(tài),穩(wěn)定性可以很好地得到滿足,功耗也較低。通過(guò)共模反饋的使用,解決了因?yàn)楣に嚱呛蜏囟茸兓沟幂敵龉材W兓膯?wèn)題,保證后續(xù)比較器能夠正常工作。

            在設(shè)計(jì)源隨器時(shí),根據(jù)ADC的指標(biāo)來(lái)計(jì)算,對(duì)于12 bit 4 GSPS ADC而言,用SFDR近似SNDR計(jì)算:

          (3)

            要達(dá)到12位精度,SFDR=74 dB,要達(dá)到11位精度,SFDR=67.98 dB。

            對(duì)于輸入buffer,以單極點(diǎn)近似有:

          (4)

            要求在一個(gè)周期內(nèi)buffer的輸出能夠建立到0.5 LSB范圍內(nèi):

          (5)

            得到輸入buffer的帶寬滿足:

          (6)

            考慮工藝角和溫度變化對(duì)帶寬的影響,取BW=7 GHz。但實(shí)際的時(shí)鐘包含上升沿、下降沿以及非交疊時(shí)間,建立時(shí)間不會(huì)達(dá)到一個(gè)周期,所以建立時(shí)間會(huì)比一個(gè)時(shí)鐘周期要短,因此在設(shè)計(jì)時(shí)取帶寬BW=10 GHz。

          2 前仿真驗(yàn)證

            完成源隨器設(shè)計(jì)后,源隨器負(fù)載電容為1.5 pF,200 mV的正弦輸入信號(hào)通過(guò)4.7 μF電容交流耦合進(jìn)入源隨器。圖4為Buffer各個(gè)Corner下的帶寬前仿真如圖4所示(SSHT最小為10.8 GHz)。

            對(duì)源隨器的輸出進(jìn)行FFT分析,得到不同工藝角下源隨器輸出的線性度(SFDR),如表1所示。

            前仿真可以看到,本次設(shè)計(jì)緩沖器,在低頻的線性度均在85 dB以上,1.8 GHz輸入信號(hào)時(shí),線性度均在71 dB以上,滿足12 bit 4 GSPS ADC的應(yīng)用要求。

          3 后仿真驗(yàn)證

            在該源隨器經(jīng)過(guò)前仿真驗(yàn)證后,充分考慮匹配和減小寄生,進(jìn)行版圖實(shí)現(xiàn),進(jìn)行寄生參數(shù)提取,完成后仿真驗(yàn)證。圖5為TT Corner下源隨器輸出信號(hào)在不同輸入信號(hào)頻率時(shí),輸出信號(hào)的頻譜,從中可以得到SFDR參數(shù),不同Corner的統(tǒng)計(jì)結(jié)果如表2所示,與前仿真相比,后仿真線性度有一定的減小,最小帶寬大于9.6 GHz。均滿足12 bit 4 GSPS ADC的要求。

          4 結(jié)論

            本次設(shè)計(jì)所提出的源隨器結(jié)構(gòu),適用于超高速ADC的輸入信號(hào)緩沖器,解決了傳統(tǒng)緩沖器存在的溝調(diào)效應(yīng)和襯偏效應(yīng)。提出了Replica的共模反饋方式,為緩沖器提供共模,解決了ADC緩沖器的輸出共模在工藝角和溫度變化后發(fā)生漂移的問(wèn)題。仿真驗(yàn)證得到源隨器的低頻線性度均在73 dB以上,奈奎斯特頻率輸入的線性度均在65 dB以上,滿足12 bit 4 GSPS ADC設(shè)計(jì)需要。

            參考文獻(xiàn):

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