行譯碼器結(jié)構(gòu)與列譯碼器基本相同，但沒(méi)有電源節(jié)點(diǎn)。使用TG邏輯譯碼器的另一巨大好處是可以減少晶體管的數(shù)量。在靜態(tài)邏輯，參考文獻(xiàn)[9]的譯碼器由84 只晶體管組成，但用TG結(jié)構(gòu)組成的行和列譯碼器有30只晶體管，并且總數(shù)是60。這意味著芯片面積可能也被減少。較少的晶體管級(jí)數(shù)也幫助減少延時(shí)。另一方面，使用TG結(jié)構(gòu)的邏輯門最大級(jí)數(shù)可減少到2級(jí)；不使用傳輸門結(jié)構(gòu)的全CMOS結(jié)構(gòu)的最高門級(jí)數(shù)是3，以上充分說(shuō)明使用TG結(jié)構(gòu)更有利減少延時(shí)和改進(jìn)工作頻率。表1給出相關(guān)的參量對(duì)比。

2．3 工作原理

用行列譯碼器進(jìn)行譯碼，單位電流源是導(dǎo)通還是截止，共有三種情況。第一種是所在行和下一行都是“1”，在這種情況下，無(wú)論列控制信號(hào)是否為“1”，該電流源均被選中。也就是說(shuō)，對(duì)應(yīng)的電流源開(kāi)關(guān)狀態(tài)為接通狀態(tài)。第二種情況是所在的行控制信號(hào)為“1”，但是下一行的控制信號(hào)為“0”，這時(shí)，電流源是否被選中，要根據(jù)列控制信號(hào)來(lái)決定。如果列控制信號(hào)為“1”，則該電流源被選中；如果列控制信號(hào)為“0”，則該電流源不被選中，處于截止?fàn)顟B(tài)。第三種情況是所在行和下一行的控制信號(hào)均為“0”，那么不管其所在列的控制信號(hào)為多少，此電流源不會(huì)被選中，處于截止?fàn)顟B(tài)。TG構(gòu)成的開(kāi)關(guān)電路如圖4所示。

3 電流源電路及減少毛刺電路

電流源電路是DAC的重要部分，同時(shí)為了減小毛刺反應(yīng)，下面將介紹減少毛刺的電路。

3．1 電流單元

一般常用的設(shè)計(jì)均采用減少電路噪聲和降低電流源的復(fù)雜結(jié)構(gòu)。例如，差分電路、偏置電路、參考電流等需要很多數(shù)量的晶體管。在這個(gè)設(shè)計(jì)中，使用一個(gè)簡(jiǎn)單的電流單元結(jié)構(gòu)，并且電流源采用由二只晶體管組成的電流源單元。與其他芯片相比，電路的面積可以大大減小，如圖5所示。