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          基于FPGA的錯(cuò)誤檢測(cè)與自動(dòng)糾正的設(shè)計(jì)實(shí)現(xiàn)

          作者: 時(shí)間:2012-03-11 來源:網(wǎng)絡(luò) 收藏
          CPU,可能需要插入等待周期等等,但由于采用VHDL語言進(jìn)行設(shè)計(jì),有很大的靈活性,稍加改動(dòng)就可以滿足不同場合的需求


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