半導(dǎo)體設(shè)計(jì) 文章進(jìn)入半導(dǎo)體設(shè)計(jì)技術(shù)社區(qū)

基于單片機(jī)的復(fù)雜可編程邏輯器件快速配置方法

IIC總線通訊接口器件的CPLD實(shí)現(xiàn)

利用FPGA實(shí)現(xiàn)模式可變的衛(wèi)星數(shù)據(jù)存儲器糾錯系統(tǒng)

一個(gè)嵌入式系統(tǒng)的Petri網(wǎng)模型與CPLD實(shí)現(xiàn)

基于FPGA的機(jī)載合成孔徑雷達(dá)數(shù)字信號處理機(jī)接口板卡的設(shè)計(jì)與實(shí)現(xiàn)

一種用CPLD實(shí)現(xiàn)視頻信號運(yùn)動檢測的方法

可編程控制器在船舶減搖鰭隨動系統(tǒng)中的應(yīng)用

基于生物學(xué)的電子電路設(shè)計(jì)

基于CPLD的系統(tǒng)中I2C總線的設(shè)計(jì)

基于FPGA/CPLD和USB技術(shù)的無損圖像采集卡

非多路復(fù)用與多路復(fù)用總線轉(zhuǎn)換橋的設(shè)計(jì)與實(shí)現(xiàn)

高速PCB設(shè)計(jì)中的時(shí)序分析及仿真策略

基于分布式算法和FPGA實(shí)現(xiàn)基帶信號成形的研究

用Verilog HDL實(shí)現(xiàn)I2C總線功能

基于Verilog HDL的CMOS圖像敏感器驅(qū)動電路設(shè)計(jì)

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半導(dǎo)體設(shè)計(jì)介紹

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基于FPGA的機(jī)載合成孔徑雷達(dá)數(shù)字信號處理機(jī)接口板卡的設(shè)計(jì)與實(shí)現(xiàn)

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可編程控制器在船舶減搖鰭隨動系統(tǒng)中的應(yīng)用

基于生物學(xué)的電子電路設(shè)計(jì)

基于CPLD的系統(tǒng)中I2C總線的設(shè)計(jì)

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非多路復(fù)用與多路復(fù)用總線轉(zhuǎn)換橋的設(shè)計(jì)與實(shí)現(xiàn)

高速PCB設(shè)計(jì)中的時(shí)序分析及仿真策略

基于分布式算法和FPGA實(shí)現(xiàn)基帶信號成形的研究

用Verilog HDL實(shí)現(xiàn)I2C總線功能

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