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          萊迪思富士通發(fā)布LatticeSC和LatticeECP2

          • -通力合作打造出難以超越的FPGA產(chǎn)品系列- 萊迪思半導(dǎo)體公司近日宣布推出其新一代的90納米FPGA,包含兩個(gè)全新的FPGA器件系列。LatticeSC™ 系統(tǒng)芯片F(xiàn)PGA的設(shè)計(jì)宗旨是提供業(yè)界最佳的整體性能,而LatticeECP2™ FPGA則將業(yè)界成本最低的FPGA結(jié)構(gòu)和高端的FPGA功能集于一身。這兩個(gè)器件系列都采用了富士通公司經(jīng)過優(yōu)化的工藝,既滿足了高容量FPGA對(duì)成本效率的要求,又能夠提供擁有數(shù)百萬門的系統(tǒng)級(jí)FPGA所需的千兆赫性能。這兩個(gè)器件系列將在
          • 關(guān)鍵字: LatticeECP2  LatticeSC  富士通  萊迪思  

          萊迪思推出LatticeSC系統(tǒng)芯片F(xiàn)PGA系列

          • -    LatticeSC FPGA 將高速I/O、SERDES、結(jié)構(gòu)化的ASIC模塊 和高性能的FPGA結(jié)構(gòu)集成在單個(gè)器件上 -     萊迪思半導(dǎo)體公司近日發(fā)布了其LatticeSCTM系統(tǒng)芯片F(xiàn)PGA系列。該系列在高速應(yīng)用中有著無以倫比的性能和連通性。LatticeSC FPGA采用富士通的90納米CMOS工藝技術(shù)并用300毫米硅片制造,能夠加速芯片至芯片、芯片至存儲(chǔ)器、高速串行
          • 關(guān)鍵字: FPGA系列  LatticeSC  萊迪思  

          用可編程的扭斜控制來解決時(shí)鐘網(wǎng)絡(luò)問題的方法

          • 時(shí)鐘網(wǎng)絡(luò)管理問題提高同步設(shè)計(jì)的整體性能的關(guān)鍵是提高時(shí)鐘網(wǎng)絡(luò)的頻率。然而,諸如時(shí)序裕量、信號(hào)完整性、相關(guān)時(shí)鐘邊沿的同步等因素極大地增加了時(shí)鐘網(wǎng)絡(luò)設(shè)計(jì)的復(fù)雜度。傳統(tǒng)上,時(shí)鐘網(wǎng)絡(luò)的設(shè)計(jì)采用了簡單的元件,諸如扇出緩沖器、時(shí)鐘發(fā)生器、延時(shí)線、零延時(shí)緩沖器和頻率合成器。由于PCB走線長度不等而引起的時(shí)序誤差,采用蜿蜒走線設(shè)計(jì)的走線長度匹配方法來處理。走線阻抗與輸出驅(qū)動(dòng)阻抗的不匹配經(jīng)常通過反復(fù)試驗(yàn)選擇串聯(lián)電阻來消除。多種信號(hào)的標(biāo)準(zhǔn)使得時(shí)鐘邊沿的同步更加復(fù)雜。至今,這三種挑戰(zhàn)會(huì)經(jīng)常遇到,并且鮮有理想的解決方案。以下描述了
          • 關(guān)鍵字: 萊迪思  

          可編程邏輯器件融合CPLD+FPGA最佳特性

          • 可編程邏輯器件融合CPLD+FPGA最佳特性 Lattice(萊迪思)半導(dǎo)體公司近日推出了新的MachXO可編程邏輯器件系列產(chǎn)品,Lattice稱,這種新一代的跨越式可編程邏輯器件支持傳統(tǒng)上由高密度的CPLD或者低容量的FPGA所實(shí)現(xiàn)的應(yīng)用?! ?jù)Lattice現(xiàn)場應(yīng)用支持副總裁Jock Tomlinson介紹,MachXO邏輯器件建立在低成本的130nm嵌入式Flash處理工藝上。它能夠在單芯片中瞬時(shí)工作,這種特性對(duì)于許多CPLD應(yīng)用來說是十分重要的。3.5ns的管腳至管腳的延時(shí)使得器件能夠滿足當(dāng)代系統(tǒng)
          • 關(guān)鍵字: Lattice(萊迪思)半導(dǎo)體公司  

          萊迪思推出ispCLOCKTM高性能時(shí)鐘發(fā)生器器件

          • 萊迪思半導(dǎo)體公司(NASDAQ:LSCC)今天宣布推出其革命性的ispCLOCKTM在系統(tǒng)可編程時(shí)鐘發(fā)生器器件新系列。ispClock5500系列中的第一批器件:10輸出的ispClock5510 和 20 輸出的 ispClock5520將一個(gè)高性能的時(shí)鐘發(fā)生器和一個(gè)靈活的通用扇出緩沖器合成在一起。采用了一個(gè)高性能的鎖相環(huán)以及時(shí)鐘乘除工具,該片上的時(shí)鐘發(fā)生器可以提供多達(dá)5個(gè)頻率范圍從10MHz到320MHz的時(shí)鐘。無論是單端還是差分信號(hào)模式,通用扇出緩沖器都可以驅(qū)動(dòng)多達(dá)20個(gè)時(shí)鐘網(wǎng)絡(luò),并且每一個(gè)輸出都是
          • 關(guān)鍵字: 萊迪思  

          萊迪思推出業(yè)界第一個(gè)混合信號(hào)PLD、開拓了電源管理市場

          • 世界上最大的在系統(tǒng)可編程器件供應(yīng)商-萊迪思半導(dǎo)體公司(納斯達(dá)克代號(hào):LSCC)宣布推出其創(chuàng)新的PowerPAC™器件。這是業(yè)界第一片混合信號(hào)可編程邏輯器件(PLD),它內(nèi)含在系統(tǒng)可編程的模擬和邏輯組塊,能提供經(jīng)過優(yōu)化的電源管理功能,這一功能對(duì)如今的多電源電子系統(tǒng)是至關(guān)重要的。該器件集成了可編程邏輯、電壓比較器、參考電壓及高電壓的場效應(yīng)管驅(qū)動(dòng)器,支持單芯片可編程供電定序與監(jiān)控,為總值達(dá)到120億美元的電源半導(dǎo)體市場奉獻(xiàn)了獨(dú)特的可編程控制方案。雖然,微處理器、DSP、FPGA和專用集成電路(ASI
          • 關(guān)鍵字: 萊迪思  模擬IC  電源  

          萊迪思低功耗的CPLD 器件系列將其可編程解決方案拓展至便攜式電子產(chǎn)品市場

          • 在系統(tǒng)可編程(ISP™)邏輯產(chǎn)品的發(fā)明者-萊迪思半導(dǎo)體公司(納斯達(dá)克代號(hào):LSCC)今天正式宣布其1.8伏 ispMACH
          • 關(guān)鍵字: 萊迪思  
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          萊迪思介紹

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