鎖相環(huán) 文章 進(jìn)入鎖相環(huán)技術(shù)社區(qū)
基于ADF4106的鎖相環(huán)頻率器研究與設(shè)計(jì)
- 本文由鎖相環(huán)頻率合成器的基本工作原理入手，介紹基于鎖相環(huán)芯片ADF4106的工作特性，并結(jié)合環(huán)路濾波器、壓控振蕩器和射頻通路設(shè)計(jì)出一種輸出頻率為2GHz的頻率合成器，并經(jīng)過印制板加工及測試，驗(yàn)證實(shí)驗(yàn)結(jié)果滿足設(shè)計(jì)指標(biāo)。
- 關(guān)鍵字： 鎖相環(huán) ADF4106 環(huán)路濾波器 壓控振蕩器 201509
基于2．5 Gbps收發(fā)器的相位鎖定檢測電路設(shè)計(jì)與仿真
- 摘要：相位鎖定檢測電路是鎖相環(huán)環(huán)路的關(guān)鍵電路，其性能的優(yōu)劣直接影響了整個(gè)系統(tǒng)的工作。本文描述了相位鎖定檢測電路的工作原理，根據(jù)項(xiàng)目實(shí)際提出一種相位鎖定檢測方案，按照全定制設(shè)計(jì)流程采用SMIC0.18μm CMOS混合信號(hào)工藝完成了電路的設(shè)計(jì)、仿真。結(jié)果表明該電路在2.5Gbps收發(fā)器電路中可以穩(wěn)定可靠地工作。 關(guān)鍵詞：相位鎖定檢測;CMOS電路;鎖相環(huán);收發(fā)器 鎖相環(huán)是高速多通道串行收發(fā)系統(tǒng)中的關(guān)鍵電路，相位是否準(zhǔn)確對齊對于系統(tǒng)性能有著重要影響。電荷泵鎖相環(huán)因其穩(wěn)定性高，捕獲范圍大，
- 關(guān)鍵字： 相位鎖定檢測 CMOS電路 鎖相環(huán) 收發(fā)器
德州儀器推出可提供業(yè)界最佳噪聲性能的 14GHz 分?jǐn)?shù)N分頻鎖相環(huán)(PLL)
- 日前，德州儀器 (TI) 宣布推出支持高級(jí)頻率調(diào)制功能的業(yè)界最高性能 14GHz 分?jǐn)?shù) N分頻PLLatinum? 鎖相環(huán) (PLL)。該 LMX2492 提供業(yè)界最佳噪聲性能，比性能最接近的同類競爭器件低 6dB，可提升射頻 (RF) 靈敏度以及雷達(dá)覆蓋范圍及精確度。此外，該器件還支持 200MHz 的相位頻率檢測器、5V 充電泵電源以及 500 MHz 至 14GHz 的寬泛工作頻率。LMX2492 提供工業(yè)及汽車級(jí)(1 級(jí))版本，適用于軍事與汽車?yán)走_(dá)、微波回程、通信以及測量測試應(yīng)用。如欲
- 關(guān)鍵字： 德州儀器 鎖相環(huán)
一種新型帶寬自適應(yīng)全數(shù)字鎖相環(huán)的設(shè)計(jì)方案
- 本方案采用理論分析與硬件電路設(shè)計(jì)相結(jié)合的方法進(jìn)行了系統(tǒng)設(shè)計(jì)，并用FPGA予以實(shí)現(xiàn)。系統(tǒng)仿真與硬件電路測試結(jié)果證實(shí)了設(shè)計(jì)方案的正確性。該鎖相環(huán)的自由振蕩頻率可隨輸入信號(hào)頻率的變化而改變，具有電路結(jié)構(gòu)簡單、鎖相范圍廣、鎖定速度快和穩(wěn)態(tài)誤差小等特點(diǎn)。
- 關(guān)鍵字： FPGA 鎖相環(huán) 振蕩器 濾波器 計(jì)數(shù)器
基于多環(huán)鎖相寬帶細(xì)步進(jìn)頻率合成器的設(shè)計(jì)
- 摘要：為了滿足寬頻段、細(xì)步進(jìn)頻率綜合器的工程需求，對基于多環(huán)鎖相的頻率合成器進(jìn)行了分析和研究。在對比傳統(tǒng)...
- 關(guān)鍵字： 多環(huán)技術(shù) 鎖相環(huán) 寬帶 細(xì)步進(jìn) 低雜散
基于TMS320F28335的微網(wǎng)鎖相環(huán)的設(shè)計(jì)方案探討
- 微電網(wǎng)是將分布式電源、儲(chǔ)能單元、負(fù)荷以及監(jiān)控、保護(hù)裝置結(jié)合在一起，形成一個(gè)對公共電網(wǎng)來說單一可控的單元...
- 關(guān)鍵字： TMS320F28335 鎖相環(huán)
改進(jìn)的解耦雙同步坐標(biāo)系鎖相環(huán)的設(shè)計(jì)與實(shí)現(xiàn)
- 摘要：微網(wǎng)中的電壓可能會(huì)存在較大的諧波和不平衡，因此要求鎖相環(huán)(PLL)能夠迅速、準(zhǔn)確地確定電網(wǎng)正序電壓的相位。提出的改進(jìn)型解耦雙同步坐標(biāo)系PLL通過在q軸加入6次諧波的陷波器，可抑制電網(wǎng)中的5次負(fù)序電壓和7次正
- 關(guān)鍵字： 鎖相環(huán) 雙同步坐標(biāo)系 解耦陷波器
鑒頻鑒相器的指標(biāo)對鎖相環(huán)死區(qū)及抖動(dòng)性能的影
- 該應(yīng)用筆記討論了鑒頻鑒相器的指標(biāo)對鎖相環(huán)(PLL)死區(qū)及抖動(dòng)性能的影響。在使用電荷泵環(huán)路濾波的PLL設(shè)計(jì)中，通 ...
- 關(guān)鍵字： 鑒頻 鑒相器 鎖相環(huán) 抖動(dòng)性能
基于FPGA的數(shù)字三相鎖相環(huán)優(yōu)化設(shè)計(jì)
- 數(shù)字三相鎖相環(huán)中含有大量乘法運(yùn)算和三角函數(shù)運(yùn)算，占用大量的硬件邏輯資源。為此，提出一種數(shù)字三相鎖相環(huán)的優(yōu)化實(shí)現(xiàn)方案，利用乘法模塊復(fù)用和CORDIC算法實(shí)現(xiàn)三角函數(shù)運(yùn)算，并用Vetilog HDL硬件描述語言對優(yōu)化前后的算法進(jìn)行了編碼實(shí)現(xiàn)。仿真和實(shí)驗(yàn)結(jié)果表明，優(yōu)化后的數(shù)字三相鎖相環(huán)大大節(jié)省了FPGA的資源，并能快速、準(zhǔn)確地鎖定相位，具有良好的性能。
- 關(guān)鍵字： FPGA 數(shù)字 三相 鎖相環(huán)
鎖相環(huán)介紹
能使受控振蕩器的頻率和相位均與輸入信號(hào)保持確定關(guān)系的閉環(huán)電子電路。鎖相環(huán)的基本結(jié)構(gòu)如圖1，其中鑒相器用來鑒別輸入信號(hào)ui與輸出信號(hào)u0之間的相位差,并輸出誤差電壓ud。ud中的噪聲和干擾成分被低通性質(zhì)的環(huán)路濾波器濾除，形成壓控振蕩器(VCO)的控制電壓uC。uC作用于壓控振蕩器的結(jié)果是把它的輸出振蕩頻率f0拉向環(huán)路輸入信號(hào)頻率fi,當(dāng)二者相等時(shí)，環(huán)路被鎖定，稱為入鎖。維持鎖定的直流控制電壓由鑒相器 [ 查看詳細(xì) ]
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