arm+fpga 文章進(jìn)入arm+fpga技術(shù)社區(qū)

ARM開發(fā)經(jīng)驗(yàn)

前一段時(shí)間做了arm的一些開發(fā)，主要是編寫了arm的啟動(dòng)軟件和移植了uCOS-II到arm7。我做事情喜歡深入簡(jiǎn)出，及從最簡(jiǎn)單，最原理的方面先做一個(gè)框架，然后在這個(gè)框架里面進(jìn)行補(bǔ)充。我還是一個(gè)很喜歡和別人討論的人，希望有人可以給我提出意見和建議。我的這個(gè)心得很初級(jí)，都是一些基本的東西?，F(xiàn)在拿出來和大家分享，希望在我畢業(yè)之前能給大家留一些紀(jì)念。由于這些東西發(fā)paper實(shí)在是沒有價(jià)值，但是我感覺可以作為arm開發(fā)的入門。由于我的水平和經(jīng)驗(yàn)有限，錯(cuò)誤也是難免的。但是如果不拿出來和大家分享，就
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使用ARM標(biāo)準(zhǔn)C庫進(jìn)行嵌入式應(yīng)用程序開發(fā)

引言隨著對(duì)高處理能力、實(shí)時(shí)多任務(wù)、超低功耗等方面需求的增長(zhǎng)，高端嵌入式處理器已經(jīng)進(jìn)入了國(guó)內(nèi)開發(fā)人員的視野，并在國(guó)內(nèi)得到了普遍的重視和應(yīng)用。ARM是目前嵌入式領(lǐng)域應(yīng)用最廣泛的RISC微處理器結(jié)構(gòu)，憑借低成本、低功耗、高性能等優(yōu)點(diǎn)占據(jù)了嵌入式系統(tǒng)應(yīng)用領(lǐng)域的領(lǐng)先地位。ADS是ARM公司推出的ARM集成開發(fā)環(huán)境，提供了對(duì)C和C++的支持，是目前開發(fā)ARM的主要工具。本文針對(duì)日益縮短的嵌入式開發(fā)周期，結(jié)合ARM系統(tǒng)開發(fā)調(diào)試經(jīng)驗(yàn)，對(duì)使用ARM標(biāo)準(zhǔn)庫進(jìn)行應(yīng)用程序開發(fā)作了比較系統(tǒng)的分析。 1
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FPGA與DS18B20型溫度傳感器通信的實(shí)現(xiàn)

DS18B20是DALLAS公司生產(chǎn)的一線式數(shù)字溫度傳感器，采用3引腳TO-92型小體積封裝；溫度測(cè)量范圍為-55℃～+125℃，可編程為9位～12位A/D轉(zhuǎn)換精度，測(cè)溫分辨率可達(dá)0.0625℃，被測(cè)溫度用符號(hào)擴(kuò)展的16位數(shù)字量方式串行輸出。一線式(1-WIRE)串行總線是利用1條信號(hào)線就可以與總線上若干器件進(jìn)行通信。具體應(yīng)用中可以利用微處理器的I/O端口對(duì)DS18B20直接進(jìn)行通信，也可以通過現(xiàn)場(chǎng)可編程門陣列(FPGA)等可編程邏輯器件(PLD)實(shí)現(xiàn)對(duì)1-WIRE器件的通信。
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ARM發(fā)布07年第一季度未審計(jì)財(cái)報(bào)

　　近日，英國(guó)ARM公司（倫敦證交所：ARM；納斯達(dá)克：ARMHY）公布了截止至2007年3月31日的2007年第一季度未審計(jì)財(cái)務(wù)報(bào)告，報(bào)告顯示第一季度公司營(yíng)業(yè)收入達(dá)到6650萬英鎊，以美元結(jié)算營(yíng)業(yè)收入達(dá)到1.292億美元，比去年同期分別增長(zhǎng)了3%和14%。由于美元對(duì)英鎊匯率的下跌（2007年第一季度1.94美元兌1英鎊，2006年第一季度1.75美元兌1英鎊），依照2006年第一季度的實(shí)際匯率，2007年第一季度英鎊營(yíng)業(yè)收入將達(dá)到7400萬英鎊。　　第一季度公司授權(quán)業(yè)務(wù)的營(yíng)業(yè)收入達(dá)到5430萬美元，
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基于ADSP-BF537的視頻SOC驗(yàn)證方案

本文介紹一種利用嵌入Blackfin處理器的ADSP-BF537作為處理器進(jìn)行SoC的FPGA實(shí)時(shí)驗(yàn)證的方案及其總線接口轉(zhuǎn)換...
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基于IP核的FPGA設(shè)計(jì)方法

前　言幾年前設(shè)計(jì)專用集成電路(ASIC) 還是少數(shù)集成電路設(shè)計(jì)工程師的事, 隨著硅的集成度不斷提高,百萬門的ASIC 已不難實(shí)現(xiàn), 系統(tǒng)制造公司的設(shè)計(jì)人員正越來越多地采用ASIC 技術(shù)集成系統(tǒng)級(jí)功能(System L evel In tegrete - SL I) , 或稱片上系統(tǒng)(System on a ch ip ) , 但ASIC 設(shè)計(jì)能力跟不上制造能力的矛盾也日益突出。現(xiàn)在設(shè)計(jì)人員已不必全部用邏輯門去設(shè)計(jì)ASIC, 類似于用集成電路( IC) 芯片在印制板上的設(shè)計(jì),ASIC 設(shè)計(jì)人員可以應(yīng)用等
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基于FPGA的MPEG-4編解碼器

您是否曾想在您的 FPGA 設(shè)計(jì)中使用先進(jìn)的視頻壓縮技術(shù)，卻發(fā)現(xiàn)實(shí)現(xiàn)起來太過復(fù)雜？現(xiàn)在您無需成為一名視頻專家就能在您的系統(tǒng)中使用視頻壓縮。賽靈思新推出的 MPEG-4 編碼器/解碼器核可以幫助您滿足視頻壓縮需求。
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ARM是什么?

如果說，“嵌入式”是2001年電子工程師談?wù)摰米疃嗟脑~之一，2002年談?wù)摰米疃嗟囊粋€(gè)詞就是“ARM”。究竟什么是ARM呢，他是英國(guó)一家電子公司的名字，全名的意思是Advanced RISC Machine。該公司成立于1990年11月，是蘋果電腦，Acorn電腦集團(tuán)和VLSI Technology的合資企業(yè)。Acorn曾推出世界上首個(gè)商用單芯片RISC處理器，而蘋果電腦當(dāng)時(shí)希望將RISC技術(shù)應(yīng)用于自身系統(tǒng)，ARM微處理器新標(biāo)準(zhǔn)因此應(yīng)運(yùn)而生。　 &nbs
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基于并行流水線結(jié)構(gòu)的可重配FIR濾波器的FPGA實(shí)現(xiàn)

1 并行流水結(jié)構(gòu)FIR的原理在用FPGA或?qū)Ｓ眉呻娐穼?shí)現(xiàn)數(shù)字信號(hào)處理算法時(shí)，計(jì)算速度和芯片面積是兩個(gè)相互制約的主要問題。實(shí)際應(yīng)用FIR濾波器時(shí)，要獲得良好的濾波效果，濾波器的階數(shù)可能會(huì)顯著增加，有時(shí)可能會(huì)多達(dá)幾百階。因此，有必要在性能和實(shí)現(xiàn)復(fù)雜性之間做出選擇，也就是選擇不同的濾波器實(shí)現(xiàn)結(jié)構(gòu)。這里運(yùn)用并行流水線結(jié)構(gòu)來實(shí)現(xiàn)速度和硬件面積之間的互換和折衷。在關(guān)鍵路徑插入寄存器的流水線結(jié)構(gòu)是提高系統(tǒng)吞吐率的一項(xiàng)強(qiáng)大的實(shí)現(xiàn)技術(shù)，并且不需要大量重復(fù)設(shè)置硬件。流水線的類型主要分為兩種：算術(shù)流水線和指令流水線
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USB海量存儲(chǔ)類設(shè)備功能在ARM系統(tǒng)中的應(yīng)用

技術(shù)發(fā)展到今天的信息時(shí)代，數(shù)據(jù)的存儲(chǔ)和傳輸在嵌入式系統(tǒng)有了越來越重要的地位。而USB是目前設(shè)計(jì)成熟、應(yīng)用廣泛且使用極為簡(jiǎn)捷的技術(shù)，USB傳輸是一種高效方便的數(shù)據(jù)傳輸方式。　　基于上述原因，本文重點(diǎn)論述基于USB的海量存儲(chǔ)(USB Mass Storage)設(shè)備功能在ARM嵌入式系統(tǒng)中設(shè)計(jì)和應(yīng)用。使用該設(shè)備功能，上位機(jī)可以像讀寫普通U盤一樣對(duì)于系統(tǒng)采集并存儲(chǔ)在FLASH中的數(shù)據(jù)進(jìn)行讀寫。　　1 硬件方案　　l.1 器件簡(jiǎn)介　　S3C44B0X[1]是SAMSUNG公司出品的基于ARM7T
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FPGA設(shè)計(jì)的驗(yàn)證技術(shù)及應(yīng)用原則

FPGA設(shè)計(jì)和驗(yàn)證工程師當(dāng)今面臨的最大挑戰(zhàn)之一是時(shí)間和資源制約。隨著FPGA在速度、密度和復(fù)雜性方面的增加，完成一個(gè)完整時(shí)序驗(yàn)證對(duì)人力和計(jì)算機(jī)處理器、存儲(chǔ)器提出了更多更高的要求。　　隨著FPGA器件體積和復(fù)雜性的不斷增加，設(shè)計(jì)工程師越來越需要有效的驗(yàn)證方。時(shí)序仿真可以是一種能發(fā)現(xiàn)最多問題的驗(yàn)證方法，但對(duì)許多設(shè)計(jì)來說，它常常是最困難和費(fèi)時(shí)的方法之一。過去，采用標(biāo)準(zhǔn)臺(tái)式計(jì)算機(jī)的時(shí)序仿真是以小時(shí)或分鐘計(jì)算的，但現(xiàn)在對(duì)某些項(xiàng)目來說，在要求采用高性能64位服務(wù)器的情況下，其測(cè)試時(shí)間卻要幾天甚至幾周。這樣，這種
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基于ARM的FPGA加載配置實(shí)現(xiàn)

引言基于SRAM工藝FPGA在每次上電后需要進(jìn)行配置，通常情況下FPGA的配置文件由片外專用的EPROM來加載。這種傳統(tǒng)配置方式是在FPGA的功能相對(duì)穩(wěn)定的情況下采用的。在系統(tǒng)設(shè)計(jì)要求配置速度高、容量大、以及遠(yuǎn)程升級(jí)時(shí)，這種方法就顯得很不實(shí)際也不方便。本文介紹了通過ＡＲＭ對(duì)可編程器件進(jìn)行配置的的設(shè)計(jì)和實(shí)現(xiàn)。 1 配置原理與方式 1.1 配置原理在FPGA正常工作時(shí)，配置數(shù)據(jù)存儲(chǔ)在SRAM單元中，這個(gè)SRAM單元也被稱為配置存儲(chǔ)（Configuration RAM）。由于SRAM是易失性的存
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基于SYSTEM C的FPGA設(shè)計(jì)方法

一、概述隨著VLSI的集成度越來越高，設(shè)計(jì)也越趨復(fù)雜。一個(gè)系統(tǒng)的設(shè)計(jì)往往不僅需要硬件設(shè)計(jì)人員的參與，也需要有軟件設(shè)計(jì)人員的參與。軟件設(shè)計(jì)人員與硬件設(shè)計(jì)人員之間的相互協(xié)調(diào)就變的格外重要，它直接關(guān)系到工作的效率以及整個(gè)系統(tǒng)設(shè)計(jì)的成敗。傳統(tǒng)的設(shè)計(jì)方法沒有使軟件設(shè)計(jì)工作與硬件設(shè)計(jì)工作協(xié)調(diào)一致，而是將兩者的工作割裂開來。軟件算法的設(shè)計(jì)人員在系統(tǒng)設(shè)計(jì)后期不能為硬件設(shè)計(jì)人員的設(shè)計(jì)提供任何的幫助。同時(shí)現(xiàn)在有些大規(guī)模集成電路設(shè)計(jì)中往往帶有DSP Core或其它CPU Core。這些都使得單
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基于ARM智能交通信號(hào)機(jī)控制板開發(fā)

信號(hào)機(jī)是一個(gè)典刑的嵌入式系統(tǒng)，嵌入式系統(tǒng)是以應(yīng)用為中心來設(shè)計(jì)，對(duì)功能、性能、可靠性、成本、功耗、體積等有嚴(yán)格的要求，既要滿足智能交通系統(tǒng)對(duì)信號(hào)機(jī)智能化、多功能的要求，又要最大化信號(hào)機(jī)的性價(jià)比，因此本設(shè)計(jì)選擇基于ARM核的32位嵌入式RISC處理器——AT91RM9200來完成智能交通信號(hào)機(jī)控制板的硬件設(shè)計(jì)，以達(dá)到使信號(hào)機(jī)在交通系統(tǒng)中成為收集與處理交通流量數(shù)據(jù)、通信聯(lián)網(wǎng)以及區(qū)域協(xié)調(diào)控制平臺(tái)的設(shè)計(jì)目標(biāo)。 1 引言 &
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基于DSP+FPGA結(jié)構(gòu)的小波圖像處理系統(tǒng)設(shè)計(jì)

介紹了一種基于DSP+FPGA結(jié)構(gòu)的小波圖像處理系統(tǒng)設(shè)計(jì)方案，以高性能數(shù)字信號(hào)處理器ADSP—BF535作為核心，結(jié)合現(xiàn)場(chǎng)可編程門陣列FPGA，實(shí)現(xiàn)了實(shí)時(shí)數(shù)字圖像處理。　　小波分析是近年迅速發(fā)展起來的新興學(xué)科，與Fourier分析和Gabor變換相比，小波變換是時(shí)間(空間)頻率的局部化分析，它通過伸縮平移運(yùn)算對(duì)信號(hào)逐步進(jìn)行多尺度細(xì)化，最終達(dá)到高頻處時(shí)間細(xì)分和低頻處頻率細(xì)分，能自動(dòng)適應(yīng)時(shí)頻信號(hào)分析的要求，從而可聚焦到信號(hào)的任意細(xì)節(jié)．解決了Fourier分
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