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Denso采用Cadence混合信號(hào)、低功耗解決方案
- 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)日前宣布，汽車零部件生產(chǎn)商Denso公司在改用了Cadence定制/模擬與數(shù)字流程之后，在低功耗混合信號(hào)IC設(shè)計(jì)方面實(shí)現(xiàn)了質(zhì)量與效率的大幅提升。將Cadence Encounter RTL-to-GDSII流程應(yīng)用于設(shè)計(jì)的數(shù)字部分之后，Denso表示比之前采用的流程減小了10%的面積，功耗降低了20% 。
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CADENCE PCB設(shè)計(jì)技術(shù)方案
- CADENCE PCB設(shè)計(jì)解決方案能為解決與實(shí)現(xiàn)高難度的與制造密切相關(guān)的設(shè)計(jì)提供完整的設(shè)計(jì)環(huán)境，該設(shè)計(jì)解決方案集成了從設(shè)計(jì)構(gòu)想至最終產(chǎn)品所需要的一切設(shè)計(jì)流程，包含設(shè)計(jì)輸入元件庫工具、PCB編輯器和一個(gè)自動(dòng)/交互連布線
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三星和Cadence發(fā)布20納米數(shù)字設(shè)計(jì)方法
- 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(納斯達(dá)克： CDNS) 日前宣布，三星電子與Cadence合作推出20納米設(shè)計(jì)方法，包含雙重圖形光刻(double patterning)技術(shù)，面向共同用戶的開發(fā)和內(nèi)部測(cè)試芯片。Cadence與三星的合作為移動(dòng)消費(fèi)電子產(chǎn)品帶來了新的工藝進(jìn)展，使得20納米及未來工藝節(jié)點(diǎn)設(shè)計(jì)成為可能。
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Cadence宣布已助力一款20納米測(cè)試芯片成功流片
- 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)，日前宣布其已助力STMicroelectronics的一款20納米測(cè)試芯片成功流片，采用定制模擬與數(shù)字方法學(xué)，實(shí)現(xiàn)20納米高級(jí)工藝節(jié)點(diǎn)的混合信號(hào)SoC設(shè)計(jì)。兩家公司的工程師緊密合作開發(fā)技術(shù)，使用含有Cadence Encounter和Virtuoso平臺(tái)的方法進(jìn)行設(shè)計(jì)、實(shí)現(xiàn)與簽核，以及開發(fā)基礎(chǔ)IP和一個(gè)面向20納米工藝的基于SKILL的工藝設(shè)計(jì)包(PDK)。
- 關(guān)鍵字： Cadence 20納米
Nufront第三代處理器采用Cadence接口IP解決方案
- 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司 (NASDAQ: CDNS)，日前宣布Nufront(新岸線)的NS115芯片組采用了Cadence可配置的DDR3/3L/LPDDR2存儲(chǔ)控制器與硬化PHY IP核，應(yīng)用于其雙核ARM Cortex –A9移動(dòng)應(yīng)用處理器。TSMC 40LP工藝， 32位DDR3/LPDDR2接口的數(shù)據(jù)傳輸速率最高可達(dá)800Mbps，并能提供對(duì)超薄筆記本、平板電腦和智能手機(jī)等產(chǎn)品至關(guān)重要的基于數(shù)據(jù)流量的自動(dòng)功耗管理。 Cadence 的DDR3/3L/LPDDR2 IP
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