在現代電子系統(tǒng)設計中,由于可編程邏輯器件的卓越性能、靈活方便的可升級特性,而得到了廣泛的應用。由于大規(guī)模高密度可編程邏輯器件多采用SRAM工藝,要求每次上電,對FPGA器件進行重配置,這就使得可以通過監(jiān)視配置
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保密性 問題 FPGA 工藝 SRAM 基于
美國空間數據系統(tǒng)咨詢委員會(簡稱CCSDS)于2005年推出一套適用于空間領域的圖像壓縮標準,標準使用了離散...
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小波變換 FPGA CCSDS圖像壓縮
ASIC、FPGA和DSP的應用領域呈現相互覆蓋的趨勢,使設計人員必須在軟件無線電結構設計中重新考慮器件選擇...
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FPGA ASIC DSP 軟件無線電
Modbus協(xié)議是一個應用廣泛的工業(yè)現場總線協(xié)議,鑒于其簡單、開放、幀格式緊湊等優(yōu)點,于2008年正式成為我國國家標準。介紹一種通過Cyclone系列FPGA實現Modbus RTU模式的方法,首先給出一個可以通用于Modbus主設備和從設備的協(xié)議接口單元,然后基于該接口設計了一個通用的Modbus從設備協(xié)處理器。實踐證明該方法能夠滿足工業(yè)環(huán)境的通訊要求,此外,該方法在其他FPGA上也具有一定通用性和推廣價值。
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實現 FPGA 協(xié)議 通信 Modbus 功率模塊
Altera公司今天發(fā)布Stratix® V系列FPGA,適用于支持Micron技術公司的下一代低延時DRAM (RLDRAM® 3存儲器)。Stratix V FPGA采用新的存儲器體系結構,降低延時,高效實現FPGA業(yè)界最好的系統(tǒng)性能。Stratix V FPGA為網絡設備生產商提供存儲器接口解決方案,支持在互聯(lián)網上迅速有效的傳送視頻、語音和數據。
Micron公司業(yè)務開發(fā)高級經理Bruce Franklin表示:“Micron的下一代RLDRAM 3存儲器專門設
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Altera FPGA Stratix
基于 CPLD EPM570T100C5的通用直流調速模塊設計,本文針對常見調速應用,采用可控硅做為調速元件,采用EPM570T100C5設計和實現了一個通用直流調速模塊,為實現遠距離控制內置了RS 485通信和簡單通信協(xié)議。采用EPM570T100C5作為控制核心,電路簡潔,輸出控制脈沖精確
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調速 模塊 設計 直流 通用 CPLD EPM570T100C5 基于
基于CPLD器件設計的單穩(wěn)態(tài)電路,隨著電子技術特別是數字集成電路技術的迅猛發(fā)展,市面上出現了FPGA、CPLD等大規(guī)模數字集成電路,并且其工作速度和產品質量不斷提高。利用大規(guī)模數字集成電路實現常規(guī)的單穩(wěn)態(tài)集成電路所實現的功能,容易滿足寬度、精
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穩(wěn)態(tài) 電路 設計 器件 CPLD 基于
基于CPLD的水下沖擊波記錄儀的設計,1.引言 隨著大規(guī)模集成電路和單片機的迅速發(fā)展,復雜可編程邏輯器件(CPLD)具有使用靈活、可靠性高、功能強大的優(yōu)點,在電子產品設計中得到了廣泛的應用。CPLD可實現在系統(tǒng)編程,重復多次,而且還兼容IEEE1
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記錄儀 設計 沖擊波 水下 CPLD 基于
節(jié)省電池能量的系統(tǒng)斷電電路CPLD,今天,大多數的CPLD(復雜可編程邏輯器件)都采用可減少功耗的工作模式,但當系統(tǒng)未使用時,應完全切斷電源以保存電池能量,從而實現很多設計者的終極節(jié)能目標。圖1描述了如何在一片CPLD 上增加幾只分立元件,實現一
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電路 CPLD 斷電 系統(tǒng) 電池 能量 節(jié)省
基于CPLD的專用鍵盤接口芯片的方案設計,在單片機應用系統(tǒng)中,存在多種形式的外部數據輸入接口界面,例如RS-232C串行通信、鍵盤輸入等[1,4] 。其中利用鍵盤接口輸入數據,是實現現場實時調試、數據調整和控制最常用的方法。單片機的外圍鍵盤擴展電路有多種實
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芯片 方案設計 接口 鍵盤 CPLD 專用 基于
ARM920T基于Linux平臺下的FPGA驅動開發(fā),Linux操作系統(tǒng)的全稱是GNU/Linux,它是由GNU工程和Linux內核兩個部分共同組成的一個操作系統(tǒng)。該系統(tǒng)中所有組件的源代碼都是自由的,可以有效保護學習成果,因而在嵌入式領域得到了廣泛的應用。 FPGA是英文Field
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驅動 開發(fā) FPGA 平臺 基于 Linux ARM920T
摘要:從實際工程應用出發(fā),研究了在基于FPGA上快速傅里葉變換實現線性卷積的方法,并搭建了一個基于Altera的EP2S60硬件處理平臺,利用Altera提供的FFT IP核,在100 MHz系統(tǒng)時鐘下,數據吞吐率可達100 Ms/s, 關鍵
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FPGA 線性卷積
摘要:CCSDS圖像數據壓縮標準中采用9/7整形離散小波變換為核心算法,該算法結構簡單,易于硬件設計實現。文中基于FPGA設計實現了9/7整數離散小波變換系統(tǒng),設計中使用內部RAM存儲方式,減小了對存儲器的需求量,同
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FPGA 離散小 波變換 系統(tǒng)設計
電子產品世界,為電子工程師提供全面的電子產品信息和行業(yè)解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
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軟件無線電 ASIC FPGA
Altera公司今天宣布,第二季度銷售達到4.693億美元,比2010年第一季度增長17%,比2009年第二季度增長68%。新產品銷售持續(xù)增長36%。2010年第二季度凈收入為1.806億美元,每股攤薄后收益0.58美元,與之相比,2010年第一季度凈收入為1.532億美元,每股攤薄后收益0.50美元,2009年第二季度凈收入達到0.474億美元,每股攤薄后收益為0.16美元。
本年度到目前為止,運營現金流為3.786億美元。Altera本季度末流動資金和短期投入達到21億美元。
Alte
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Altera 28nm FPGA
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