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基于CPLD的并口數(shù)據(jù)的采集和存儲(chǔ)
- 摘 要：提出了一種利用CPLD實(shí)現(xiàn)雷達(dá)并口數(shù)據(jù)的采集和存儲(chǔ)的方案。采用單片CPLD完成了以往需要大量外圍器件來(lái)完成的雷達(dá)并口數(shù)據(jù)收發(fā)及存儲(chǔ)功能，有效地減少了印制板上功能模塊的面積，減少了系統(tǒng)體積，提高了設(shè)計(jì)效率
- 關(guān)鍵字： CPLD 并口 數(shù)據(jù) 采集
基于CPLD技術(shù)的數(shù)字時(shí)序控制電路設(shè)計(jì)
- 1、引言 六自由度電磁敏感定位系統(tǒng)作為一種新型的跟蹤定位裝置，可實(shí)時(shí)地確定目標(biāo)的六個(gè)參數(shù),已在機(jī)載火控系統(tǒng)（頭盔瞄準(zhǔn)具）、精密醫(yī)療器械、單兵作戰(zhàn)模擬訓(xùn)練中獲得廣泛應(yīng)用[1、2]。該跟蹤系統(tǒng)由正弦信號(hào)發(fā)射電
- 關(guān)鍵字： 控制 電路設(shè)計(jì) 數(shù)字時(shí)序 技術(shù) CPLD 基于
利用FPGA的新功能保證視頻設(shè)計(jì)安全性
- 越來(lái)越多的消費(fèi)應(yīng)用開(kāi)始在設(shè)計(jì)中集成流式視頻，結(jié)果引入了許多標(biāo)準(zhǔn)和專有的加密算法。但是加密方案以及實(shí)現(xiàn)方法不統(tǒng)一導(dǎo)致視頻接收設(shè)備在設(shè)計(jì)和支持方面存在巨大的挑戰(zhàn)。DeviceDNA作為FPGA的一項(xiàng)新功能，可保證
- 關(guān)鍵字： FPGA 新功能 視頻 設(shè)計(jì)安全
基于FPGA和單片機(jī)的頻率監(jiān)測(cè)系統(tǒng)
- O．引言
本系統(tǒng)利用單片機(jī)和FPGA有效的結(jié)合起來(lái)共同實(shí)現(xiàn)等精度頻率測(cè)量和IDDS技術(shù)，發(fā)揮各自的優(yōu)點(diǎn)，使設(shè)計(jì)變得更加容易和靈活，并具有頻率測(cè)量范圍寬、產(chǎn)生的波形頻率分辨率高及精度大等特點(diǎn)。
系統(tǒng)方便靈 - 關(guān)鍵字： 監(jiān)測(cè) 系統(tǒng) 頻率 單片機(jī) FPGA 基于 FPGA 語(yǔ)音播報(bào) 頻率檢測(cè) 波形發(fā)生 單片機(jī) 信號(hào)發(fā)生器 濾波器 軟件
采用FPGA實(shí)現(xiàn)視頻監(jiān)視
- 目前，視頻監(jiān)視行業(yè)使用模擬CCTV攝像機(jī)和接口作為監(jiān)視系統(tǒng)的基礎(chǔ)設(shè)施。這些系統(tǒng)組成不容易擴(kuò)展，視頻分辨率低，信...
- 關(guān)鍵字： FPGA DVR 數(shù)字視頻攝錄機(jī)
先進(jìn)FPGA有助于信息包處理
- 初創(chuàng)公司Cswitch推出一種瞄準(zhǔn)網(wǎng)絡(luò)、無(wú)線基站和電信基礎(chǔ)設(shè)施應(yīng)用等信息包處理的新穎的可配置邏輯芯片。該器件由異質(zhì)陣列組成，這一陣列將一排排通用邏輯單元（與傳統(tǒng)FPGA中的非常類似）跟一排排可配置SRAM的RAM和CAM（內(nèi)容地址存儲(chǔ)器）模塊、ALU（算術(shù)邏輯單元）和專門用于信息包處理的模塊散布在一起。Cswitch公司總裁兼首席執(zhí)行官Doug Laird表示，其目的是滿足日益增長(zhǎng)的如下應(yīng)用：這類應(yīng)用必須以線速處理打包數(shù)據(jù)，而且要使用比傳統(tǒng)FP
- 關(guān)鍵字： FPGA 信息包處理 Cswitch CMOS
成功解決FPGA設(shè)計(jì)時(shí)序問(wèn)題的三大要點(diǎn)
- FPGA的設(shè)計(jì)與高速接口技術(shù)可以幫助你滿足今天的市場(chǎng)要求，但也提出了一些有趣的設(shè)計(jì)挑戰(zhàn)。為了確保存儲(chǔ)器接口的數(shù)據(jù)傳輸準(zhǔn)確，在超過(guò)200兆赫茲以上，進(jìn)行時(shí)序分析將發(fā)揮更突出的作用，以識(shí)別和解決系統(tǒng)運(yùn)行的問(wèn)題。在
- 關(guān)鍵字： FPGA 計(jì)時(shí)
采用FPGA實(shí)現(xiàn)音頻模數(shù)轉(zhuǎn)換器
- 摘 要 簡(jiǎn)要分析sigma―deIta(∑一△)架構(gòu)模數(shù)轉(zhuǎn)換器(ADC)原理，提出一種基于FPGA內(nèi)部LVDS(Low Voltage Differential Signaling)接收器的音頻ADC架構(gòu)，并給出在FPGA上的實(shí)現(xiàn)結(jié)果。在FPGA內(nèi)部實(shí)現(xiàn)音頻ADC，具有擴(kuò)展方便
- 關(guān)鍵字： FPGA 音頻 模數(shù)轉(zhuǎn)換器
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