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FPGA實戰(zhàn)演練邏輯篇：FPGA與CPLD
- 盡管很多人聽說過FPGA和CPLD，但是關(guān)于FPGA與CPLD之間的區(qū)別，了解的人可能不是很多。雖然FPGA與CPLD都是“可反復(fù)編程的邏輯器件”，但是在技術(shù)上卻有一些差異。簡單地說，F(xiàn)PGA就是將CPLD的電路規(guī)模、功能、性能等方面強化之后的產(chǎn)物。(特權(quán)同學(xué)版權(quán)所有) 一般而言， FPGA與CPLD之間的區(qū)別如表1.1所示。(特權(quán)同學(xué)版權(quán)所有) 表1.1 FPGA和CPLD的比較 ? 總而言之，F(xiàn)PGA和CPLD最大的區(qū)別是他們的存儲
- 關(guān)鍵字： FPGA CPLD
基于CPLD的光伏逆變器鎖相及保護(hù)電路設(shè)計
- 0 引言 在光伏并網(wǎng)系統(tǒng)的逆變器電路中，對電網(wǎng)電壓的鎖相是一項關(guān)鍵技術(shù)。由于電力系統(tǒng)在工作時會產(chǎn)生較大的電磁干擾，因此，其簡單的鎖相方法很容易受到干擾而失鎖，從而導(dǎo)致系統(tǒng)無法正常運行。在這種情況下，設(shè)計采用對電網(wǎng)電壓進(jìn)行過零檢測后再將信號送人CPLD，然后由CPLD實現(xiàn)對電網(wǎng)電壓進(jìn)行數(shù)字鎖相的方法，可以有效地防止相位因干擾而發(fā)生抖動或者失鎖的現(xiàn)象，保證系統(tǒng)的正常運行。另外，本系統(tǒng)還使用CPLD對DSP產(chǎn)生的PWM波控制信號和系統(tǒng)運行時的各項參數(shù)進(jìn)行監(jiān)控，一旦發(fā)現(xiàn)異常，立即使系統(tǒng)停機，并通知DSP
- 關(guān)鍵字： 濾波器 CPLD 光伏逆變器
基于DSP+CPLD的伺服控制卡的設(shè)計
- 0 引 言 隨著先進(jìn)制造技術(shù)的迅速發(fā)展，對運動控制的精度要求也越來越高，而運動伺服控制系統(tǒng)的性能很大程度上取決于伺服控制算法，通過運動控制與智能控制的融合，從改進(jìn)傳統(tǒng)的PID控制，到現(xiàn)代的最優(yōu)控制、自適應(yīng)控制、智能控制技術(shù)，應(yīng)用先進(jìn)的智能控制策略達(dá)到高質(zhì)量的運動控制效果，已經(jīng)成為當(dāng)前研究的一個熱點。 由于運動伺服控制系統(tǒng)中存在負(fù)載模型參數(shù)的變化，機械摩擦、電機飽和等非線性因素，造成受控對象的非線性和模型不確定性，使得需要依靠精確的數(shù)學(xué)模型，系統(tǒng)模型參數(shù)的常規(guī)PID控制很難獲得超高精度、快響
- 關(guān)鍵字： DSP CPLD
基于CPLD的編碼器解碼接口、PWM輸出方案及其在運動控制卡和伺服驅(qū)動器中的應(yīng)用
- 引言 在數(shù)控機床或其他數(shù)控設(shè)備中，往往都會用到光柵尺或編碼器等位置傳感部件，用以來測量機械運動部件的實際運動位置及速度信息。那么光柵尺或編碼器測量到的數(shù)值，就需要專門的接收部件來處理。一般的編碼器輸出的信號是AB(或ABZ)相正交編碼信號，之所以這樣編碼也是為了將方向信息加入碼流，同時也有利抗干擾等方面的處理。因此在接收這個信號時就需要專門的解碼接口電路，將所得的數(shù)據(jù)也就是實際運動位置/位置信息傳遞給處理單元，或通過總線(比如PCI)傳遞給數(shù)控設(shè)備的中央控制系統(tǒng)中，讓控制系統(tǒng)的軟硬件根據(jù)測來的實
- 關(guān)鍵字： PWM CPLD
基于AT89S52和CPLD的數(shù)字轉(zhuǎn)速表設(shè)計
- 介紹了以89S52單片機和復(fù)雜可編程邏輯器件(CPLD)為核心的數(shù)字轉(zhuǎn)速表的設(shè)計。采用CPLD來實現(xiàn)轉(zhuǎn)速、周期、脈寬和占空比的測量計數(shù)，單片機完成測試控制、數(shù)據(jù)處理和顯示輸出。同時，運用等精度的設(shè)計方法，克服了基于傳統(tǒng)測速原理轉(zhuǎn)速表的測量精度隨被測轉(zhuǎn)速的下降而降低的缺點。實驗結(jié)果表明，所設(shè)計的數(shù)字轉(zhuǎn)速表性能穩(wěn)定，測量精度高。 基于單片機和CPLD的數(shù)字轉(zhuǎn)速表設(shè)計
- 關(guān)鍵字： AT89S52 CPLD
基于AT89S52和CPLD的自動巡線輪式機器人控制系統(tǒng)
- 1 引言 輪式移動機器人是機器人研究領(lǐng)域的一項重要內(nèi)容.它集機械、電子、檢測技術(shù)與智能控制于一體。在各種移動機構(gòu)中，輪式移動機構(gòu)最為常見。輪式移動機構(gòu)之所以得到廣泛的應(yīng)用。主要是因為容易控制其移動速度和移動方向。因此.有必要研制一套完整的輪式機器人系統(tǒng)。并進(jìn)行相應(yīng)的運動規(guī)劃和控制算法研究。筆者設(shè)計和開發(fā)了基于5l型單片機的自動巡線輪式機器人控制系統(tǒng)。 2 控制系統(tǒng)總體設(shè)計 機器人控制系統(tǒng)由主控制電路模塊、存儲器模塊、光電檢測模塊、電機及舵機驅(qū)動模塊等部分組成，控制系統(tǒng)的框圖如圖1所示
- 關(guān)鍵字： AT89S52 CPLD
FPGA是什么？
- 導(dǎo)讀：本文系統(tǒng)講解了FPGA是什么及其結(jié)構(gòu)、原理、生產(chǎn)廠家等內(nèi)容，敬請閱讀～～ 一、FPGA是什么- -簡介 FPGA，是Field Programmable Gate Array的簡稱，中文名稱為現(xiàn)場可編程門陣列，是一種可編程器件，是在PAL(可編程邏輯陣列)、GAL(通用陣列邏輯)、CPLD(復(fù)雜可編程邏輯器件)等傳統(tǒng)邏輯電路和門陣列的基礎(chǔ)上發(fā)展起來的一種半定制電路，主要應(yīng)用于ASIC(專用集成電路)領(lǐng)域，既解決了半定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。 二、FP
- 關(guān)鍵字： FPGA CPLD FPGA是什么
基于CPLD技術(shù)的看門狗電路設(shè)計
- 隨著現(xiàn)代電子技術(shù)的發(fā)展，帶有各種微處理的現(xiàn)代電子設(shè)備已廣泛應(yīng)用于國民生產(chǎn)的各行各業(yè)中。但隨著設(shè)備功能越來越強大，程序結(jié)構(gòu)越來越復(fù)雜，指令代碼越來越長，加之現(xiàn)場工作環(huán)境的干擾，設(shè)備失控，程序“走飛”，各功能模塊“死機”的概率也同樣成倍地增加。對此，常見的解決方法是在電路設(shè)計時放置一片硬件看門狗(Watchdog)電路，其目的是在系統(tǒng)“走死”后能強制系統(tǒng)復(fù)位并返回初始化程序。隨著CPLD器件被廣泛應(yīng)用于各種儀器、儀表設(shè)備的設(shè)計中，而且
- 關(guān)鍵字： CPLD 看門狗
基于CPLD的系統(tǒng)硬件看門狗設(shè)計
- 引言 在以單片機、DSP等處理器為核心的數(shù)字系統(tǒng)中，看門狗是不可缺少的一部分，特別是在對可靠性要求極高的系統(tǒng)中，如箭上伺服控制器，由于箭體內(nèi)強弱電交叉使用，或者地面測試環(huán)境復(fù)雜多變，會產(chǎn)生諸多干擾和輻射。它們的沖擊會使CPU在執(zhí)行指令時的地址碼或操作碼發(fā)生變化，甚至將操作數(shù)作為操作碼執(zhí)行，導(dǎo)致程序跑飛。為使系統(tǒng)在規(guī)定時間內(nèi)重新正常工作，一種有效的措施是采用硬件看門狗技術(shù)。 本設(shè)計的最初思路來源：實現(xiàn)高可靠性數(shù)字伺服控制器軟、硬件看門狗的雙冗余設(shè)計要求，目前缺少軍品級國產(chǎn)化硬件看門狗器件，在
- 關(guān)鍵字： CPLD DSP
基于SPCE061A和CPLD的電動自行車充電系統(tǒng)研制
- 電動車由于具有無廢氣污染、無噪音、輕便美觀等特點，受到眾多使用者的青睞。但使用中也暴露出它的局限性，那就是蓄電池的容量決定了它的使用范圍，而且存在充電時間長的缺點。目前隨著電動自行車的發(fā)展，急需解決的問題就是如何實現(xiàn)快速靈活的充電。 隨著電子技術(shù)、可編程邏輯器件(FPGA,CPLD)、EDA技術(shù)的飛速發(fā)展，基于硬件編程語言的自上而下(TOP-TO-DOWN)設(shè)計方法給數(shù)字系統(tǒng)的開發(fā)設(shè)計帶來了革命性變革，僅使用單片機來實現(xiàn)系統(tǒng)控制的傳統(tǒng)方法正在被越來越多的以MCU+FPGA/CPLD為核心的最新設(shè)
- 關(guān)鍵字： SPCE061A CPLD
數(shù)字電視機頂盒設(shè)計方案、技術(shù)文獻(xiàn)集錦
- “數(shù)字電視機頂盒”，它是一種將數(shù)字電視信號轉(zhuǎn)換成模擬信號的變換設(shè)備，它對經(jīng)過數(shù)字化壓縮的圖像和聲音信號進(jìn)行解碼還原，產(chǎn)生模擬的視頻和聲音信號，通過電視顯示器和音響設(shè)備給觀眾提供高質(zhì)量的電視節(jié)目。它采用了兼容的辦法，在中國一直延續(xù)到現(xiàn)在。本文介紹了幾種數(shù)字電視機頂盒的設(shè)計和使用，供大家參考。 數(shù)字電視機頂盒導(dǎo)航式操作系統(tǒng)設(shè)計方案 本文對機頂盒各項業(yè)務(wù)和操作功能進(jìn)行模塊化細(xì)分歸類，借鑒目前主流消費電子產(chǎn)品操作系統(tǒng)的模式，采用導(dǎo)航式操作系統(tǒng)，在主菜單上使用M×
- 關(guān)鍵字： SDRAM CPLD
有關(guān)FPGA設(shè)計開發(fā)軟件ISE的使用技巧、技術(shù)文獻(xiàn)匯總
- ISE是使用XILINX的FPGA的必備的設(shè)計工具。它可以完成FPGA開發(fā)的全部流程，包括設(shè)計輸入、仿真、綜合、布局布線、生成BIT文件、配置以及在線調(diào)試等，功能非常強大。本文為您提供有關(guān)ISE的相關(guān)技術(shù)文獻(xiàn)，相信讀完之后一定會使您對ISE有一個更深刻的了解。 FPGA設(shè)計開發(fā)軟件ISE使用技巧之：ISE軟件簡介 ISE是集成綜合環(huán)境的縮寫，它是Xillinx FPGA/CPLD的綜合性集成設(shè)計平臺，該平臺集成了設(shè)計、輸入、仿真、邏輯綜合、布局布線與實現(xiàn)、時序分板、芯片下載與配置、功率分析
- 關(guān)鍵字： Xillinx CPLD
CPLD對FPGA從并快速加載的解決方案
- 現(xiàn)場可編程門陣列(FPGA)作為專用集成電路(ASIC)領(lǐng)域的一種半定制電路，可以根據(jù)設(shè)計的需要靈活實現(xiàn)各種接口或者總線的輸出，在設(shè)備端的通信產(chǎn)品中已得到越來越廣泛的使用。FPGA是基于靜態(tài)隨機存儲器(SRAM)結(jié)構(gòu)的，斷電后程序丟失后的每次上電都需要重新加載程序。且隨著FPGA規(guī)模的升級，加載程序的容量也越來越大，如Xilinx公司的Spartan - 6系列中的6SLX150T，其加載容量最大可以達(dá)到4.125 MB. 1 FPGA常用配置方式 FPGA的配置數(shù)據(jù)通常存放在系統(tǒng)中的存儲
- 關(guān)鍵字： CPLD FPGA modelsim
基于CPLD和接觸式圖像傳感器的圖像采集系統(tǒng)
- 接觸式圖像傳感器CIS( CONTACT Image SENSOR )是繼CCD之后于20世紀(jì)90年代研究和開發(fā)的一種新型光電耦合器件[1]。它將光電傳感陣列、LED光源陣列、柱狀透鏡陣列、移位寄存器和模擬開關(guān)等集成在一個條狀方形盒內(nèi)，其工作原理與CCD較為相似，但與CCD相比，CIS具有體積小、價格低、結(jié)構(gòu)簡單、安裝方便等優(yōu)點，目前在傳真機、掃描儀及條碼*器等領(lǐng)域可完全取代CCD圖像傳感器。 本文介紹一種基于復(fù)雜可編程邏輯器件CPLD(Complex Programmable LOGIC DE
- 關(guān)鍵字： CPLD DSP 圖像傳感器
基于CPLD技術(shù)的CMOS圖像傳感器高速采集系統(tǒng)
- 在當(dāng)前圖像傳感器市場，CMOS傳感器以其低廉的價格得到越來越多消費者的青睞。在目前的應(yīng)用中，多數(shù)采用軟件進(jìn)行數(shù)據(jù)的讀取，但是這樣無疑會浪費指令周期，并且對于高速器件，采用軟件讀取在程序設(shè)計上、在時間配合上有一定的難度。因此，為了采集數(shù)據(jù)量大的圖像信號，本文設(shè)計一個以CPLD為核心的圖像采集系統(tǒng)，實現(xiàn)了對OV7110CMOS圖像傳感器的高速讀取，其讀取速率可達(dá)8 Mb/s。 1、硬件電路方案 圖1為基于CPLD的OV7110CMOS圖像傳感器的高速數(shù)據(jù)采集系統(tǒng)原理框圖，他主要由2個部分組成：
- 關(guān)鍵字： CPLD CMOS OV7110
cpld-pci接口介紹
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