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基于關(guān)鍵幀提取技術(shù)的網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng)
- 基于關(guān)鍵幀提取技術(shù)的網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng), 應(yīng)用背景由于寬帶網(wǎng)絡(luò)近年來(lái)在世界各地的高速發(fā)展,高品質(zhì)的音視頻壓縮技術(shù)不斷推陳出新,更高的壓縮比率加上更寬的帶寬,使得互聯(lián)網(wǎng)用戶在互聯(lián)網(wǎng)上觀看高品質(zhì)電視節(jié)目的愿望不再是幻想。美國(guó)、意大利、法國(guó)、加拿大
- 關(guān)鍵字: 網(wǎng)絡(luò)視頻監(jiān)控 關(guān)鍵幀 提取技術(shù) 寬帶網(wǎng)絡(luò) FPGA
保證嵌入式系統(tǒng)程序完整性的技術(shù)設(shè)計(jì)方案
- 保證嵌入式系統(tǒng)程序完整性的技術(shù)設(shè)計(jì)方案, 1 項(xiàng)目背景信息產(chǎn)業(yè)的高速發(fā)展,帶來(lái)了信息技術(shù)的空前繁榮;但危害信息安全的事件也不斷發(fā)生,信息安全的形勢(shì)是嚴(yán)峻的. 信息安全事關(guān)國(guó)家安全,事關(guān)社會(huì)穩(wěn)定,必須采取措施確保信息安全. 硬件結(jié)構(gòu)的安全和操作系統(tǒng)的安全
- 關(guān)鍵字: FPGA TCM 嵌入式系統(tǒng) 完整保證技術(shù)
FPGA實(shí)戰(zhàn)演練邏輯篇3:FPGA與CPLD
- 盡管很多人聽(tīng)說(shuō)過(guò)FPGA和CPLD,但是關(guān)于FPGA與CPLD之間的區(qū)別,了解的人可能不是很多。雖然FPGA與CPLD都是“可反復(fù)編程的邏輯器件”,但是在技術(shù)上
- 關(guān)鍵字: FPGA 實(shí)戰(zhàn)演練 CPLD
NAND flash和NOR flash的區(qū)別詳解
- 我們使用的智能手機(jī)除了有一個(gè)可用的空間(如蘋(píng)果8G、16G等),還有一個(gè)RAM容量,很多人都不是很清楚,為什么需要二個(gè)這樣的芯片做存儲(chǔ)呢,這就是我
- 關(guān)鍵字: NOR flash Nand flash FlaSh
嵌入式高速固態(tài)存儲(chǔ)器的組成原理與設(shè)計(jì)實(shí)現(xiàn)
- 信息化時(shí)代的到來(lái),使得信息和數(shù)據(jù)成為推動(dòng)社會(huì)發(fā)展的主要因素,對(duì)于數(shù)據(jù)的處理提出了更高的要求。為了適應(yīng)時(shí)代發(fā)展的需求,現(xiàn)代數(shù)據(jù)信息處理
- 關(guān)鍵字: 固態(tài)存儲(chǔ)器 嵌入式 FPGA
DSP硬件設(shè)計(jì)需要知道的注意事項(xiàng)
- 數(shù)字信號(hào)處理芯片(DSP) 具有高性能的CPU(時(shí)鐘性能超過(guò)100MHZ)和高速先進(jìn)外圍設(shè)備,通過(guò)CMOS處理技術(shù),DSP芯片的功耗越來(lái)越低。這些巨大的進(jìn)步增加了DSP
- 關(guān)鍵字: 硬件設(shè)計(jì) FlaSh DSP
一種FPGA單粒子軟錯(cuò)誤檢測(cè)電路設(shè)計(jì)
- 摘要:分析了FPGA器件發(fā)生單粒子效應(yīng)的空間分布特性,設(shè)計(jì)并實(shí)現(xiàn)了一種面向FPGA單粒子軟錯(cuò)誤的檢測(cè)電路。將該電路放置在FPCA待檢測(cè)電路的附近,利
- 關(guān)鍵字: FPGA 空間分布特性 單粒子效應(yīng) 軟錯(cuò)誤 檢測(cè)電路
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