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采用Xilinx 和FPGA的DDR2 SDRAM存儲(chǔ)器接口控制器的設(shè)計(jì)
- 采用Xilinx 和FPGA的DDR2 SDRAM存儲(chǔ)器接口控制器的設(shè)計(jì),本白皮書(shū)討論各種存儲(chǔ)器接口控制器設(shè)計(jì)所面臨的挑戰(zhàn)和 Xilinx 的解決方案，同時(shí)也說(shuō)明如何使用 Xilinx軟件工具和經(jīng)過(guò)硬件驗(yàn)證的參考設(shè)計(jì)來(lái)為您自己的應(yīng)用(從低成本的 DDR SDRAM 應(yīng)用到像 667 Mb/sDDR2 SDRAM 這樣的更
- 關(guān)鍵字： 接口 控制器 設(shè)計(jì) 存儲(chǔ)器 SDRAM Xilinx FPGA DDR2 采用
基于單片機(jī)與FPGA可調(diào)延時(shí)模塊的設(shè)計(jì)
- 系統(tǒng)結(jié)構(gòu)框圖如圖1。其硬件結(jié)構(gòu)比較簡(jiǎn)單，主要由單片機(jī)P89C51RD、RS-232/TTL接口電路MAX232和可編程邏輯器件FPGA三部分組成。單片機(jī)P89C51RD2是上位PC機(jī)和FPGA的連接紐帶，它通過(guò)并口發(fā)送數(shù)據(jù)給FPGA，另一邊通過(guò)RS-2
- 關(guān)鍵字： FPGA 單片機(jī) 可調(diào)延時(shí)模塊
FPGA驅(qū)動(dòng)LED靜態(tài)顯示和動(dòng)態(tài)顯示的VHDL程序
- 例1：FPGA驅(qū)動(dòng)LED靜態(tài)顯示 --文件名：decoder.vhd --功能：譯碼輸出模塊，LED為共陽(yáng)接法 --最后修改日期：2004.3.24 library IEEE; use IEEE.STD_LOGIC_1164.ALL; use IEEE.STD_LOGIC_ARITH.ALL;
- 關(guān)鍵字： FPGA VHDL LED 驅(qū)動(dòng)
一種基于FPGA的UART 電路實(shí)現(xiàn)
- 1 引 言 UART 即通用異步收發(fā)器，他廣泛使用串行數(shù)據(jù)傳輸協(xié)議。UART 功能包括微處理器接口、用于數(shù)據(jù)傳輸?shù)木彌_器（Buffer）、幀產(chǎn)生、奇偶校驗(yàn)、并串轉(zhuǎn)換，用于數(shù)據(jù)接收的緩沖器、幀產(chǎn)生、奇偶校驗(yàn)、串并轉(zhuǎn)換等。
- 關(guān)鍵字： FPGA UART 電路實(shí)現(xiàn)
基于FPGA開(kāi)發(fā)靜態(tài)無(wú)功補(bǔ)償控制器
- “我們?cè)贜I CompactRIO平臺(tái)上開(kāi)發(fā)的SVC全數(shù)字控制系統(tǒng)，大大縮短了產(chǎn)品上市的時(shí)間又保證了系統(tǒng)的穩(wěn)定性。”挑戰(zhàn)：電弧爐、軋鋼機(jī)等大型工業(yè)設(shè)備在為企業(yè)創(chuàng)造產(chǎn)值的同時(shí)也帶來(lái)了無(wú)功分量和高次諧波等危害，
- 關(guān)鍵字： FPGA 無(wú)功補(bǔ)償 控制器
基于FPGA的LVDS高速數(shù)據(jù)通信卡設(shè)計(jì)
- 摘要 基于FPGA、PCI9054、SDRAM和DDS設(shè)計(jì)了用于某遙測(cè)信號(hào)模擬源的專(zhuān)用板卡。PCI9054實(shí)現(xiàn)與上位機(jī)的數(shù)據(jù)交互，F(xiàn)PGA實(shí)現(xiàn)PCI本地接口轉(zhuǎn)換、數(shù)據(jù)接收發(fā)送控制及DDS芯片的配置。通過(guò)WDM驅(qū)動(dòng)程序設(shè)計(jì)及MFC交互界面設(shè)計(jì)，最
- 關(guān)鍵字： 數(shù)據(jù)通信 設(shè)計(jì) 高速 LVDS FPGA
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