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FPGA的高速多通道數(shù)據(jù)采集控制器IP核設(shè)計(jì)
- FPGA的高速多通道數(shù)據(jù)采集控制器IP核設(shè)計(jì),隨著可編程邏輯器件的不斷進(jìn)步和發(fā)展，F(xiàn)PGA在嵌入式系統(tǒng)中發(fā)揮著越來(lái)越重要的作用。本文介紹的在電能質(zhì)量監(jiān)測(cè)系統(tǒng)中信號(hào)采集模塊控制器的 IP核，是采用硬件描述語(yǔ)言來(lái)實(shí)現(xiàn)的。首先它是以ADS8364芯片為控制對(duì)象，結(jié)合
- 關(guān)鍵字： IP 設(shè)計(jì) 控制器 數(shù)據(jù)采集 高速 通道 FPGA
用VHDL/VerilogHD語(yǔ)言開(kāi)發(fā)PLD/FPGA的完整流程
- 用VHDL/VerilogHD語(yǔ)言開(kāi)發(fā)PLD/FPGA的完整流程,用VHDL/VerilogHD語(yǔ)言開(kāi)發(fā)PLD/FPGA的完整流程為： 1.文本編輯：用任何文本編輯器都可以進(jìn)行，也可以用專用的HDL編輯環(huán)境。通常VHDL文件保存為.vhd文件，Verilog文件保存為.v文件 2.功能仿真：將文件調(diào)入HDL仿真
- 關(guān)鍵字： 完整 流程 PLD/FPGA 開(kāi)發(fā) 語(yǔ)言 VHDL/VerilogHD
基于FPGA的LED電視動(dòng)態(tài)背光系統(tǒng)設(shè)計(jì)
- 基于FPGA的LED電視動(dòng)態(tài)背光系統(tǒng)設(shè)計(jì),本文設(shè)計(jì)一款基于FPGA(現(xiàn)場(chǎng)可編程門(mén)陣列)的液晶電視動(dòng)態(tài)背光系統(tǒng)，采用LED側(cè)背光方式，符合當(dāng)前液晶電視LED背光應(yīng)用主流?！ ‰娨晞?dòng)態(tài)背光 以往的電視機(jī)主板將圖像信號(hào)通過(guò)LVDS(LowVoltageDifferentialSignal，低
- 關(guān)鍵字： 背光 系統(tǒng) 設(shè)計(jì) 動(dòng)態(tài) 電視 FPGA LED 基于
基于FPGA的實(shí)時(shí)數(shù)字化光纖傳輸系統(tǒng)
- 摘要 提出一種實(shí)時(shí)數(shù)字化光纖傳輸系統(tǒng)，該系統(tǒng)分為發(fā)送端和接收端。發(fā)送端用A／D轉(zhuǎn)換器將輸入的模擬信號(hào)數(shù)字化，再用FPGA對(duì)數(shù)據(jù)進(jìn)行處理，并通過(guò)光纖傳輸。同時(shí)，F(xiàn)PGA還控制A／D轉(zhuǎn)換器的工作。接收端用串行收發(fā)器TLK
- 關(guān)鍵字： FPGA 實(shí)時(shí)數(shù)字 光纖傳輸 系統(tǒng)
開(kāi)關(guān)磁阻電機(jī)全數(shù)字控制系統(tǒng)中FPGA的應(yīng)用
- 摘要：提出了基于數(shù)字信號(hào)處理器(DSP)和現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)的開(kāi)關(guān)磁阻電動(dòng)機(jī)全數(shù)字控制系統(tǒng)，對(duì)DSP和FPGA的功能進(jìn)行了分配。根據(jù)開(kāi)關(guān)磁阻電動(dòng)機(jī)的驅(qū)動(dòng)要求，分析控制邏輯，由FPGA實(shí)現(xiàn)了電流斬波、角度位置和PWM電
- 關(guān)鍵字： FPGA 開(kāi)關(guān)磁阻電機(jī) 全數(shù)字 控制系統(tǒng)
如何用FPGA構(gòu)建更出色的DC/DC調(diào)節(jié)器
- 摘要：設(shè)計(jì)人員此前一直使用模擬元件來(lái)構(gòu)建開(kāi)關(guān)模式DC/DC轉(zhuǎn)換器(定制型IC、運(yùn)算放大器、電阻、電容等)，控制反饋回路，并生成開(kāi)關(guān)所需的脈寬調(diào)制。使用這種模擬元件時(shí)，我們必須考慮一系列因素，包括容差、電氣應(yīng)力、老化漂移以及溫度漂移，這樣才能確保設(shè)計(jì)方案的穩(wěn)定性?，F(xiàn)在，我們擁有低成本低功耗FPGA以及模數(shù)轉(zhuǎn)換器，使得FPGA能夠取代傳統(tǒng)的模擬設(shè)計(jì)方法。
- 關(guān)鍵字： DC/DC FPGA 轉(zhuǎn)換器 201205
一種矢量信號(hào)發(fā)生器設(shè)計(jì)與實(shí)現(xiàn)
- 摘要：充分利用DDR2 SDRAM速度快、FLASH掉電不消失、MATLAB/Simulink易產(chǎn)生矢量信號(hào)的特點(diǎn)，以FPGA為邏輯時(shí)序控制器，設(shè)計(jì)并實(shí)現(xiàn)了一種靈活、簡(jiǎn)單、低成本的矢量信號(hào)發(fā)生器。本文以產(chǎn)生3載波WCDMA為例，詳細(xì)介紹了矢量信號(hào)發(fā)生器的設(shè)計(jì)方案與實(shí)現(xiàn)過(guò)程，使用Verilog HDL描述并實(shí)現(xiàn)了DDR2 SDRAM的時(shí)序控制和FPGA的邏輯控制。
- 關(guān)鍵字： DDR2 SDRAM FLASH 201205
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