摘要:為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設定不當帶來的數據不連續(xù)問題,結合LabVIEWFPGA的編程特點和DMA FIFO的工作原理,提出了一種設定FIFO深度的方法。對FIFO不同深度的實驗表明,采用該方法設定的FIFO深
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LabVIEW FPGA 模塊 傳輸
摘要:針對高速高靈敏度數字信號處理時對于自適應濾波器的數值特性和實時性的要求,在一種自適應格型聯(lián)合濾波器的基礎上提出算法改進,采用馳豫超前流水線技術和時序重構技術,在損失較小濾波性能的情況下,在FPGA中
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FPGA 濾波器
系統(tǒng)的比較,與大家共享:盡管FPGA和CPLD都是可編程ASIC器件,有很多共同特點,但由于CPLD和FPGA結構上的差異,具有各自的特點:①CPLD更適 ...
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cpld fpga
直方圖對數字數據的分析通常是一種有用的工具。不過,要從一個直方圖獲得可靠的結果,必須獲得大量數據,通常是要...
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FPGA
由于FPGA的功能日益強大,開發(fā)周期短、可重復編程等優(yōu)點也越來越明顯,可以在FPGA芯片上集成UART功能模塊,從...
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FPGA UART接口
基于FPGA的UART接口模塊設計,UART(UniversalAnynchronousReceiverTransmitter,通用異步接收發(fā)送器)是廣泛應用的串行數據傳輸協(xié)議之一,其應用范圍遍及計算機外設、工控自動化等場合。雖然USB傳輸協(xié)議比UART協(xié)議有更高的性能,但電路復雜開發(fā)難
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模塊 設計 接口 UART FPGA 基于
摘要:誤碼測試儀是檢測通信系統(tǒng)可靠性的重要設備。傳統(tǒng)的誤碼測試儀基于CPLD和CPU協(xié)同工作,不僅結構復雜,價格昂貴,而且不方便攜帶?;贔PGA的高速誤碼測試儀,采用FPGA來完成控制和測試模塊的一體化設計,提高了
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FPGA 誤碼測試 儀的設計
摘要:目前FIR濾波器的一般設計方法比較繁瑣,開發(fā)周期長,如果采用設計好的FIR濾波器的IP核,則開發(fā)效率大為提高。本方案基于Altera公司的CycloneⅡ系列芯片EP2C8Q208C8N,首先利用MATLAB中的濾波器函數fir2得出需產
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FPGA FIR 濾波器 性能
摘要:針對信號發(fā)生器時輸出頻率精度高和幅值可調的要求,采用直接數字頻率合成(DDS)技術,提出一種基于FPGA的幅值、頻率均可調的、高分辨率、高穩(wěn)定度的信號發(fā)生器設計方案。采用AT89S52單片機為控制器,控制FPGA產
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FPGA 幅值 信號發(fā)生器
摘要:介紹了QDPSK信號的優(yōu)點,并分析了其實現(xiàn)原理,提出一種QDPSK高性能數字調制器的FPGA實現(xiàn)方案。采用自頂向下的設計思想,將系統(tǒng)分成串/并變換器、差分編碼器、邏輯選相電路、四相載波發(fā)生器等4大模塊,用原理圖
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QDPSK FPGA 調制器
紅外目標識別跟蹤系統(tǒng)的DSP+FPGA實現(xiàn),現(xiàn)場可編程門陣列(FPGA)是在專用ASIC的基礎上發(fā)展出來的,它克服了專用ASIC不夠靈活的缺點。與其他中小規(guī)模集成電路相比,其優(yōu)點主要在于它有很強的靈活性,即其內部的具體邏輯功能可以根據需要配置,對電路的修改和
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DSP FPGA 實現(xiàn) 系統(tǒng) 跟蹤 目標 識別 紅外
FPGA實現(xiàn)OFDM水聲通信系統(tǒng)定時同步,引 言 正交頻分復用(Orthogonal Frequency Division Multiplexing,OFDM)技術是一種多載波調制技術,它將寬帶信道分解為相互正交的一組窄帶子信道,利用各個子信道進行并行數據傳輸,因此其頻譜利用率高、抗多徑衰
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系統(tǒng) 定時 同步 通信 水聲 實現(xiàn) OFDM FPGA
S2C 日前宣布其Verification Module技術(專利申請中)已可用于其基于Xilinx的FPGA原型驗證系統(tǒng)中。V6 TAI Verification Module可以實現(xiàn)在FPGA原型驗證環(huán)境和用戶驗證環(huán)境之間高速海量數據傳輸。用戶可以使用Xilinx ChipScope或者第三方調試環(huán)境,同時查看4個FPGA。另外,V6 TAI Verification Module還可以用于1.3M~4.7M ASIC門的原型設計。V6 TAI Verification Module具有PCIe G
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S2C Xilinx FPGA
引 言數字相關器作為軟件無線電的典型應用,在擴頻通信中成為必不可少的技術。在傳統(tǒng)的擴頻通信中,采用模擬器件(如:聲表面波器) 來實現(xiàn)解擴單元,而用數字相關器可以增加系統(tǒng)的靈活性和穩(wěn)定性,因此,對數字相關器
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相關 數字 實現(xiàn) FPGA DSP
基于FPGA的混合信號驗證流程,隨著SoC設計上的混合信號組件數量增加了,基本的功能驗證對于硅初期能否成功也愈來愈重要。FPGA在系統(tǒng)整合難題上加入了一個新特點。在核心上,此新范例-可編程系統(tǒng)單芯片(programmable system chip,PSC)整合FPGA電閘
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驗證 流程 信號 混合 FPGA 基于
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