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          基于FPGA 的ATM SAR 及其接口設(shè)計(jì)與實(shí)現(xiàn)

          • 摘要:本文針對(duì)AAL5業(yè)務(wù),采用FPGA實(shí)現(xiàn)了AAL層中SAR子層功能和ATM層功能,向下提供UTOPIA主接口與物理層從接口...
          • 關(guān)鍵字: FPGA  ATM  SAR  

          Xilinx助力有線電視運(yùn)營商打造面向未來的前端系統(tǒng)

          • 全球可編程平臺(tái)領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. )在 2011 年 SCTE 有線電視技術(shù)博覽會(huì) (SCTE Cable-Tec Expo 2011)上演示了有線電視行業(yè)第一個(gè)用單個(gè) RF 端口支持多達(dá) 160 個(gè)正交幅度調(diào)制 (QAM )信道的方案,該方案是在基于賽靈思 28nm 7 系列 FPGA上實(shí)現(xiàn)的。該技術(shù)對(duì)多系統(tǒng)運(yùn)營商 (MSO) 通過現(xiàn)有有線電視前端系統(tǒng)提供更豐富的三重播放業(yè)務(wù)至關(guān)重要,同時(shí)也展示了基于 FPGA 的前端設(shè)備可以提供關(guān)鍵的器件和信號(hào)密度,滿足競爭激烈的數(shù)據(jù)和內(nèi)容
          • 關(guān)鍵字: Xilinx  FPGA  RF  

          Altera發(fā)布業(yè)界第一個(gè)面向FPGA的OpenCL計(jì)劃

          •   Altera公司(NASDAQ: ALTR)今天發(fā)布FPGA和SoC FPGA的開放計(jì)算語言(OpenCL?)標(biāo)準(zhǔn)開發(fā)計(jì)劃。OpenCL標(biāo)準(zhǔn)是基于C語言的開放標(biāo)準(zhǔn),適用于并行編程。Altera的OpenCL計(jì)劃結(jié)合了FPGA的并行能力以及OpenCL標(biāo)準(zhǔn),實(shí)現(xiàn)強(qiáng)大的系統(tǒng)加速功能。與使用Verilog或者VHDL等底層硬件描述語言(HDL)的傳統(tǒng)FPGA開發(fā)方法相比,這一混合系統(tǒng)(CPU + FPGA,使用OpenCL標(biāo)準(zhǔn))還具有明顯的產(chǎn)品及時(shí)面市優(yōu)勢。通過其OpenCL計(jì)劃,Altera與
          • 關(guān)鍵字: Altera  FPGA  

          基于51單片機(jī)和FPGA 的人機(jī)交互系統(tǒng)的設(shè)計(jì)

          • 摘要: 在儀器儀表電路中,人機(jī)交互界面是必不可少的環(huán)節(jié)。為了解決單純采用單片機(jī)制作的系統(tǒng)功耗高、速度慢、 ...
          • 關(guān)鍵字: 51單片機(jī)  FPGA  人機(jī)交互系統(tǒng)  

          Altera發(fā)布業(yè)界第一個(gè)面向FPGA的OpenCL計(jì)劃

          • Altera公司今天發(fā)布FPGA和SoC FPGA的開放計(jì)算語言(OpenCL?)標(biāo)準(zhǔn)開發(fā)計(jì)劃。OpenCL標(biāo)準(zhǔn)是基于C語言的開放標(biāo)準(zhǔn),適用于并行編程。Altera的OpenCL計(jì)劃結(jié)合了FPGA的并行能力以及OpenCL標(biāo)準(zhǔn),實(shí)現(xiàn)強(qiáng)大的系統(tǒng)加速功能。與使用Verilog或者VHDL等底層硬件描述語言(HDL)的傳統(tǒng)FPGA開發(fā)方法相比,這一混合系統(tǒng)(CPU + FPGA,使用OpenCL標(biāo)準(zhǔn))還具有明顯的產(chǎn)品及時(shí)面市優(yōu)勢。
          • 關(guān)鍵字: Altera  FPGA  

          賽靈思聯(lián)盟計(jì)劃推出高等設(shè)計(jì)服務(wù)成員計(jì)劃

          • 全球可編程平臺(tái)領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. )今天宣布,賽靈思聯(lián)盟計(jì)劃 (Xilinx Alliance Program)推出高等設(shè)計(jì)服務(wù)成員計(jì)劃,作為其設(shè)計(jì)服務(wù)成員計(jì)劃的一個(gè)重要擴(kuò)展,幫助 FPGA 客戶加速新產(chǎn)品的開發(fā),并使其更輕松找到滿足其設(shè)計(jì)與開發(fā)需求的最佳合作伙伴。
          • 關(guān)鍵字: 賽靈思   FPGA   

          ARM和單片機(jī)AVR的區(qū)別

          • AVR單片機(jī)是ATMEL公司研制開發(fā)的一種新型單片機(jī),它與51單片機(jī)、PIC單片機(jī)相比運(yùn)行效率高很多、芯片內(nèi)部的Flsah、EEPROM、SRAM容量較大、全部支持在線編程燒寫(ISP、每個(gè)IO口都可以以推換驅(qū)動(dòng)的方式輸出高、低電平,
          • 關(guān)鍵字: 區(qū)別  AVR  單片機(jī)  ARM  

          基于51單片機(jī)和FPGA的人機(jī)交互系統(tǒng)的設(shè)計(jì)

          • 摘要:在儀器儀表電路中,人機(jī)交互界面是必不可少的環(huán)節(jié)。為了解決單純采用單片機(jī)制作的系統(tǒng)功耗高、速度慢、電 ...
          • 關(guān)鍵字: 人機(jī)交互  C805lF  T6963C  FPGA  鍵盤掃描  

          基于FPGA的LED體三維顯示設(shè)計(jì)方案

          • 引 言  眾所周知, 視覺是人類感知世界的最重要的方式, 而現(xiàn)實(shí)生活中的所有物質(zhì)形態(tài)都是以三維空間而客觀存在。三維顯示能真正地再現(xiàn)客觀世界的立體空間, 提供更符合人們觀察習(xí)慣的交流方式, 有助于人們在綜合
          • 關(guān)鍵字: FPGA  LED  體三維  方案    

          基于FPGA的WALLACE TREE乘法器設(shè)計(jì)

          • 摘要:為了使基于FPGA設(shè)計(jì)的信號(hào)處理系統(tǒng)具有更高運(yùn)行速度和具有更優(yōu)化的電路版圖布局布線,提出了一種適用于FPGA結(jié)構(gòu)的改進(jìn)型WALLACE TREE架構(gòu)乘法器。首先討論了基于標(biāo)準(zhǔn)單元3:2壓縮器的改進(jìn)型6:4壓縮器,根據(jù)FP
          • 關(guān)鍵字: WALLACE  FPGA  TREE  乘法器設(shè)計(jì)    

          一種新的基于FPGA的數(shù)據(jù)格式轉(zhuǎn)換方法

          • 摘要:針對(duì)目前多數(shù)的FPGA都支持浮點(diǎn)IP核,卻較少關(guān)注數(shù)據(jù)源獲取的問題,提出了一種數(shù)據(jù)格式轉(zhuǎn)換方法。使用VHDL語言,采用流水線處理方式將ASCII碼所表示的一定范圍內(nèi)的實(shí)數(shù)轉(zhuǎn)換為單精度浮點(diǎn)數(shù)。經(jīng)過ModelSim功能仿真
          • 關(guān)鍵字: FPGA  數(shù)據(jù)格式  方法  轉(zhuǎn)換    

          戴爾:軟件移植成本阻礙ARM 64位處理器應(yīng)用

          •   據(jù)國外媒體報(bào)道,戴爾Data Center Services(簡稱DCS)營銷執(zhí)行董事Steve Cumings和營銷經(jīng)理Drew Schulke稱,因軟件移植成本,最新ARM 64位處理器在與英特爾、AMD兩家公司爭奪市場時(shí)將面臨挑戰(zhàn)。上月,英國芯片商ARM發(fā)布新款64位處理器架構(gòu)ARMv8。ARM此前專注于32位處理器,以節(jié)能高效主導(dǎo)手機(jī)市場。推出64位處理器后,ARM將市場轉(zhuǎn)向服務(wù)器等更大設(shè)備,與英特爾等競爭。   市場研究機(jī)構(gòu)IDC今年第三季度數(shù)據(jù)顯示,x86架構(gòu)處理器為英特爾贏得95.1%
          • 關(guān)鍵字: ARM  64位處理器  

          IBM和ARM正進(jìn)行小功率SOI芯片研究

          •   11月15日消息,據(jù)國外媒體報(bào)道,IBM、ARM同一批半導(dǎo)體生產(chǎn)商正在進(jìn)行一項(xiàng)關(guān)于小功率SOI芯片組的研究計(jì)劃,打算將采用體硅制成的CMOS設(shè)計(jì)轉(zhuǎn)換成全耗盡型FD-SOI裝配。   由于受超薄氧化物層覆蓋,采用該種芯片的設(shè)備將提供更好的性能以及更低的能耗。參與此次合作研究的公式有ARM、法國半導(dǎo)體廠商Leti、比利時(shí)魯汶大學(xué)(the Université Catholique de Louvain) 、IBM、Globalfoundries、 法國Soitec。   SOI工業(yè)協(xié)會(huì)組
          • 關(guān)鍵字: ARM  SOI芯片  

          LATTICE和Valens半導(dǎo)體公司發(fā)布適用于監(jiān)控?cái)z像機(jī)市場的新的參考設(shè)計(jì)

          • 萊迪思半導(dǎo)體公司(NASDAQ:LSCC)和Valens半導(dǎo)體今日發(fā)布一款新的全面的HDBaseT?攝像機(jī)參考設(shè)計(jì)解決方案。HDB...
          • 關(guān)鍵字: 監(jiān)控  HDBaseT  FPGA  攝像機(jī)  

          嵌入式軟件開發(fā)流程及ARM的中斷調(diào)試方法介紹

          • 嵌入式軟件開發(fā)流程及ARM的中斷調(diào)試方法介紹,1 嵌入式軟件開發(fā)流程  參照嵌入式軟件的開發(fā)流程。第一步:工程建立和配置。第二步:編輯源文件。第三步:工程編譯和鏈接。第四步:軟件的調(diào)試。第五步:執(zhí)行文件的固化?! ≡谡麄€(gè)流程中,用戶首先需要建立工程
          • 關(guān)鍵字: 調(diào)試  方法  介紹  中斷  ARM  軟件開發(fā)  流程  嵌入式  
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          fpga+arm介紹

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