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愛特梅爾為基于ARM的AT91SAM9G20嵌入式微處理器
- 愛特梅爾公司 (Atmel® Corporation) 宣布為基于ARM926EJ-S? 的400 MHz AT91SAM9G20 嵌入式微處理器 (MPU)，以及AT91SAM9 系列中的其它產(chǎn)品提供最新的Linux® mainline 版本v2.6.27支持。產(chǎn)品面世的時(shí)間與正式在Linux內(nèi)核發(fā)布的時(shí)間兩者之所以相隔很近，全賴愛特梅爾為AT91SAM9嵌入式MPU，以及用于整個(gè)產(chǎn)品系列的外設(shè)提供了完備的Linux支持。 設(shè)計(jì)人員可在 www.linux4sam.org 的愛
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業(yè)界容量最大的ASIC原型電路板采用了Altera Stratix III器件
- 2008年11月11號，北京——Altera公司(NASDAQ: ALTR)今天宣布，Dini集團(tuán)在其業(yè)界容量最大的單板FPGA原型引擎中采用了具有340K邏輯單元(LE)的Stratix® III EP3SL340 FPGA。DN7020K10采用了1,760引腳封裝的20片EP3SL340 FPGA，每個(gè)器件提供1,104個(gè)用戶I/O，容量等價(jià)于5千萬ASIC邏輯門?？蛻粼O(shè)計(jì)無線通信、網(wǎng)絡(luò)和圖形處理應(yīng)用等定制ASIC時(shí)，可以利用這一超大容量原型電路板來驗(yàn)
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采用FPGA來實(shí)現(xiàn)自適應(yīng)波束形成算法
- 1引言在雷達(dá)及聲納信號處理系統(tǒng)中，波束形成算法通常采用DSP軟件編程實(shí)現(xiàn)，控制邏輯電路采用CPLD來...
- 關(guān)鍵字： FPGA 聲納系統(tǒng) 最小均方自適應(yīng)算法
基于ARM和藍(lán)牙的無線信號采集系統(tǒng)的設(shè)計(jì)
- 本文針對無線信號測試，提出一種基于ARM和藍(lán)牙的無線信號采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)?；贏RM核心的微處理器具有運(yùn) ...
- 關(guān)鍵字： 藍(lán)牙模塊 采集模塊 無線測量 信號測試 藍(lán)牙協(xié)議 ARM 電平轉(zhuǎn)換 無線測試 電壓基準(zhǔn) 復(fù)位電路
基于ARM的汽車防盜報(bào)警系統(tǒng)設(shè)計(jì)
- 隨著我國汽車工業(yè)的高速發(fā)展，許多家庭擁有了自己的私家車，但車庫的數(shù)量遠(yuǎn)遠(yuǎn)滿足不了需求，因此，如何有效地防止汽車被盜是車主們最關(guān)心的問題。近年來，科學(xué)技術(shù)迅猛發(fā)展，結(jié)合各種新技術(shù)的新型汽車防盜裝備相繼出現(xiàn)。由于目前車載系統(tǒng)的功能正在逐步的增強(qiáng)、增多，采用單片機(jī)的控制已越來越無法適應(yīng)需求。所以在汽車電子中采用嵌入式技術(shù)將成為必然。 本文采用嵌入式技術(shù)開發(fā)車載防盜裝置，一方面能增強(qiáng)控制能力，提高汽車防盜的智能化程度。另一方面，縮小了裝置的體積，提高了該裝置應(yīng)用的靈活性，同時(shí)也為將來進(jìn)一步增強(qiáng)汽車電子的
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DSP+FPGA實(shí)時(shí)信號處理系統(tǒng)
- 實(shí)時(shí)信號處理系統(tǒng)要求必須具有處理大數(shù)據(jù)量的能力,以保證系統(tǒng)的實(shí)時(shí)性;其次對系統(tǒng)的體積、功耗、穩(wěn)定性...
- 關(guān)鍵字： DSP FPGA 信號處理 實(shí)時(shí)操作
PSoC? 在清華大學(xué)取得巨大成功
- 2008 年 10 月 14日，北京訊 — 賽普拉斯半導(dǎo)體公司中國業(yè)務(wù)運(yùn)營部與賽普拉斯大學(xué)聯(lián)盟 (CUA) 協(xié)力共同為中國的名牌大學(xué)清華大學(xué) (THU) 提供 PSoC? 器件及相關(guān)套件。相關(guān)工作取得了顯著成效，PSoC 在兩門課程的學(xué)習(xí)中得到全面推廣，并幫助 100 多名學(xué)生了解到如何用賽普拉斯業(yè)界領(lǐng)先的可編程片上系統(tǒng)解決方案設(shè)計(jì)復(fù)雜的系統(tǒng)。 清華大學(xué)自動化系與清華大學(xué)科教儀器設(shè)備廠攜手開發(fā)了 PSoC 實(shí)驗(yàn)室套件。該套件于去年春天獲得了清華大學(xué)頒發(fā)的“第10屆
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基于FPGA的UART接口開發(fā)
- 設(shè)計(jì)背景 串口即通用異步收發(fā)器（UART，Universal Asynchronous Receiver Transmitter）。串行通信具有傳輸線少、成本低、可靠性高等優(yōu)點(diǎn)，所以系統(tǒng)間互聯(lián)常采用RS-232接口方式，一般該接口由UART 專用芯片來實(shí)現(xiàn)。但UART接口芯片一般引腳較多，內(nèi)含許多輔助模塊和一些輔助功能，在實(shí)際使用時(shí)往往用不到這些功能，因此若采用UART專用芯片，必將使電路變得復(fù)雜，PCB面積增大，從而導(dǎo)致成本增加，系統(tǒng)的穩(wěn)定性和可靠性降低?；镜腢ART通信只需要兩條信號線（R
- 關(guān)鍵字： FPGA UART 接口技術(shù)
2008嵌入式設(shè)計(jì)調(diào)查：工程師時(shí)刻都在趕項(xiàng)目
- ??? Tech?Insights/Embedded?Systems?Design?2008年嵌入式市場調(diào)研報(bào)告表明，嵌入式系統(tǒng)設(shè)計(jì)人員在2008年要參與更多項(xiàng)目的開發(fā)，按期完成開發(fā)任務(wù)是他們最大的問題，有一半以上（大于50%）的開發(fā)項(xiàng)目不能按期完成。 調(diào)查結(jié)果表明：自2005年以來，2008年新項(xiàng)目對應(yīng)項(xiàng)目改進(jìn)的比例是這幾年中最高的。在所有開發(fā)項(xiàng)目中，新開發(fā)項(xiàng)目占46%，剩余54%為以往開發(fā)項(xiàng)目的升級和改進(jìn)。項(xiàng)目的改進(jìn)和升級主
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賽靈思推出Virtex-5 FXT FPGA ML510 嵌入式開發(fā)平臺
- 賽靈思公司日前宣布推出 Virtex-5 FXT FPGA ML510 嵌入式開發(fā)平臺，用于開發(fā)支持雙處理器的高性能嵌入式系統(tǒng)。這一新的開發(fā)平臺基于集成雙 Power PC? 440處理器的 Virtex-5 FXT FPGA，并且可以支持 Linux和VxWorks 操作系統(tǒng)，為軟件和硬件設(shè)計(jì)團(tuán)隊(duì)提供了無與倫比的靈活性和計(jì)算能力。 結(jié)合豐富的參考設(shè)計(jì)和由屢獲殊榮的開發(fā)工具、配置向?qū)Ш?IP 組成的賽靈思嵌入式開發(fā)套件（EDK），ML510 嵌入式開發(fā)平臺為構(gòu)建利用雙處理器完成專用分配功
- 關(guān)鍵字： xilinx FPGA WiMAX
基于單片機(jī)和FPGA的簡易數(shù)字存儲示波器設(shè)計(jì)
- l 引言 與傳統(tǒng)模擬示波器相比．?dāng)?shù)字存儲示波器不僅具有可存儲波形、體積小、功耗低，使用方便等優(yōu)點(diǎn)，而且還具有強(qiáng)大的信號實(shí)時(shí)處理分析功能。在電子測量領(lǐng)域，數(shù)字存儲示波器正在逐漸取代模擬示波器。但目前我國使用高性能數(shù)字存儲示波器主要依靠國外產(chǎn)品，而且價(jià)格昂貴。因此研究數(shù)字存儲示波器具有重要價(jià)值。借于此，提出了一種簡易數(shù)字存儲示波器的設(shè)計(jì)方案，經(jīng)測試，性能優(yōu)良。 2 數(shù)字存儲示波器基本工作原理 數(shù)字存儲示波器與模擬示波器不同在于信號進(jìn)入示波器后立刻通過高速A／D轉(zhuǎn)換器將模擬信號前端快速采樣，存儲其
- 關(guān)鍵字： 單片機(jī) FPGA 放大器 示波器
基于FPGA的低成本虛擬測試系統(tǒng)實(shí)現(xiàn)
- 1 引言 傳統(tǒng)測試測量儀存在價(jià)格昂貴、體積龐大、數(shù)據(jù)傳輸速率低、存儲顯示困難等問題，本文選用FPGA實(shí)現(xiàn)數(shù)據(jù)處理、邏輯控制，充分利用PC機(jī)，結(jié)合Labwindows圖形化上層應(yīng)用軟件界面生成的虛擬測試系統(tǒng)具有較強(qiáng)的競爭力。本系統(tǒng)在FPGA單板單片主控器件控制下，實(shí)現(xiàn)兩路獨(dú)立、幅值可控的信號發(fā)生器，一路虛擬存儲示波器，具有外部觸發(fā)信號和采樣時(shí)鐘的16路高速邏輯分析儀。 2硬件設(shè)計(jì) 2.1硬件系統(tǒng)框圖 硬件系統(tǒng)設(shè)計(jì)是以并行處理能力強(qiáng)、可重配置的低端FPGA單片EP1C6為主控器件。圖1所示為硬
- 關(guān)鍵字： 虛擬測試 FPGA
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