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fpga+dsp 文章進入fpga+dsp技術(shù)社區(qū)

基于DSP與CPLD的多通道數(shù)據(jù)采集系統(tǒng)

用于實時控制系統(tǒng)的嵌入式系統(tǒng)經(jīng)常需要對模擬量進行測量，通常的方法是以MCU為主產(chǎn)生采集控制時序控制模數(shù)轉(zhuǎn)換器，并通過中斷或查詢的方式讀取轉(zhuǎn)換后的結(jié)果。由MCU產(chǎn)生采集控制時序?qū)⒄加幂^多的系統(tǒng)軟硬件資源。而在
關(guān)鍵字：數(shù)據(jù)采集系統(tǒng) 通道 CPLD DSP 基于

Tensilica推出語音觸發(fā)和語音識別DSP IP核精巧設(shè)計

Tensilica日前宣布，推出業(yè)界最小面積，最低功耗的HiFi Mini DSP(數(shù)字信號處理器)內(nèi)核，該款DSP IP核支持“隨時傾聽”的語音觸發(fā)和語音指令功能。這款小面積低功耗的HiFi Mini DSP IP核專為智能手機、平板電腦、家用電器以及車載系統(tǒng)而優(yōu)化，由此實現(xiàn)終端產(chǎn)品的免提體驗。
關(guān)鍵字： Tensilica DSP HiFi Mini

短波擴頻猝發(fā)通信系統(tǒng)的DSP+FPGA實現(xiàn)方案

引言短波通信是一種能進行遠距離傳輸，而對電臺的要求相對較低的通信系統(tǒng)。短波具有的遠距離通信能力和電臺具有的較高機動性等特點，使其在軍事通信領(lǐng)域中具有重要的應(yīng)用價值。然而，短波信道頻帶窄，傳播特性不穩(wěn)定
關(guān)鍵字： FPGA DSP 短波擴頻通信系統(tǒng)

基于FPGA的IIR數(shù)字濾波器的快捷設(shè)計

0 引言IIR數(shù)字濾波器在很多領(lǐng)域中都有著廣闊的應(yīng)用。與FIR數(shù)字濾波器相比，IIR數(shù)字濾波器可以用較低的階數(shù)獲得較高的選擇性，而且所用存儲單元少，經(jīng)濟效率高。一個N階IIR數(shù)字濾波器的系統(tǒng)函數(shù)為：其線性常系數(shù)差分
關(guān)鍵字： FPGA IIR 數(shù)字濾波器

解析FPGA設(shè)計流程及其布線資源

FPGA/CPLD的設(shè)計流程 1、電路設(shè)計與輸入電路設(shè)計與輸入是指通過某些規(guī)范的描述方式，將工程師電路構(gòu)思輸入給EDA工具。常用的設(shè)計方法有硬件描述語言（HDL）和原理圖設(shè)計輸入方法等。原理圖設(shè)計輸入法在早期應(yīng)用得比
關(guān)鍵字： FPGA 設(shè)計流程布線資源

基于ARM+FPGA的運動控制器設(shè)計與實現(xiàn)

摘要：本文以微控制器AT91RM9200 和EP1C6Q240C8 為核心，對工業(yè)CT 機的運動控制器進行了設(shè)計，從硬件和軟件兩個方 ...
關(guān)鍵字： ARM FPGA 運動控制器

基于ARM/FPGA的高速同步數(shù)據(jù)采集方案

　　大多數(shù)的勘探、觀測工作都是在嚴苛的環(huán)境中進行的，對數(shù)據(jù)的準確性、實時性都有著較高的要求，并且大多情況 ...
關(guān)鍵字： ARM FPGA 同步數(shù)據(jù)采集

雙端口RAM在ARM 與DSP通信系統(tǒng)中的應(yīng)用

摘要：通過使用IDT70261 雙端口RAM 實現(xiàn)了ARM 與TMS320C6211 DSP 之間的高速實時數(shù)據(jù)通信，給出了雙端口RAM 與 ...
關(guān)鍵字：雙端口RAM ARM DSP 通信系統(tǒng)

后發(fā)者如何制人？Altera與ARM戰(zhàn)略合作細節(jié)公布

　　2012年12月13日，Altera聯(lián)合ARM召開發(fā)布會，共同宣布發(fā)售其首款28nm FPGA SoC器件，包含雙核ARM Cortex-A9 800MHz處理器，此時，賽靈思的類似產(chǎn)品Zynq已經(jīng)發(fā)售一年有余。　　客觀來說，Altera的SoC產(chǎn)品進展比賽靈思緩慢許多，2010年，賽靈思就放出了與ARM合作開發(fā)下一代SoC器件的消息，而與之對應(yīng)的Altera只是公布了與MIPS的合作藍圖，又聯(lián)合Intel宣布X86與FPGA的融合技術(shù)，直到2011年年中，Altera與ARM的合作計劃才姍姍來遲
關(guān)鍵字： Altera FPGA

基于DSP的車輛碰撞聲檢測裝置的設(shè)計

基于DSP的車輛碰撞聲檢測裝置的設(shè)計,1 硬件設(shè)計我們設(shè)計的碰撞檢測裝置的原理框圖如圖1所示，首先采用聲音傳感器采集各種聲音信號，傳感器輸出的電信號經(jīng)放大電路放大后，傳入聲音采集芯片的模擬信號輸入端。聲音采集芯片將模擬信號進行A/D轉(zhuǎn)換后，送到
關(guān)鍵字：裝置設(shè)計檢測碰撞 DSP 車輛基于

DSP + ARM架構(gòu)處理器為機器視覺帶來強大運算和控制能力

一些工業(yè)、航空電子控制、視覺應(yīng)用和高端測量測試，如生物影像處理等在實現(xiàn)控制、顯示的同時，還需要較強的運算 ...
關(guān)鍵字： DSP ARM架構(gòu) 機器視覺

NI推出軟件定義的無線電模塊用于最先進的5G無線研究

美國國家儀器公司(National Instruments, 簡稱 NI)近日發(fā)布用于NI FlexRIO的NI 5791射頻收發(fā)儀適配器模塊，目前多個機構(gòu)都在使用該收發(fā)儀進行5G技術(shù)最前沿的項目研究。該模塊搭配NI FlexRIO FPGA，用于實時、用戶設(shè)計的處理，形成了一個強大的SDR解決方案。
關(guān)鍵字： NI FPGA 軟件

Adaboost算法的FPGA實現(xiàn)與性能分析

引言　　Adaboost 算法是Freund 和Schapire 于1995 年提出的，全稱為Adaptive Boosting。它是 Boosting 算法的改進，意為該算法通過機器訓(xùn)練與學(xué)習(xí)不斷自適應(yīng)地調(diào)整假設(shè)的錯誤率，這種靈活性使得Adaboost 算法很容易
關(guān)鍵字： Adaboost FPGA 算法性能分析

基于FPGA的數(shù)字秒表設(shè)計與仿真

基于FPGA的數(shù)字秒表設(shè)計與仿真,數(shù)字集成電路作為當今信息時代的基石，不僅在信息處理、工業(yè)控制等生產(chǎn)領(lǐng)域得到普及應(yīng)用，并且在人們的日常生活中也是隨處可見，極大的改變了人們的生活方式。面對如此巨大的市場，要求數(shù)字集成電路的設(shè)計周期盡可能
關(guān)鍵字：仿真設(shè)計數(shù)字秒表 FPGA 基于

基于DSP技術(shù)的功率電感5kW離網(wǎng)型光伏逆變器設(shè)計

太陽能光伏發(fā)電是當今世界上最有發(fā)展前景的新能源技術(shù)，太陽能光伏發(fā)電系統(tǒng)按照系統(tǒng)運行方式的不同可分為離網(wǎng)型光伏發(fā)電系統(tǒng)、并網(wǎng)型光伏發(fā)電系統(tǒng)以及混合型光伏發(fā)電系統(tǒng)。隨著我國光伏發(fā)電系統(tǒng)的迅速發(fā)展，尤其是光
關(guān)鍵字： DSP 5kW 功率電感離網(wǎng) 光伏逆變器

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fpga+dsp電路

利用FPGA資源和最小模擬電路發(fā)電進行開關(guān)電源設(shè)計的方法
一種基于DSP和USB的指紋識別系統(tǒng)設(shè)計
基于FPGA的機載顯示系統(tǒng)架構(gòu)設(shè)計與優(yōu)化
基于FPGA+DSP遠程監(jiān)控器設(shè)計與實現(xiàn)

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MCU、DSP、PLC的優(yōu)缺點對比
RDMA IP 設(shè)計簡介
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基于FPGA的數(shù)字存儲示波器設(shè)計與實現(xiàn)
基于DSP和PC的農(nóng)業(yè)機器人控制系統(tǒng)
基于DSP的工業(yè)機器人控制器的設(shè)計與實現(xiàn)
基于DSP的高壓訓(xùn)線機器人數(shù)字化控制器
使用FPGA的超聲波測距資料合集免費下載
如何使用FPGA實現(xiàn)BP神經(jīng)網(wǎng)絡(luò)的仿真線設(shè)計
基于UDP協(xié)議和FPGA的點到點數(shù)據(jù)傳輸方案
如何使用FPGA實現(xiàn)低成本網(wǎng)絡(luò)數(shù)據(jù)傳輸存儲系統(tǒng)

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