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fpga+dsp 文章進(jìn)入fpga+dsp技術(shù)社區(qū)

整合ARM、FPGA與可編程模擬電路的單芯片方案

現(xiàn)在設(shè)計(jì)人員不僅要從多種處理器架構(gòu)中進(jìn)行選擇(大多數(shù)嵌入式系統(tǒng)設(shè)計(jì)都以處理器內(nèi)核為中心)，而且外設(shè)、通信端口和模擬功能組合的選擇幾乎無限。而這
關(guān)鍵字：芯片 FPGA ARM

基于FPGA的多端DRI電源逆變器的控制算法的實(shí)現(xiàn)

賽靈思SPARTAN-3A FPGA 可強(qiáng)化面向多端DRI 電源逆變器的控制算法實(shí)現(xiàn)方案面向工業(yè)應(yīng)用的產(chǎn)品開發(fā)需要在時(shí)限和產(chǎn)品規(guī)范不斷變化的環(huán)境中進(jìn)行廣泛的研究
關(guān)鍵字： FPGA 通信

基于FPGA可編程振蕩器增強(qiáng)

當(dāng)今復(fù)雜的 FPGA 含有眾多用于實(shí)現(xiàn)各種電路與系統(tǒng)的功能塊，諸如邏輯陣列、存儲(chǔ)器、DSP 模塊、處理器、用于時(shí)序生成的鎖相環(huán) (PLL) 和延遲鎖定環(huán) (DLL
關(guān)鍵字： FPGA 控制

基于FPGA的三相正弦DDS電路的設(shè)計(jì)與實(shí)現(xiàn)

1. 引言直接數(shù)字頻率合成器(DDS)技術(shù)，是根據(jù)相位的概念出發(fā)直接合成所需的波形的一種新的頻率合成原理,是一種把一系列數(shù)字形式的信號(hào)通過DAC轉(zhuǎn)換成模
關(guān)鍵字：控制 FPGA

基于Xilinx Zynq SoC的解決方案

在移動(dòng)互聯(lián)、智能終端的高速發(fā)展和普及下，網(wǎng)絡(luò)熱點(diǎn)和盲點(diǎn)急需靈活的方案來完善覆蓋。由于基站選址和工程施工難度越來越大，施工成本越來越高，基站設(shè)
關(guān)鍵字： FPGA 控制

基于Nios軟CPU內(nèi)核的FPGA非線性校正方案

1. 引言O(shè)FDM能有效抑制多徑信道引起的深度衰落、抵抗脈沖噪聲和具有較高的頻譜效率的特點(diǎn)。但是OFDM的傳輸符號(hào)是多載波的QAM信號(hào)經(jīng)過IFFT處理后得到的
關(guān)鍵字：射頻 FPGA

基于FPGA的簡(jiǎn)易電壓表設(shè)計(jì)

　　傳統(tǒng)的數(shù)字電壓表設(shè)計(jì)通常以大規(guī)模ASIC(專用集成電路)為核心器件，并輔以少量中規(guī)模集成電路及顯示器件構(gòu)成。這種電壓表的設(shè)計(jì)簡(jiǎn)單、精確度高，但是由于采用了ASIC器件使得它欠缺靈活性，其系統(tǒng)功能固定，難以更新擴(kuò)展。而應(yīng)用FPGA設(shè)計(jì)的電壓表，采用FPGA芯片控制通用A/D轉(zhuǎn)換器，可使速度、靈活性大大優(yōu)于通用數(shù)字電壓表。、　　本文采用STEP-MAX10M08核心板和STEP Base Board V3.0底板來完成簡(jiǎn)易電壓表設(shè)計(jì)，我們將設(shè)計(jì)拆分成三個(gè)功能模塊實(shí)現(xiàn)：　　ADC081S101_driver
關(guān)鍵字： FPGA ASIC

基于FPGA的嵌入式視覺的應(yīng)用

什么樣的積極創(chuàng)新可以幫助您設(shè)計(jì)出這樣一個(gè)系統(tǒng)mdash;mdash;它能夠提醒用戶有兒童在游泳池中溺水，或是有入侵者試圖闖入住宅或者辦公場(chǎng)所?這種技術(shù)還
關(guān)鍵字：嵌入式 FPGA

加快設(shè)計(jì)流程的兩種嵌入式系統(tǒng)開發(fā)方案的設(shè)計(jì)

在日益信息化的現(xiàn)代社會(huì)中，計(jì)算機(jī)和網(wǎng)絡(luò)的應(yīng)用已經(jīng)全面滲透到日常生活中，各種應(yīng)用嵌入式系統(tǒng)的電子產(chǎn)品也隨處可見，計(jì)算機(jī)的應(yīng)用經(jīng)過桌面PC系統(tǒng)的空
關(guān)鍵字：嵌入式 FPGA

采用帶有收發(fā)器的全系列40-nm FPGA 和ASIC 實(shí)現(xiàn)創(chuàng)新設(shè)計(jì)

人們對(duì)寬帶服務(wù)的帶寬要求越來越高，促使芯片供應(yīng)商使用更多的高速串行收發(fā)器。因此，下一代應(yīng)用采用了多種數(shù)據(jù)速率，從幾Mbps 到數(shù)百Gbps，在一種
關(guān)鍵字： FPGA ASIC 40 nm

基4-FPGA的大動(dòng)態(tài)范圍數(shù)字AGC的實(shí)現(xiàn)

1 引言在數(shù)字中頻接收機(jī)中，把A／D轉(zhuǎn)換提前到中頻部分，為保證A／D轉(zhuǎn)換的動(dòng)態(tài)范圍和系統(tǒng)帶寬，要求低噪聲放大器和自動(dòng)增益控制AGC(Automatic Ga
關(guān)鍵字： FPGA AGC 動(dòng)態(tài)范圍數(shù)字

提高DSP代碼運(yùn)行性能的研究

提高DSP代碼運(yùn)行性能的研究,1 引言
隨著微控制器技術(shù)的發(fā)展，以TI公司TMS320C2000系列為代表的DCS型數(shù)字信號(hào)處理器DSP應(yīng)用廣泛。該類型DSP內(nèi)部集成Flash存儲(chǔ)器，可將二進(jìn)制代碼同化到其內(nèi)部的Flash存儲(chǔ)器直接運(yùn)行。這種運(yùn)行方式在傳統(tǒng)嵌入
關(guān)鍵字： DSP 代碼運(yùn)行性能

基于DSP的太陽光線自動(dòng)跟蹤系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

基于DSP的太陽光線自動(dòng)跟蹤系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn),1 引言
精確捕捉太陽光線可提高太陽能裝置，尤其是聚光類太陽能裝置的太陽能利用率?，F(xiàn)有的聚光類太陽能發(fā)電系統(tǒng)主要采用程序控制、傳感器控制、程序與傳感器聯(lián)合控制的方法。程序控制方法是計(jì)算出太陽在一天中
關(guān)鍵字： DSP 光線自動(dòng)跟蹤系統(tǒng)設(shè)計(jì)

基于FPGA的正交數(shù)字混頻器中數(shù)控振蕩器的設(shè)計(jì)與實(shí)現(xiàn)

要CORDIC(COordination Rotation DIgital Computer)算法實(shí)現(xiàn)正交數(shù)字混頻器中的數(shù)控振蕩器的方法。首先推導(dǎo)了算法產(chǎn)生正余弦信號(hào)的實(shí)現(xiàn)過程,然后給出了
關(guān)鍵字： FPGA 正交數(shù)字混頻器數(shù)控振蕩器

積分梳狀濾波器的FPGA實(shí)現(xiàn)

本文提出了多級(jí)CIC抽取濾波器結(jié)構(gòu)不僅能夠?qū)崿F(xiàn)更寬輸入信號(hào)的任意速率的抽取，并且對(duì)帶外信號(hào)的衰減也更大。
關(guān)鍵字： FPGA 積分梳狀濾波器

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fpga+dsp介紹

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fpga+dsp電路

利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計(jì)的方法
一種基于DSP和USB的指紋識(shí)別系統(tǒng)設(shè)計(jì)
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計(jì)與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計(jì)與實(shí)現(xiàn)

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基于FPGA的數(shù)字存儲(chǔ)示波器設(shè)計(jì)與實(shí)現(xiàn)
基于DSP和PC的農(nóng)業(yè)機(jī)器人控制系統(tǒng)
基于DSP的工業(yè)機(jī)器人控制器的設(shè)計(jì)與實(shí)現(xiàn)
基于DSP的高壓訓(xùn)線機(jī)器人數(shù)字化控制器
使用FPGA的超聲波測(cè)距資料合集免費(fèi)下載
如何使用FPGA實(shí)現(xiàn)BP神經(jīng)網(wǎng)絡(luò)的仿真線設(shè)計(jì)
基于UDP協(xié)議和FPGA的點(diǎn)到點(diǎn)數(shù)據(jù)傳輸方案
如何使用FPGA實(shí)現(xiàn)低成本網(wǎng)絡(luò)數(shù)據(jù)傳輸存儲(chǔ)系統(tǒng)

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