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賽靈思推出首批7系列FPGA設(shè)計平臺之問答

賽靈思在 DesignCon 2012 展會上推出面向 28nm 7 系列 FPGA 的目標(biāo)設(shè)計平臺——3 款最新開發(fā)套件，其中包括Kintex?-7 FPGA KC705 評估套件、Virtex?-7 FPGA VC707 評估套件，以及與安富利電子元件部 (Avnet Electronic Marketing) 聯(lián)合開發(fā)的 Kintex?-7 FPGA DSP 套件。
關(guān)鍵字：賽靈思 FPGA

賽靈思第一批7系列FPGA目標(biāo)設(shè)計平臺上市

全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. (NASDAQ:XLNX) )宣布推出其首批用于加速 28nm 7 系列FPGA系統(tǒng)開發(fā)與集成能力提升的目標(biāo)設(shè)計平臺。賽靈思針對 FPGA 系統(tǒng)設(shè)計和集成的目標(biāo)設(shè)計平臺方法提供了業(yè)界最全面的開發(fā)套件，包括開發(fā)板、ISE 設(shè)計套件工具、IP 核、參考設(shè)計和 FPGA 夾層卡 (FMC)，能幫助設(shè)計人員立即啟動應(yīng)用開發(fā)。
關(guān)鍵字： Xilinx FPGA

賽靈思發(fā)布ISE 13.4 設(shè)計套件

全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. (NASDAQ:XLNX) )今天宣布推出 ISE? 13.4設(shè)計套件。該設(shè)計套件可提供對 MicroBlaze? 微控制器系統(tǒng) (MCS) 的公共訪問功能、面向 28nm 7 系列 FPGA 的全新 RX 裕量分析和調(diào)試功能，以及支持面向 Artix?-7 系列和 Virtex?-7 XT 器件的部分可重配置功能。
關(guān)鍵字： Xilinx FPGA ISE 13.4

JavaCard指令處理器的FPGA設(shè)計

JavaCard指令處理器的FPGA設(shè)計,1 JavaCard簡介　　智能卡是指集成了CPU、ROM、RAM、COS(芯片操作系統(tǒng))和EEPROM，能儲存信息和圖像，具備讀/寫能力，信息能被加密保護的便攜卡。智能卡的最基本標(biāo)準是ISO/IEC7816。智能卡在銀行、電信等行業(yè)得到廣泛
關(guān)鍵字：設(shè)計 FPGA 處理器指令 JavaCard

基于FPGA的SOC外部組件控制器IP的設(shè)計

1 引言

嵌入式系統(tǒng)已經(jīng)發(fā)展成為應(yīng)用最廣的計算機系統(tǒng)［1］。SOC（System On a Chip）則是嵌入式系統(tǒng)的研究和開發(fā)熱點。SOC 的核心概念是把整個系統(tǒng)集成到一片半導(dǎo)體芯片上。目前SOC 的中文名稱還不統(tǒng)一，可被叫做
關(guān)鍵字： FPGA SOC 控制器

基于FPGA的NCO設(shè)計方案

　隨著數(shù)字通信技術(shù)的飛速發(fā)展，軟件無線電的應(yīng)用愈加的廣泛，而影響軟件無線電性能的關(guān)鍵器件數(shù)控振蕩器NCO(Numerical CONtrolled Oscillator) 的設(shè)計至關(guān)重要直接數(shù)字頻率合成(DDS)技術(shù)是一種從相位概念出發(fā)直接合
關(guān)鍵字： FPGA NCO 設(shè)計方案

多核DSP技術(shù)在OCT醫(yī)療成像中的應(yīng)用

過去幾年間，光學(xué)相干斷層掃描(OCT)技術(shù)有長足的進展。自從OCT技術(shù)問世以來，眼科醫(yī)生便運用近紅外線技術(shù)，拍攝眼部最遠端部位的高分辨率影像。由于眼部組織呈現(xiàn)半透明狀，因此OCT可提供顯現(xiàn)視網(wǎng)膜病變的影像，藉以診
關(guān)鍵字： DSP OCT 多核醫(yī)療成像

基于C/C++的大規(guī)模FPGA設(shè)計

背景可編程邏輯器件的設(shè)計方法經(jīng)歷了布爾等式，原理圖輸入，硬件描語言這樣一個發(fā)展過程。隨著設(shè)計的日益復(fù)雜和可編程邏輯器件規(guī)模的不斷擴大，人們不停地尋求更加抽象的行為級設(shè)計方法，以便在盡可能短時間內(nèi)完成自
關(guān)鍵字： FPGA 大規(guī)模

多節(jié)點大容量FPGA系統(tǒng)的遠程升級方法

引言　　多節(jié)點系統(tǒng)，在目前的很多電子系統(tǒng)應(yīng)用場合都可以看到。這種多節(jié)點系統(tǒng)由于具有結(jié)構(gòu)可擴展性、功能配置的靈活性以及便于查找故障節(jié)點等良好的可維護性得到了越來越廣泛的應(yīng)用。通常，多節(jié)點系統(tǒng)各個節(jié)點的主
關(guān)鍵字： FPGA 節(jié)點大容量方法

基于FPGA的嵌入式系統(tǒng)USB接口設(shè)計

基于FPGA的嵌入式系統(tǒng)USB接口設(shè)計,摘要：設(shè)計基于FPGA的IP-BX電話應(yīng)用系統(tǒng)，用于傳統(tǒng)的電話網(wǎng)絡(luò)(PSTN)與PC機之間的接口連接。USB2．0接口器件EZ-USB FX2 CY7C68013A-56工作在slave FIFO模式，為基于FPGA的嵌入式系統(tǒng)與PC機之間提供數(shù)據(jù)和命令通道，從
關(guān)鍵字：接口設(shè)計 USB 系統(tǒng) FPGA 嵌入式基于

基于DSP的3G LTE應(yīng)用技術(shù)簡介

基于DSP的3G LTE應(yīng)用技術(shù)簡介,3G LTE是第三代伙伴計劃(3GPP)的一個高級標(biāo)準，為廣域網(wǎng)提供下一代寬帶無線技術(shù)。與以前各階段的3GPP相比，3G LTE的目標(biāo)是更高的吞吐量、更低的時延以及高效的IP回程，提供一種新的可以大規(guī)模部署的移動網(wǎng)絡(luò)技術(shù)，
關(guān)鍵字：應(yīng)用技術(shù) 簡介 LTE 3G DSP 基于

裝入CPLD/FPGA的步進電機運動控制器與驅(qū)動器

本設(shè)計實例進一步拓展了以前將步進電機驅(qū)動器集成到CPLD中的設(shè)計（參考文獻1）。本實例不僅集成了驅(qū)動器，而且還集成了一個簡單的單軸步進電機運動控制器。根據(jù)CPLD大小，可以將多個運動控制器設(shè)計到單一設(shè)備中。例如
關(guān)鍵字：控制器驅(qū)動器運動電機 CPLD/FPGA 步進裝入

TMS320LF2407A DSP的PFC級電路的原理與設(shè)計

1、引言　　帶A/D轉(zhuǎn)換器（ADC）和脈沖寬度調(diào)制器（PWM）等集成外設(shè)的低成本高性能數(shù)字信號處理器（DSP），已在電機控制、不間斷電源（UPS）和運動控制等領(lǐng)域獲得比較廣泛的應(yīng)用。低成本DSP在控制電源變換功能方面，
關(guān)鍵字：原理設(shè)計電路 PFC DSP TMS320LF2407A

利用FPGA解決TMS320C54K與SDRAM的接口問題

在DSP應(yīng)用系統(tǒng)中，需要大量外擴存儲器的情況經(jīng)常遇到。例如，在數(shù)碼相機和攝像機中，為了將現(xiàn)場拍攝的諸多圖...
關(guān)鍵字： FPGA TMS320C54K SDRAM

基于FPGA與外部SRAM的大容量數(shù)據(jù)存儲

1引言我們將針對FPGA中內(nèi)部BlockRAM有限的缺點，提出了將FPGA與外部SRAM相結(jié)合來改進設(shè)計的方法，并給出...
關(guān)鍵字： FPGA SRAM

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基于UDP協(xié)議和FPGA的點到點數(shù)據(jù)傳輸方案
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