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理解FPGA 中的壓穩(wěn)態(tài)
- 理解FPGA 中的壓穩(wěn)態(tài) 本白皮書介紹FPGA 中的壓穩(wěn)態(tài)，為什么會出現(xiàn)這一現(xiàn)象，它是怎樣導(dǎo)致設(shè)計失敗的。介紹怎樣計算壓穩(wěn)態(tài)MTBF，重點是對結(jié)果造成影響的各種器件和設(shè)計參數(shù)。
引言
當(dāng)信號在不相關(guān)或者異步時鐘域 - 關(guān)鍵字： FPGA 壓穩(wěn)態(tài)
高速流水線浮點加法器的FPGA實現(xiàn)
- 本工程設(shè)計完全符合IP核設(shè)計的規(guī)范流程，而且完成了Verilog HDL建模、功能仿真、綜合、時序仿真等IP核設(shè)計的整個過程，電路功能正確。實際上，本系統(tǒng)在布局布線后，其系統(tǒng)的最高時鐘頻率可達80MHz。雖然使用浮點數(shù)會導(dǎo)致舍入誤差，但這種誤差很小，可以忽略。實踐證明，本工程利用流水線結(jié)構(gòu)，方便地實現(xiàn)了高速、連續(xù)、大數(shù)據(jù)量浮點數(shù)的加法運算，而且設(shè)計結(jié)構(gòu)合理，性能優(yōu)異，可以應(yīng)用在高速信號處理系統(tǒng)中。
- 關(guān)鍵字： FPGA 流水線 浮點 加法器
Altera 發(fā)布28-nm FPGA技術(shù)創(chuàng)新
- Altera公司今天宣布了在即將推出的28nm FPGA中采用的創(chuàng)新技術(shù)：嵌入式HardCopy®模塊、部分重新配置新方法以及嵌入式28-Gbps收發(fā)器，這些技術(shù)將極大的提高下一代Altera® FPGA的密度和I/O性能，并進一步鞏固相對于ASIC和ASSP的競爭優(yōu)勢。 快速增長的寬帶應(yīng)用如高清晰(HD)視頻、云計算、網(wǎng)絡(luò)數(shù)據(jù)存儲和移動視頻等對基礎(chǔ)設(shè)備和最終用戶設(shè)備開發(fā)人員提出了新挑戰(zhàn)。他們怎樣才能夠迅速提高系統(tǒng)帶寬，同時滿足嚴(yán)格的功耗和成本要求呢?Altera開發(fā)了最新的創(chuàng)新
- 關(guān)鍵字： Altera 28nm FPGA
采用FPGA實現(xiàn)發(fā)電機組頻率測量計的設(shè)計
- 基于FPGA設(shè)計的發(fā)電機組頻率測量計，系統(tǒng)在整體上采用光電耦合器的隔離方式，提高系統(tǒng)的抗干擾能力和穩(wěn)定性。該系統(tǒng)具有線路簡單可靠、通用性強、穩(wěn)定度高等優(yōu)點，可廣泛應(yīng)用于頻率電壓變換器、轉(zhuǎn)速繼電器。該設(shè)計的FPGA數(shù)字系統(tǒng)部分使用Verilog HDL語言，給出核心程序，并可以通過Verilog HDL語言的綜合工具進行相應(yīng)硬件電路的生成，具有傳統(tǒng)邏輯設(shè)計方法所無法比擬的優(yōu)越性。經(jīng)過仿真后，驗證設(shè)計是成功的, 達到預(yù)期結(jié)果。同時這種方法設(shè)計的數(shù)字電子系統(tǒng)可移植性強、可更改性好。如果需要的頻率測量范圍需要擴
- 關(guān)鍵字： FPGA 發(fā)電機組 測量計 頻率
賽靈思推出即插即用高清電視參考設(shè)計
- 全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc.)近日推出一款全新的消費視頻增強參考設(shè)計。該款參考設(shè)計基于一個低成本的Xilinx Spartan現(xiàn)場可編程邏輯門陣列(FPGA) 并結(jié)合先進的數(shù)字視頻算法，可大大加快高清數(shù)字電視的“即插即用”的設(shè)計步伐。 該款參考設(shè)計是賽靈思與世界著名的數(shù)字處理IC與IP廠商Vestek 電子研發(fā)公司共同開發(fā)的成果。隨著這款現(xiàn)成的、功能完整的設(shè)計解決方案的供貨上市，數(shù)字電視OEM廠商在大批量市場中可以更加輕松地利用圖像質(zhì)
- 關(guān)鍵字： Xilinx Spartan FPGA
基于FPGA的超聲波液體密度傳感器的設(shè)計
- 0引言液體密度是許多工業(yè)中的重要參數(shù)，它可以直接參與生產(chǎn)過程中的控制和決策，因此對液體密度進行...
- 關(guān)鍵字： FPGA 超聲波液體密度傳感器 設(shè)計
基于FPGA滑動相關(guān)法偽碼捕獲的研究與實現(xiàn)
- 引言對于碼分多址的擴頻通信方式而言，只有當(dāng)接收端本地偽碼與發(fā)端偽碼處于相同相位狀態(tài)時，有用的信...
- 關(guān)鍵字： FPGA 滑動相關(guān)法 偽碼捕獲
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